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晶圓代工大客戶(hù)砍單力道不輕　臺(tái)積電、聯(lián)電4Q成長(zhǎng)籠罩陰霾

　　臺(tái)積電于日前召開(kāi)業(yè)務(wù)會(huì)議，對(duì)于2009年第4季客戶(hù)投單狀況已更趨明朗，由于手機(jī)芯片客戶(hù)高通(Qualcomm)及FPGA(Field-Programmable Gate Arrays)芯片大客戶(hù)賽靈思(Xilinx)、Altera紛縮減第4季訂單，使得臺(tái)積電、聯(lián)電對(duì)于第4季營(yíng)收成長(zhǎng)幅度趨于謹(jǐn)慎觀望，而在主流成熟制程方面，LCD驅(qū)動(dòng)IC客戶(hù)包括奇景、聯(lián)詠已停止向晶圓代工廠增加訂單，顯示LCD終端需求恐已呈現(xiàn)疲軟、甚至有崩盤(pán)之虞。　　臺(tái)積電全球業(yè)務(wù)會(huì)議日前召開(kāi)，由于客戶(hù)近期紛與臺(tái)積電敲定第4季最新投片
關(guān)鍵字： Qualcomm 手機(jī)芯片 FPGA 晶圓代工

TI將數(shù)字電源管理成功應(yīng)用于新一代Xilinx FPGA設(shè)計(jì)

　　日前，德州儀器 (TI) 宣布，Xilinx 在其最新 Virtex®-6 ML605 現(xiàn)場(chǎng)可編程門(mén)陣列 (FPGA) 評(píng)估套件中采用 TI 電源管理技術(shù)簡(jiǎn)化電源設(shè)計(jì)。TI Fusion Digital Power™ 控制器可為 FPGA 用戶(hù)提供高級(jí)電源管理功能以及高度的設(shè)計(jì)靈活性，可實(shí)時(shí)監(jiān)控電源系統(tǒng)的工作情況。　　Xilinx 平臺(tái)市場(chǎng)營(yíng)銷(xiāo)總監(jiān) Brent Przybus 指出：“隨著 FPGA 設(shè)計(jì)的日益復(fù)雜化，具有精確電流監(jiān)控功能的智能電源管理解決方案的需求
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基于FPGA的多通道同步數(shù)據(jù)采集存儲(chǔ)系統(tǒng)

1 引言
在現(xiàn)代信號(hào)處理系統(tǒng)中，多通道數(shù)據(jù)采集存儲(chǔ)系統(tǒng)廣泛應(yīng)用于各種商用以及工業(yè)領(lǐng)域中，特別是在艦上系統(tǒng)、彈上設(shè)備及艦上部分系統(tǒng)中，往往產(chǎn)生寬帶信號(hào)或上升沿下降沿較陡的模擬信號(hào)。對(duì)這樣的模擬信號(hào)往往
關(guān)鍵字： FPGA 多通道存儲(chǔ)系統(tǒng) 同步數(shù)據(jù)采集

賽靈思目標(biāo)設(shè)計(jì)平臺(tái)方案獲行業(yè)高度認(rèn)可

　　全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc. ) 今天宣布，在8月28日成都舉辦的“2009中國(guó)FPGA產(chǎn)業(yè)發(fā)展論壇”上，《中國(guó)電子報(bào)》把“2009 FPGA最佳產(chǎn)品獎(jiǎng)”授予賽靈思目標(biāo)設(shè)計(jì)平臺(tái)(Target Design Platform, 簡(jiǎn)稱(chēng)TDP)，對(duì)該平臺(tái)在幫助客戶(hù)大幅縮短研發(fā)周期，輕松實(shí)現(xiàn)創(chuàng)新設(shè)計(jì)并大大增強(qiáng)客戶(hù)競(jìng)爭(zhēng)力方面的突出優(yōu)勢(shì)，給予了充分的肯定。　　“賽靈思公司推出的目標(biāo)設(shè)計(jì)平臺(tái)，給FPGA產(chǎn)品賦予了新
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優(yōu)勢(shì)劣勢(shì)同樣明顯 FPGA力爭(zhēng)市場(chǎng)主力地位

　　盡管FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)從誕生至今只有20多年的歷史，但作為一個(gè)新興產(chǎn)業(yè)，F(xiàn)PGA已經(jīng)取得了輝煌的成就。8月28日，中國(guó)電子報(bào)社在成都舉辦了“2009中國(guó)FPGA產(chǎn)業(yè)發(fā)展論壇”，F(xiàn)PGA企業(yè)的代表、系統(tǒng)企業(yè)的代表、市場(chǎng)調(diào)研公司的分析師以及關(guān)注FPGA產(chǎn)業(yè)的各界人士共聚一堂，熱烈探討FPGA產(chǎn)業(yè)的發(fā)展現(xiàn)狀和未來(lái)趨勢(shì)。　　靈活性凸顯FPGA優(yōu)勢(shì) 　　從工藝技術(shù)來(lái)看，和CPU一樣，F(xiàn)PGA始終走在半導(dǎo)體產(chǎn)業(yè)的前列，如今已躋身40納米陣營(yíng);就應(yīng)用領(lǐng)域而言，F(xiàn)PGA已從最初
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SOPC技術(shù)在視覺(jué)測(cè)量中的設(shè)計(jì)方案與應(yīng)用

1引言視覺(jué)測(cè)量技術(shù)是以機(jī)器視覺(jué)技術(shù)為基礎(chǔ)，融合電子技術(shù)、計(jì)算機(jī)技術(shù)、近景攝影測(cè)量技術(shù)、圖像處理...
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基于FPGA的兩路視頻同步播放系統(tǒng)的設(shè)計(jì)

1、引言
如圖 1所示，兩臺(tái)攝像機(jī)C1、C2分別對(duì)具有部分重疊區(qū)域的景物進(jìn)行拍攝。在 t1時(shí)刻拍攝，得到了圖像A1、B1；在下一時(shí)刻t2，得到了圖像A2、B2。
在同一屏幕上重現(xiàn)原圖像時(shí)，必須保證兩個(gè)播放器依次同時(shí)播放圖
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基于FPGA的DES加密算法的高性能實(shí)現(xiàn)

在分析DES算法原理的基礎(chǔ)上，詳細(xì)闡述一種基于VHDL描述、FPGA實(shí)現(xiàn)的DES加密算法系統(tǒng)的設(shè)計(jì)和仿真結(jié)果。該系統(tǒng)采用了一種基于子密鑰預(yù)先計(jì)算的新型流水線(xiàn)設(shè)計(jì)方案，克服了傳統(tǒng)DES流水線(xiàn)實(shí)現(xiàn)方式的缺點(diǎn)，使系統(tǒng)的密鑰可動(dòng)態(tài)刷新．并在硬件資源消耗有所降低的情況下，進(jìn)一步提高系統(tǒng)的處理速度，系統(tǒng)最高時(shí)鐘頻率為222．77 MHz．信息加密的速度為14．26 Gb／s，是最快軟件實(shí)現(xiàn)方式的112倍。同時(shí)系統(tǒng)還具有設(shè)計(jì)靈活，可靠性高，可重用性強(qiáng)．升級(jí)方便等特點(diǎn)。
關(guān)鍵字： FPGA DES 加密算法性能

基于單片機(jī)和FPGA的多功能計(jì)數(shù)器的設(shè)計(jì)

1 引言
頻率、周期、相位是交流信號(hào)的3大要素。一般情況下，分析交流信號(hào)需研究其頻率與相位，而周期可直接由頻率計(jì)算。對(duì)于正弦信號(hào)的頻率、相位測(cè)量準(zhǔn)確度的要求不斷提高，而隨著電子技術(shù)的發(fā)展，對(duì)其測(cè)量方法
關(guān)鍵字：計(jì)數(shù)器設(shè)計(jì) 多功能 FPGA 單片機(jī) 基于

基于FPGA技術(shù)的模擬雷達(dá)信號(hào)的設(shè)計(jì)與實(shí)現(xiàn)

前言FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列）是由掩膜可編程門(mén)陣列和PLD（可編程邏輯器件）演變而來(lái)的，并將二者的特性結(jié)合...
關(guān)鍵字： FPGA 模擬雷達(dá)信號(hào)

流水線(xiàn)技術(shù)在基于FPGA的DSP運(yùn)算中的應(yīng)用

在數(shù)字信號(hào)處理(DSP)領(lǐng)域，需要處理的數(shù)據(jù)量很大，并且實(shí)時(shí)性要求很高。傳統(tǒng)的DSP設(shè)計(jì)方法主要有采用固定功...
關(guān)鍵字：流水線(xiàn)技術(shù) FPGA DSP 運(yùn)算

基于FPGA和SC16C554實(shí)現(xiàn)多串口通信的方法

0引言隨著電子技術(shù)的飛躍發(fā)展，通用數(shù)字信號(hào)處理器(DSP)的性能價(jià)格比不斷提高，數(shù)據(jù)處理能力不斷加...
關(guān)鍵字： FPGA SC16C554 多串口通信

滿(mǎn)足RF處理需求的嵌入式儀器設(shè)計(jì)

無(wú)線(xiàn)市場(chǎng)就像是我們的一個(gè)新生的領(lǐng)域。新的射頻(RF)技術(shù)的爆炸性增長(zhǎng)為解決老問(wèn)題創(chuàng)造了新機(jī)會(huì)。靈活的高分辨率波形生成，數(shù)字化以及分析子系統(tǒng)能夠利用射頻信號(hào)配合下變頻, 并且調(diào)整多個(gè)關(guān)心點(diǎn)也是必需的。在并發(fā)，
關(guān)鍵字：儀器 AMD 嵌入式 FPGA RF 處理 USB

基于FPGA的數(shù)字下變頻設(shè)計(jì)與實(shí)現(xiàn)

在擴(kuò)頻通信中，數(shù)字下變頻（DDC）是一種很重要的技術(shù)，它包括數(shù)字混頻器、數(shù)控振蕩器以及數(shù)字濾波器三部分。而傳統(tǒng)的DDC大多采用專(zhuān)用芯片，雖然其外圍電路簡(jiǎn)單、功能實(shí)現(xiàn)容易控制，但其大部分功能已經(jīng)固化，存在兼容
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基于FPGA的正交數(shù)字混頻器中數(shù)控振蕩器的設(shè)計(jì)與實(shí)

要CORDIC(COordination Rotation DIgital Computer)算法實(shí)現(xiàn)正交數(shù)字混頻器中的數(shù)控振蕩器的方法。首先推導(dǎo)了算法產(chǎn)生正余弦信號(hào)的實(shí)現(xiàn)過(guò)程,然后給出了在中設(shè)計(jì)數(shù)控振蕩器的頂層電路結(jié)構(gòu),并根據(jù)算法特點(diǎn)在設(shè)計(jì)中引入
關(guān)鍵字： FPGA 正交數(shù)字混頻器數(shù)控振蕩器