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基于FPGA+PCI的并行計算平臺實現(xiàn)
- 當前對于各種加密算法.除了有針對性的破解算法，最基本的思想就是窮舉密鑰進行匹配，通常稱為暴力破解算法。由于暴力破解算法包含密鑰個數(shù)較多，遍歷的時間超過實際可接受的范圍。如果計算速度提高到足夠快。這種遍歷的算法因結(jié)構設計簡便而具有實際應用的前景。 PCI總線(外設互聯(lián)總線)與傳統(tǒng)的總線標準——ISA總線(工業(yè)標準結(jié)構總線)相比，具有更高的傳輸率(132MBps)、支持32位處理器及DMA和即插即用等優(yōu)點，用于取代ISA總線而成為目前臺式計算機的事實I/O總線標準，在普通PC機和工控機上有著廣泛的應
- 關鍵字： 嵌入式系統(tǒng) 單片機 FPGA PCI 并行計算 MCU和嵌入式微處理器
基于FPGA的分布式算法FIR濾波器設計
- 引 言 FIR(finite impulse response)濾波器是數(shù)字信號處理系統(tǒng)中最基本的元件，它可以在保證任意幅頻特性的同時具有嚴格的線性相頻特性，同時其單位沖激響應是有限的，沒有輸入到輸出的反饋，是穩(wěn)定的系統(tǒng)。因此，F(xiàn)IR濾波器在通信、圖像處理、模式識別等領域都有著廣泛的應用。 目前FIR濾波器的硬件實現(xiàn)有以下幾種方式： 一種是使用單片通用數(shù)字濾波器集成電路，這種電路使用簡單，但是由于字長和階數(shù)的規(guī)格較少，不易完全滿足實際需要。雖然可采用多片擴展來滿足要求，但會增加體積和
- 關鍵字： 嵌入式系統(tǒng) 單片機 FIR FPGA 濾波器 MCU和嵌入式微處理器
FPGA奔向45納米
- Altera公司技術開發(fā)副總裁Mojy Chian博士來到北京，在媒體座談會上介紹了該公司45nm IC開發(fā)的情況。他說，45nm相對65nm的優(yōu)勢要比65nm相對90nm的優(yōu)勢更大，同時開發(fā)難度也更高。Altera通過選擇正確的合作伙伴、采用“第一片硅投產(chǎn)”的方法以及協(xié)作設計和工藝開發(fā)的方式來實現(xiàn)2008年45nm FPGA的生產(chǎn)。 那個叫Moore的人真幸運。他沒有發(fā)現(xiàn)真正的物理定律。他只不過總結(jié)并預測了半導體產(chǎn)業(yè)的發(fā)展規(guī)律，但他可能比大多數(shù)發(fā)現(xiàn)真正定律的物理學家都著名。說他幸運，是因為那個
- 關鍵字： 嵌入式系統(tǒng) 單片機 FPGA 45納米 IC 模擬IC
C語言平臺 縮短SoC前期設計時間
- 在設計上能減少結(jié)構探索時間的C語言平臺，在結(jié)構上如何以新思考突破? 以往半導體業(yè)者大多使用FPGA(Field Programmable Gate Array)製作樣品(Prototype)，接著鎖定幾項晶片重要規(guī)格，依此找出最適合該晶片的結(jié)構，這種方式最大缺點是作業(yè)時間非常冗長。然而，C語言平臺的設計方式則是，利用軟體模擬分析檢討晶片結(jié)構，以往FPGA平臺的樣品，大約需要半年左右的結(jié)構探索時間，如果採用C語言平臺的設計方式，只需要花費約2周~1個月的時間。 目前開發(fā)最快的是日本沖電氣，以
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FPGA在語音存儲與回放系統(tǒng)中的應用
- 1 引言 隨著數(shù)字信號處理器、超大規(guī)模集成電路的高速發(fā)展，語音記錄技術已從模擬錄音階段過渡到數(shù)字錄音階段。在數(shù)字化錄音技術中，壓縮后的語音數(shù)據(jù)有些存儲在硬盤中，有些存儲在帶有掉電保護功能的RAM或FLASH存儲器中。筆者介紹的語音存儲與回放系統(tǒng)，未使用專用的語音處理芯片，不需要擴展接口電路，只利用FPGA作為核心控制器，就能完成語音信號的數(shù)字化處理，即實現(xiàn)語音的存儲與回放。 2 系統(tǒng)總體結(jié)構 數(shù)字化語音存儲與回放系統(tǒng)的基本工作原理是將模擬語音信號通過模數(shù)轉(zhuǎn)換器(A/D)轉(zhuǎn)換成數(shù)字信號
- 關鍵字： 嵌入式系統(tǒng) 單片機 FPGA 語音存儲 MCU和嵌入式微處理器
基于FPGA的32 Kbit/s CVSD語音編解碼器的實現(xiàn)
- 64 Kbit/s的A律或μ律的對數(shù)壓擴PCM編碼在大容量的光纖通信系統(tǒng)和數(shù)字微波系統(tǒng)中已得到廣泛應用，但由于占用較大的傳輸帶寬和具有復雜的成幀結(jié)構，PCM編碼不適合無線語音系統(tǒng)的應用。連續(xù)可變斜率增量(Continuously Variable Slope Delta，CVSD)調(diào)制以其較低的應用難度、成本和編碼速率，較好的語音質(zhì)量廣泛應用于戰(zhàn)術通信網(wǎng)、衛(wèi)星通信、藍牙等無線語音傳輸領域。近年來FPGA不斷發(fā)展演化，并在構架方面針對DSP應用有了顯著增強。這些增強使得FPGA能夠支持各領域的眾多復雜D
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采用AVR單片機對FPGA進行配置
- Altera公司的ACEX、FLEX等系列的FPGA芯片應用廣泛，但其FPGA基于SRAM結(jié)構，決定電路邏輯功能的編程數(shù)據(jù)存儲于SRAM中。由于SRAM的易失性，每次上電時必須重新把編程數(shù)據(jù)裝載到SRAM中，這一過程就是FPGA的配置過程。FPGA的配置分為主動式和被動式。在主動模式下，F(xiàn)PGA上電后主動將配置數(shù)據(jù)從專用的EPROM(如EPC1，EPC2等)加載到SRAM中。被動模式下，F(xiàn)PGA為從屬器件，由相應的控制電路或微處理器控制配置過程，包括通過下載
- 關鍵字： 單片機 FPGA MCU和嵌入式微處理器
FPGA的堆疊封裝，欲革背板與SoC的命
- FPGA最基本的應用是橋接。隨著FPGA的門數(shù)不斷提高，雄心勃勃的FPGA巨頭們早已不滿足這些，他們向著信號處理、互聯(lián)性和高速運算方向發(fā)展。未來，F(xiàn)PGA還有望與模擬和存儲器廠商合作，做出SIP（堆疊封裝）。 最近，筆者訪問了Xilinx公司的CTO Ivo Bolsens，他說未來的FPGA一方面是在功耗、性能、價格方面進行不停地改進，未來將出現(xiàn)革命性的變化就是利用推迭封裝（SIP），一個封裝里面放多個裸片的技術，那么FPGA平臺可能就會成為一個標準的、虛擬的SoC（Virtual SoC）的
- 關鍵字： FPGA SoC MCU和嵌入式微處理器
基于FPGA的計算機防視頻信息泄漏系統(tǒng)設計
- 假如顯示終端為數(shù)字微鏡DMD(Digital MicromirrorDevice)顯示器。該顯示器將計算機每個像素點的圖像信號經(jīng)過數(shù)字光處理DLP(Digital Light Processing)后，存入SDRAM雙向緩存器，當一幀圖像接收完畢時，內(nèi)部數(shù)據(jù)處理電路同時激發(fā)各像素點對應的微鏡運動，完成一幀圖像的顯示。DMD顯示器峰值數(shù)字驅(qū)動電壓不超過33.5V，電磁輻射很低，且各微鏡片同時驅(qū)動，形成相互干擾的向外輻射信號，解碼難度極大，從而使其成為無信息泄漏的顯示器。此時，視頻電纜的輻射在整個視頻通路
- 關鍵字： 嵌入式系統(tǒng) 單片機 FPGA 視頻信息 MCU和嵌入式微處理器
嵌入式系統(tǒng)中從串配置FPGA的實現(xiàn)
- 本文主要論述在ARM嵌入式系統(tǒng)中如何實現(xiàn)FPGA從串配置的方法，將系統(tǒng)程序及配置數(shù)據(jù)存儲在系統(tǒng)Flash中，利用ARM的通用I/O口產(chǎn)生配置時序，省去專用的配置PROM。 文中ARM微處理器采用samsung公司的ARM7TDMI系列中的S3C4480X，F(xiàn)PGA采用xilinx 公司spartan3E系列中的XC3S100E，詳細討論FPGA的從串配置的時序，同時論述S3C4480X從串配置spartan3E系列FPGA的軟、硬件實現(xiàn)方法。實踐證明，該方法在成本、體積、靈活性上均具有優(yōu)勢
- 關鍵字： 嵌入式系統(tǒng) 單片機 嵌入式 FPGA MCU和嵌入式微處理器
在嵌入式系統(tǒng)中用FPGA進行開發(fā)的幾個發(fā)展方向
- 顧名思義，嵌入式系統(tǒng)指的是嵌入到系統(tǒng)內(nèi)部的計算機系統(tǒng)，是面向特定應用設計的專用計算機系統(tǒng)。 早期的嵌入式系統(tǒng)一般是以通用處理器或單片機為核心，在外圍電路中加入存儲器、功率驅(qū)動器、通信接口、顯示接口、人機輸入接口等外圍接口，再加上應用軟件，有些還加上了嵌入式操作系統(tǒng)，從而構成完整的系統(tǒng)。 隨著微電子技術的進步，SoC已經(jīng)在很多應用中取代了傳統(tǒng)的以單片機為中心的架構，將很多外設和存儲器集成在一個芯片中，使系統(tǒng)的
- 關鍵字： 嵌入式系統(tǒng) FPGA MCU和嵌入式微處理器
FPGA助力高端存儲器接口設計
- 高性能系統(tǒng)設計師在滿足關鍵時序余量的同時要力爭獲得更高性能，而存儲器接口設計則是一項艱巨挑戰(zhàn)。雙倍數(shù)據(jù)速率SDRAM和4倍數(shù)據(jù)速率SDRAM都采用源同步接口來把數(shù)據(jù)和時鐘(或選通脈沖)由發(fā)射器傳送到接收器。接收器接口內(nèi)部利用時鐘來鎖存數(shù)據(jù)，此舉可消除接口控制問題(例如在存儲器和FPGA間的信號傳遞時間)，但也為設計師帶來了必須解決的新挑戰(zhàn)。 關鍵問題之一就是如何滿足各種讀取數(shù)據(jù)捕捉需求以實現(xiàn)高速接口。隨著數(shù)據(jù)有效窗越來越小，該問題也益發(fā)重要；同時，更具挑戰(zhàn)性的問題是，如何讓接收到的時鐘與數(shù)據(jù)中
- 關鍵字： FPGA 存儲器 接口 模擬IC
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