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基于FPGA的數(shù)據(jù)采集控制模塊設計
- 0 引 言
數(shù)據(jù)采集和控制系統(tǒng)是對生產(chǎn)過程或科學實驗中各種物理量進行實時采集、測試和反饋控制的閉環(huán)控制，它在工業(yè)控制、軍事電子設備、醫(yī)學監(jiān)護等許多領域發(fā)揮著重要作用。其中，數(shù)據(jù)采集部分尤為重要，而傳統(tǒng) - 關鍵字： FPGA 數(shù)據(jù) 采集控制 模塊設計
對基于FPGA的作戰(zhàn)系統(tǒng)時統(tǒng)的研究與設計
- O引言作戰(zhàn)系統(tǒng)時間的統(tǒng)一同步(時統(tǒng))的重要性越來越得到重視，只有保證整個系統(tǒng)處在同一時間的基準...
- 關鍵字： FPGA 作戰(zhàn)系統(tǒng) 時統(tǒng)
基于FPGA的8段數(shù)碼管動態(tài)顯示IP核設計
- 設計基于FPGA的8段數(shù)碼管動態(tài)顯示IP核，介紹8段數(shù)碼管內(nèi)部結(jié)構(gòu)及其驅(qū)動顯示方式和IP核設計方法，給出8段數(shù)碼管動態(tài)顯示IP核的Verilog HDL程序源代碼及其C語言驅(qū)動程序。此IP核可例化成1～8個共陰極(或共陽極)數(shù)碼管控制器，能方便地控制1～8個數(shù)碼管同時顯示數(shù)字和小數(shù)點位。測試結(jié)果表明，該IP核工作可靠、穩(wěn)定，可直接應用于電子設計中。
- 關鍵字： FPGA 8段數(shù)碼管 動態(tài)顯示 IP核
基于FPGA技術的數(shù)字相關器的設計與實現(xiàn)
- 1 引 言 同步在通信系統(tǒng)中占有非常重要的地位,同步系統(tǒng)性能的高低在很大程度上決定了通信系統(tǒng)的質(zhì)量,甚至通信的成敗。相關器是同步系統(tǒng)的關鍵部件之一,因此,要求相關器須有比其它部件更高的可靠性。
- 關鍵字： FPGA 數(shù)字相關器
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