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          PLD將憑借高效低耗挑戰(zhàn)消費電子領域

          • 可編程邏輯器件(PLD)的兩種主要類型是現(xiàn)場可編程門陣列(FPGA)和復雜可編程邏輯器件(CPLD)。根據(jù)半導體行業(yè)協(xié)會提供的數(shù)據(jù),PLD現(xiàn)在是半導體行業(yè)中增長最快的領域之一,高性能PLD現(xiàn)在已經從采用最先進的標準單元技術制
          • 關鍵字: PLD  FPGA  CPLD  

          采用雙閉環(huán)控制提高PWM的電源紋波抑制

          • 摘要:文章提出了一種新的調制技術,以提高數(shù)字脈沖寬度調制器(PWM)的電源紋波抑制。這種調制技術的特點是使用兩個反饋點(開關節(jié)點和輸出點),以使在相對低的開關頻率下實現(xiàn)高增益和高帶寬。由此能夠得到高環(huán)路增益,
          • 關鍵字: 脈沖寬度調制(PWM)  帶寬  增益  紋波抑制  

          賽靈思FPGA受DLP數(shù)字影院投影儀青睞

          • 賽靈思公司(Xilinx)日前宣布NEC子公司NEC Display Solutions有限公司的三款DLP數(shù)字影院投影儀產品,均采用了賽靈思Virtexreg;-5 FPGA系列產品。DLP數(shù)字影院投影儀符合美國數(shù)字影院計劃(DCI1)標準,擁有一系列優(yōu)異的
          • 關鍵字: FPGA  賽靈思  DLP  投影儀  Virtex  NEC  

          通過實時改變使用率研究FPGA功耗行為

          • 現(xiàn)代的FPGA 芯片能夠開發(fā)高性能應用,但在這些設計中電源管理通常是一大限制因素。FPGA 器件的資源使用最能決定設計的容量和處理速度,但是增加資源就會提高功耗。更高的功耗會提高運行成本、面積要求和結溫,而設計
          • 關鍵字: 賽靈思  FPGA  

          FPGA設計規(guī)劃框架

          • 這款久經考驗的FPGA開發(fā)框架是您通向完美項目執(zhí)行的通途。長久以來新型FPGA的功能和性能已經為它們贏得系統(tǒng)中的核心位置,成為許多產品的主要數(shù)據(jù)處理引擎。鑒于FPGA在如此多應用中的重要地位,采取正式且注重方法的
          • 關鍵字: FPGA  

          利用Xilinx FPGA實現(xiàn)高效并行實時上采樣

          • 本文介紹一種使用Virtex-6器件和免費WebPACK工具實現(xiàn)實時四倍上采樣的方法。許多信號處理應用都需要進行上采樣。從概念上講,對數(shù)據(jù)向量進行M倍上采樣的最簡單方法是用實際頻率分量數(shù)的(M-1)倍個零填充數(shù)據(jù)向量的離散
          • 關鍵字: Xilinx  FPGA  采樣  

          利用FPGA對大規(guī)模MIMO信道進行特性描述

          • 多用戶MIMO(MUMIMO)是一種無線通信技術,采用基礎架構節(jié)點(例如基站和接入點)上的多個天線為多個客戶同時提供服務。MU-MIMO是未來無線標準中必不可少的組成部分,有望為繁忙的網絡帶來顯著的性能提升。人們預想隨著無
          • 關鍵字: FPGA  MIMO  

          基于FPGA高速大容量數(shù)據(jù)采集與存儲系統(tǒng)

          • 大容量數(shù)據(jù)采集與存儲系統(tǒng)在工業(yè)自動化生產、國防和軍事監(jiān)控及環(huán)境監(jiān)測等方面被廣泛應用。為了能夠完整、準確地捕獲到各種信號或者故障發(fā)生時的特征信號,需要對其進行狀態(tài)監(jiān)測,并且要求監(jiān)測系統(tǒng)具備長時間連續(xù)采集
          • 關鍵字: 數(shù)據(jù)采集    存儲    FPGA  

          基于FPGA的車電總線接口技術研究

          • 為提高集成架構中車電總線通信速率,結合綜合化處理系統(tǒng)項目要求,采用雙總線結合的方式,利用CAN總線和FlexRay總線實現(xiàn)功能及搭配上的互補,提出一種基于現(xiàn)場可編程門陣列(FPGA)的總線接口單元設計方案。通過FPGA完
          • 關鍵字: FPGA    FlexRay總線    CAN總線    總線接口  

          FPGA復位的可靠性設計方法

          • 對FPGA設計中常用的復位設計方法進行了分類、分析和比較。針對FPGA在復位過程中存在不可靠復位的現(xiàn)象,提出了提高復位設計可靠性的4種方法,包括清除復位信號上的毛刺、異步復位同步釋放、采用專用全局異步復位/置位
          • 關鍵字: FPGA    復位可靠性    同步復位    異步復位  

          基于FPGA的數(shù)字存儲示波器對外圍芯片的控制設計

          • 數(shù)字存儲示波器作為測試技術的重要工具,被廣泛應用于各個領域,并逐步取代傳統(tǒng)模擬示波器。其采樣數(shù)據(jù)是波形運算和分析的基礎,直接影響到整個數(shù)字存儲示波器的準確性。從這點出來,提出采用現(xiàn)場可編程邏輯器件(
          • 關鍵字: 數(shù)字存儲示波器    FPGA  

          基于FPGA的RS(255,239)編譯碼器設計及實現(xiàn)方法

          • RS(Reed—Solomon)編碼是一種具有較強糾錯能力的多進制BCH編碼,其既可糾正隨機錯誤,又可糾正突發(fā)錯誤。RS編譯碼器廣泛應用于通信和存儲系統(tǒng),為解決高速存儲器中數(shù)據(jù)可靠性的問題,文中提出了RS編碼的實現(xiàn)方
          • 關鍵字: RS編譯碼    FPGA    伽羅華域    BM算法    Chien搜索  

          多通道實時陣列信號處理系統(tǒng)的設計

          • 摘要:以全數(shù)字化信號產生和數(shù)字波束形成處理為基礎的數(shù)字化陣列雷達已成為當代相控陣雷達技術發(fā)展的一個重要趨勢,本文針對現(xiàn)代數(shù)字化陣列雷達對多通道數(shù)據(jù)采集和實時處理的需求,設計了一種基于FPGA的多通道實時陣
          • 關鍵字: 陣列信號  多通道采集  FPGA  數(shù)字波束合成  

          FPGA與ADC數(shù)字數(shù)據(jù)輸出的接口及LVDS應用訣竅

          • 現(xiàn)場可編程門陣列(FPGA)與模數(shù)轉換器(ADC)輸出的接口是一項常見的工程設計挑戰(zhàn)。本文簡要介紹各種接口協(xié)議和標準,并提供有關在高速數(shù)據(jù)轉換器實現(xiàn)方案中使用LVDS的應用訣竅和技巧。接口方式和標準現(xiàn)場可編程門陣列
          • 關鍵字: FPGA    ADC    LVDS    JESD204    接口方式  

          完善FPGA系統(tǒng)設計的三原則

          • 一,面積與速度的平衡互換原則這里的面積指的是FPGA的芯片資源,包括邏輯資源和I/O資源等;這里的速度指的是FPGA工作的最高頻率(和DSP或者ARM不同,F(xiàn)PGA設計的工作頻率是不固定的,而是和設計本身的延遲緊密相連)。
          • 關鍵字: FPGA    系統(tǒng)設計    設計原則  
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          fpga-pwm介紹

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