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fpga-to-asic 文章進(jìn)入fpga-to-asic技術(shù)社區(qū)

FAQ-賽靈思28nm FPGA常見問題解答

1、什么是賽靈思7系列產(chǎn)品? 　　賽靈思7系列三款FPGA基于高性能，低功耗HPL28nm工藝，且建立在行業(yè)最低功耗和唯一統(tǒng)一架構(gòu)之上，可以提供突破性的功耗，性能及設(shè)計可移植性。這種創(chuàng)新的架構(gòu)使得設(shè)計方案可以在7系列的三大產(chǎn)品Artix-7, Kintex-7以及 Virtex-7方便的進(jìn)行移植。系統(tǒng)制造商可以非常容易的成功實現(xiàn)規(guī)模設(shè)計以滿足市場需求，同時降低成本和功耗，增加系統(tǒng)性能和容量。采用AMBA4 AXI4 作為互聯(lián)支持即插即用FPGA設(shè)計，IP復(fù)用進(jìn)一步提高了生產(chǎn)率，可移植性以及精確性。
關(guān)鍵字：賽靈思 FPGA Zynq-7000

FAQ-Virtex-7HT常見問題解答

1. 賽靈思將發(fā)布內(nèi)容是什么? 　　賽靈思將發(fā)布 Virtex-7 HT FPGA，該產(chǎn)品在單片 FPGA 中集成了業(yè)界最多數(shù)量的串行收發(fā)器—16個 28Gbps 和72個 13.1Gbps 串行收發(fā)器，能夠滿足 100Gbps 和 400Gbps 帶寬應(yīng)用的需要。如欲觀看賽靈思 28Gbps 收發(fā)器的演示視頻，請訪問：http://www.xilinx.com/cn/28gbps。在該視頻中，信號完整性專家 Howard Johnson 博士對 Virtex-7 HT FPGA 的 28Gbps
關(guān)鍵字： Xilinx Virtex-7 HT FPGA

基于FPGA實現(xiàn)VLIW微處理器

超長指令字VLIW微處理器架構(gòu)采用了先進(jìn)的清晰并行指令設(shè)計。VLIW微處理器的最大優(yōu)點是簡化了處理器的結(jié)構(gòu)，刪除了處理器內(nèi)部許多復(fù)雜的控制電路，它能從應(yīng)用程序中提取高度并行的指令數(shù)據(jù)，并把這些機(jī)器指令均勻地分
關(guān)鍵字： FPGA VLIW 微處理器

基于FPGA的并行掃頻DDS的實現(xiàn)

DDS同 DSP（數(shù)字信號處理）一樣，是一項關(guān)鍵的數(shù)字化技術(shù)。DDS是直接數(shù)字式頻率合成器（Direct Digital Synthesizer）的英文縮寫。與傳統(tǒng)的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉(zhuǎn)換時間等優(yōu)點，廣
關(guān)鍵字： FPGA DDS 并行

一種浮點反正切函數(shù)的FPGA設(shè)計和實現(xiàn)

快速精確的反正弦函數(shù)運(yùn)算在現(xiàn)代工程中應(yīng)用廣泛。為了提高反正弦函數(shù)的精度和計算能力，研究了基于CORD IC算法的反正弦函數(shù)運(yùn)算器的FPGA 實現(xiàn)，并通過改進(jìn)算法減小了誤差，使誤差精度達(dá)到10--4 數(shù)量級。并在X ili
關(guān)鍵字： FPGA 浮點反正切函數(shù)

詳解單片機(jī)系統(tǒng)的動態(tài)加密技術(shù)

摘要：單片機(jī)系統(tǒng)產(chǎn)品的加密和解密技術(shù)永遠(yuǎn)是一個矛盾的統(tǒng)一體。然而，為了更好的保護(hù)好自己的單片機(jī)技術(shù)成果和 ...
關(guān)鍵字：單片機(jī)系統(tǒng) 動態(tài)加密技術(shù) FPGA

基于單片機(jī)實現(xiàn)SRAM工藝FPGA的加密應(yīng)用

摘要：首先對采用SRAM工藝的FPGA的保密性和加密方法進(jìn)行原理分析，然后提出一種實用的采用單片機(jī)產(chǎn)生長偽隨機(jī)碼 ...
關(guān)鍵字：單片機(jī) SRAM工藝 FPGA 加密應(yīng)用

MELP混合線性碼激勵的FPGA實現(xiàn)的系統(tǒng)框架介紹

利用語音編碼技術(shù)可有效降低信息存儲量、提高信道利用率?；旌霞罹€性預(yù)測(MELP)語音編碼算法能在較低碼率下提供較高的語音質(zhì)量、自然度和清晰度，已成為美國國防部新的2.4 Kb/s的語音編碼標(biāo)準(zhǔn)。語音編碼技術(shù)在當(dāng)今
關(guān)鍵字： MELP FPGA 線性激勵

FPGA與DSP：競合中縮小差距

DSP和FPGA由于各有優(yōu)缺點，因而各有擅長的應(yīng)用領(lǐng)域。近年來，F(xiàn)PGA在與DSP的競合中，在降低開發(fā)難度、提高設(shè)計流程的生產(chǎn)效率方面做了大量工作，逐步縮小了與DSP的差距。
關(guān)鍵字： DSP FPGA

以FPGA為核心的多功能輸液系統(tǒng)的設(shè)計

今朝，病院輸液現(xiàn)場一般是人工節(jié)制和看管，但輸液速度和輸液量是一個很難切確把握的值，護(hù)士經(jīng)由過程動彈輸液器上...
關(guān)鍵字： FPGA

基于FPGA LPM多功能信號發(fā)生器設(shè)計

摘要：以FPGA芯片為載體，通過QuartusII的LPM_ROM模塊和VHDL語言為核心設(shè)計一個多功能信號發(fā)生器，根據(jù)輸入...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于FPGA的電子設(shè)計競賽電路板的設(shè)計與實現(xiàn)

摘要：介紹了一種基于FPGA的電子設(shè)計競賽電路板，該電路板由美國Altera公司的Cyclone系列FPGAEP1C6、單片...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于FPGA的像素探測器數(shù)據(jù)緩存設(shè)計

粒子對撞機(jī)[1]是建立在高能同步加速器上的一種粒子對撞裝置。對撞機(jī)運(yùn)行時，能量強(qiáng)大的粒子在其內(nèi)部經(jīng)過加速...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于FPGA的CORDIC算法的改進(jìn)及實現(xiàn)

坐標(biāo)旋轉(zhuǎn)計算機(jī)CORDIC(TheCoordinateRotationalDigitalComputer)算法是一種用于計算一些常用的基本運(yùn)算...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于FPGA的成像聲納FFT波束形成器設(shè)計

海洋面積占地球表面積的71%，海底蘊(yùn)藏的石油、天然氣等礦產(chǎn)資源量也遠(yuǎn)遠(yuǎn)超過陸地。由于能源危機(jī)和資源短缺日...
關(guān)鍵字： FPGA

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fpga-to-asic介紹

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fpga-to-asic電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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基于FPGA集群的NEST脈沖神經(jīng)網(wǎng)絡(luò)仿真器
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