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          頻分分路中高速FFT的實現(xiàn)
          
                                                            
            
                    	
          • 摘    要：本文介紹了多相陣列FFT在星上多載波數(shù)字化分路中的應用，并針對星上處理的實時高速處理要求，提出了一種FFT的實現(xiàn)方案，并用一片F(xiàn)PGA芯片驗證了其正確性和可行性。關鍵詞：FFT；FPGA；頻分分路
多載波信號的數(shù)字化分路是衛(wèi)星通信星上處理技術的關鍵技術之一，數(shù)字化分路技術主要有并行濾波器組分路、樹形濾波器組分路和多相陣列FFT分路三種。在通道數(shù)較多時，多相陣列FFT有效地使用了抽取技術，且FFT算法具有很高的計算效率，本文所討論的就是該方法中FFT的實現(xiàn)。

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          • 關鍵字：
                        FFT  FPGA  頻分分路                          
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          基于FPGA的可編程定時器/計數(shù)器8253的設計與實現(xiàn)
          
                                                            
            
                    	
          • 摘    要：本文介紹了可編程定時器/計數(shù)器8253的基本功能，以及一種用VHDL語言設計可編程定時器/計數(shù)器8253的方法，詳述了其原理和設計思想，并利用Altera公司的FPGA器件ACEX 1K予以實現(xiàn)。關鍵詞：FPGA；IP；VHDL
引言在工程上及控制系統(tǒng)中，常常要求有一些實時時鐘，以實現(xiàn)定時或延時控制，如定時中斷，定時檢測，定時掃描等，還要求有計數(shù)器能對外部事件計數(shù)。要實現(xiàn)定時或延時控制，有三種主要方法：軟件定時、不可編程的硬件定時、可編程的硬件定時器。其中可編
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          • 關鍵字：
                        FPGA  IP  VHDL                          
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          可配置系統(tǒng)級驗證環(huán)境加速SoC開發(fā)
          
                                                            
            
                    	
          • 利用嵌入式硅IP可以縮短SoC設計所需的開發(fā)時間，這已成為眾所公認的事實。但要從完工后的整個系統(tǒng)角度出發(fā)，整合及驗證來自多家廠商的元件，需要相當?shù)臅r間和努力，然而它們卻常被忽略。這會對嵌入式軟件開發(fā)人員造成額外負擔，因為他們需要SoC的外圍和接口以及處理器的精確模型，才能在設計投片之前，針對正在開發(fā)的SoC，迅速完成應用固件的測試及除錯。如果SoC平臺以可配置處理器和外圍IP為基礎，這些IP又來自多家供貨商，這種情形就更加重要，因為設計人員必須確認在特定配置下，每個元件的功能不會影響到其它元件的工作。除此
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          • 關鍵字：
                        ARC  SoC  ASIC                          
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          雙層AMBA總線設計及其在SoC芯片設計中的應用
          
                                                            
            
                    	
          • 摘    要：AMBA總線是目前主流的片上總線。本文給出的雙層AMBA總線設計能極大地提高總線帶寬，并使系統(tǒng)架構更為靈活。文章詳細介紹了此設計的實現(xiàn)，并從兩個方面對兩種總線方式進行了比較。關鍵詞：雙層AMBA總線;總線帶寬;SoC
引言一般說來，SoC芯片是由片上芯核、用戶設計的IP核以及將這兩者集成在一起的總線組成的。片上芯核決定了使用何種片上總線以及芯片的體系結構。ARM系列嵌入式微處理器憑借其高性能、低功耗的特點占據(jù)了市場的主要份額，ARM7TDMI因其相對低廉的價格
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          • 關鍵字：
                        SoC  雙層AMBA總線  總線帶寬  SoC  ASIC                          
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          256級灰度LED點陣屏顯示原理及基于FPGA的電路設計
          
                                                            
            
                    	
          • 摘    要：本文提出了一種LED點陣屏實現(xiàn)256級灰度顯示的新方法。詳細分析了其工作原理。并依據(jù)其原理，設計出了基于FPGA 的控制電路。關鍵詞：256級灰度；LED點陣屏；FPGA；電路設計
引言256級灰度LED點陣屏在很多領域越來越顯示出其廣闊的應用前景，本文提出一種新的控制方式，即逐位分時控制方式。隨著大規(guī)?？删幊踢壿嬈骷某霈F(xiàn)，由純硬件完成的高速、復雜控制成為可能。
逐位分時點亮工作原理所謂逐位分時點亮，即從一個字節(jié)數(shù)據(jù)中依次提取出一位數(shù)據(jù)，分8次點亮對應的像
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          • 關鍵字：
                        256級灰度  FPGA  LED點陣屏  電路設計  發(fā)光二極管  LED                          
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          一種高效的復信號處理芯片設計
          
                                                            
            
                    	
          • 摘    要：本文提出了一種高效的復信號處理芯片的設計方法。本芯片是某雷達信號處理機的一部分，接收3組ADC的輸出復數(shù)據(jù)，依次完成去直流、加窗、512點FFT、求功率譜和累加3組信號的功率譜等功能。在這5種功能中，加窗、512點FFT和求功率譜復用一個蝶形單元。本芯片由單片F(xiàn)PGA實現(xiàn)，計算精度高、速度較快，滿足雷達系統(tǒng)的實時處理要求。關鍵詞：  FFT；蝶形單元；塊浮點；功率譜； FPGA
引言復信號處理芯片是某雷達系統(tǒng)的一部分。雷達系統(tǒng)的實時處理特點要求芯片運
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          • 關鍵字：
                        FFT  FPGA  蝶形單元  功率譜  塊浮點                          
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          采用FPGA實現(xiàn)脈動陣列
          
                                                            
            
                    	
          • 微電子學的發(fā)展徹底改變了計算機的設計：集成電路技術增加了能夠安裝到單個芯片中的元器件數(shù)目及其復雜度。因此，采用這種技術可以構建低成本、專用的外圍器件，從而迅速地解決復雜的問題。
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          • 關鍵字：
                        FPGA  脈動  陣列                            
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          基于AD9430的數(shù)據(jù)采集系統(tǒng)設計
          
                                                            
            
                    	
          • 摘   要：本文介紹了高速ADC AD9430的功能，詳細說明了使用高速FPGA來控制AD9430構成高速(140MSPS)、高精度(12位)數(shù)據(jù)采集系統(tǒng)的設計方法，并給出了具體實現(xiàn)的系統(tǒng)框圖和測試結果。關鍵詞：數(shù)據(jù)采集；FPGA；AD9430引言結合實際任務的要求，本文提出了一種基于AD9430的高速數(shù)據(jù)采集系統(tǒng)，主要用于采集雷達回波。在這個系統(tǒng)中，選用高速邏輯器件控制A/D轉換和FIFO存儲，同時通過FPDP(Front Panel Data Port)總線將采集的數(shù)據(jù)發(fā)送出去。由
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          • 關鍵字：
                        AD9430  FPGA  數(shù)據(jù)采集                          
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          基于FPGA的非對稱同步FIFO設計
          
                                                            
            
                    	
          • 摘    要：本文在分析了非對稱同步FIFO的結構特點及其設計難點的基礎上，采用VHDL描述語言，并結合FPGA，實現(xiàn)了一種非對稱同步FIFO的設計。關鍵詞：非對稱同步FIFO；VHDL；FPGA；DLL；BlockRAM引言FIFO是一種常用于數(shù)據(jù)緩存的電路器件，可應用于包括高速數(shù)據(jù)采集、多處理器接口和通信中的高速緩沖等各種領域。然而在某些應用，例如在某數(shù)據(jù)采集和處理系統(tǒng)中，需要通過同步FIFO來連接8位A/D和16位數(shù)據(jù)總線的MCU，但是由于目前同步FIFO器件的輸入與輸
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          • 關鍵字：
                        BlockRAM  DLL  FPGA  VHDL  非對稱同步FIFO  存儲器                          
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          基于FPGA的高速數(shù)字鎖相環(huán)的設計與實現(xiàn)
          
                                                            
            
                    	
          • 摘    要：本文提出了一種利用邊沿觸發(fā)鑒相縮短鎖相環(huán)捕獲時間的方案，并詳細介紹了該方案基于FPGA的實現(xiàn)方法。通過對所設計的鎖相環(huán)進行計算機仿真和硬件測試，表明該方案確實可以提高鎖相環(huán)的捕獲性能。關鍵詞：數(shù)字鎖相環(huán)(DPLL)；捕獲時間；FPGA；VHDL引言捕獲時間是鎖相環(huán)的一個重要參數(shù)，指的是鎖相環(huán)從起始狀態(tài)到達鎖定狀態(tài)所需時間。在一些系統(tǒng)中，如跳頻通信系統(tǒng)，由于系統(tǒng)工作頻率不斷地發(fā)生快速變化(每秒幾百次到幾千次，甚至高達上萬次)，要求鎖相環(huán)能夠對信號相位快速捕獲。因此
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          • 關鍵字：
                        FPGA  VHDL  捕獲時間  數(shù)字鎖相環(huán)(DPLL)                          
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          集系統(tǒng)級FPGA芯片XCV50E的結構與開發(fā)
          
                                                            
            
                    	
          • VirtexE系列是XILINX公司生產的新型FPGA芯片，可用來進行數(shù)十萬邏輯門級的系統(tǒng)設計和百兆赫茲級的高速電路設計。
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          • 關鍵字：
                        FPGA  50E  XCV  50                            
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          基于FPGA的光柵尺信號智能接口模塊
          
                                                            
            
                    	
          • 介紹了一種基于ALTERA公司大規(guī)?？删幊踢壿嬈骷﨓PF10K10的多功能光柵尺處理品電路。敘述了該電路的主要電路――四倍頻細分、辨向電路、計數(shù)電路、接口處理電路的設計原理，風時給出了詳細的電路和仿真波形。
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          • 關鍵字：
                        FPGA  光柵  信號  模塊                            
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          基于FPGA的同步測周期高精度數(shù)字頻率計的設計
          
                                                            
            
                    	
          • 摘    要：本文介紹了一種同步測周期計數(shù)器的設計，并基于該計數(shù)器設計了一個高精度的數(shù)字頻率計。文中給出了計數(shù)器的VHDL編碼，并對頻率計的FPGA實現(xiàn)進行了仿真驗證，給出了測試結果。關鍵詞：頻率計；VHDL；FPGA；周期測量
在現(xiàn)代數(shù)字電路設計中，采用FPGA結合硬件描述語言VHDL可以設計出各種復雜的時序和邏輯電路，具有設計靈活、可編程、高性能等優(yōu)點。本文將介紹一種基于FPGA，采用同步測周期的方法來實現(xiàn)寬頻段高精度數(shù)字頻率計的設計。

圖1 同步測周期計數(shù)器

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          • 關鍵字：
                        FPGA  VHDL  頻率計  周期測量                          
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          軟體當家的硬體設計走向
          
                                                            
            
                    	
          • 在過去，想獲得更隹的嵌入式產品功能，設計者想到的不二法門往往是采用更新一代的晶片制程技術，要不然，這樣的硬體設計取向至少能提供更小的尺寸，或更低的成本，而維持一定的功能水準
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          • 關鍵字：
                        嵌入式  FPGA  DSP                          
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          Cypress推出小體積高集成度PSoCTM器件
          
                                                            
            
                    	
          • 賽普拉斯半導體公司的子公司——賽普拉斯微系統(tǒng)公司 (Cypress MicroSystems) 近日宣布：其體積最小、集成度最高的可編程系統(tǒng)級芯片 (PSoCTM) 混合信號陣列已進入批量生產銷售階段。除了4個可配置模擬部件和4個可配置數(shù)字部件之外，CY8C21x34器件還提供了用于程序存儲器的8K字節(jié)快閃存儲器和用于數(shù)據(jù)存儲的512字節(jié)SRAM，從而使其成為對成本敏感的消費類和工業(yè)控制應用（比如觸摸感應控制屏、安全傳感器和控制、智能型溫度、壓力和流量傳感器、大型傳感器陣列、風扇控制器和電池充電器等）的理
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          • 關鍵字：
                        Cypress  SoC  ASIC                          
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	共6772條
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									450																451																452							»
			
	
 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