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          用LabVIEW FPGA模塊實現(xiàn)不同時鐘域的數(shù)據(jù)連續(xù)傳輸
          
                                                            
            
                    	
          • 摘要：為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來的數(shù)據(jù)不連續(xù)問題，結(jié)合LabVIEWFPGA的編程特點和DMA FIFO的工作原理，提出了一種設(shè)定FIFO深度的方法。對FIFO不同深度的實驗表明，采用該方法設(shè)定的FIFO深
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          • 關(guān)鍵字：
                        LabVIEW  FPGA  模塊  傳輸                            
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          基于FPGA的高速自適應(yīng)格型濾波器的實現(xiàn)
          
                                                            
            
                    	
          • 摘要：針對高速高靈敏度數(shù)字信號處理時對于自適應(yīng)濾波器的數(shù)值特性和實時性的要求，在一種自適應(yīng)格型聯(lián)合濾波器的基礎(chǔ)上提出算法改進，采用馳豫超前流水線技術(shù)和時序重構(gòu)技術(shù)，在損失較小濾波性能的情況下，在FPGA中
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          • 關(guān)鍵字：
                        FPGA  濾波器                            
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          cpld fpga 區(qū)別
          
                                                            
            
                    	
          • 系統(tǒng)的比較,與大家共享：盡管ＦＰＧＡ和ＣＰＬＤ都是可編程ＡＳＩＣ器件,有很多共同特點,但由于ＣＰＬＤ和ＦＰＧＡ結(jié)構(gòu)上的差異,具有各自的特點:①ＣＰＬＤ更適 ...
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          • 關(guān)鍵字：
                        cpld  fpga                          
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          用一個時鐘在FPGA中計算直方圖
          
                                                            
            
                    	
          • 直方圖對數(shù)字?jǐn)?shù)據(jù)的分析通常是一種有用的工具。不過，要從一個直方圖獲得可靠的結(jié)果，必須獲得大量數(shù)據(jù)，通常是要...
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          • 關(guān)鍵字：
                        FPGA                          
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          基于FPGA的UART接口開發(fā)方案
          
                                                            
            
                    	
          • 由于FPGA的功能日益強大，開發(fā)周期短、可重復(fù)編程等優(yōu)點也越來越明顯，可以在FPGA芯片上集成UART功能模塊，從...
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          • 關(guān)鍵字：
                        FPGA  UART接口                          
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          基于FPGA的UART接口模塊設(shè)計
          
                                                            
                                        
            
                    	
          • 基于FPGA的UART接口模塊設(shè)計,UART（UniversalAnynchronousReceiverTransmitter,通用異步接收發(fā)送器）是廣泛應(yīng)用的串行數(shù)據(jù)傳輸協(xié)議之一，其應(yīng)用范圍遍及計算機外設(shè)、工控自動化等場合。雖然USB傳輸協(xié)議比UART協(xié)議有更高的性能，但電路復(fù)雜開發(fā)難
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          • 關(guān)鍵字：
                        模塊  設(shè)計  接口  UART  FPGA  基于                          
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          一種基于FPGA的高速誤碼測試儀的設(shè)計
          
                                                            
            
                    	
          • 摘要：誤碼測試儀是檢測通信系統(tǒng)可靠性的重要設(shè)備。傳統(tǒng)的誤碼測試儀基于CPLD和CPU協(xié)同工作，不僅結(jié)構(gòu)復(fù)雜，價格昂貴，而且不方便攜帶?；贔PGA的高速誤碼測試儀，采用FPGA來完成控制和測試模塊的一體化設(shè)計，提高了
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          • 關(guān)鍵字：
                        FPGA  誤碼測試  儀的設(shè)計                            
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          基于FPGA的FIR濾波器的性能研究
          
                                                            
            
                    	
          • 摘要：目前FIR濾波器的一般設(shè)計方法比較繁瑣，開發(fā)周期長，如果采用設(shè)計好的FIR濾波器的IP核，則開發(fā)效率大為提高。本方案基于Altera公司的CycloneⅡ系列芯片EP2C8Q208C8N，首先利用MATLAB中的濾波器函數(shù)fir2得出需產(chǎn)
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          • 關(guān)鍵字：
                        FPGA  FIR  濾波器  性能                            
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          基于FPGA的幅值可調(diào)信號發(fā)生器設(shè)計
          
                                                            
            
                    	
          • 摘要：針對信號發(fā)生器時輸出頻率精度高和幅值可調(diào)的要求，采用直接數(shù)字頻率合成(DDS)技術(shù)，提出一種基于FPGA的幅值、頻率均可調(diào)的、高分辨率、高穩(wěn)定度的信號發(fā)生器設(shè)計方案。采用AT89S52單片機為控制器，控制FPGA產(chǎn)
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          • 關(guān)鍵字：
                        FPGA  幅值  信號發(fā)生器                            
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          基于FPGA的QDPSK調(diào)制器的設(shè)計與實現(xiàn)
          
                                                            
            
                    	
          • 摘要：介紹了QDPSK信號的優(yōu)點，并分析了其實現(xiàn)原理，提出一種QDPSK高性能數(shù)字調(diào)制器的FPGA實現(xiàn)方案。采用自頂向下的設(shè)計思想，將系統(tǒng)分成串／并變換器、差分編碼器、邏輯選相電路、四相載波發(fā)生器等4大模塊，用原理圖
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          • 關(guān)鍵字：
                        QDPSK  FPGA  調(diào)制器                            
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          紅外目標(biāo)識別跟蹤系統(tǒng)的DSP+FPGA實現(xiàn)
          
                                                            
                                        
            
                    	
          • 紅外目標(biāo)識別跟蹤系統(tǒng)的DSP+FPGA實現(xiàn),現(xiàn)場可編程門陣列(FPGA)是在專用ASIC的基礎(chǔ)上發(fā)展出來的，它克服了專用ASIC不夠靈活的缺點。與其他中小規(guī)模集成電路相比，其優(yōu)點主要在于它有很強的靈活性，即其內(nèi)部的具體邏輯功能可以根據(jù)需要配置，對電路的修改和
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          • 關(guān)鍵字：
                        DSP  FPGA  實現(xiàn)  系統(tǒng)  跟蹤  目標(biāo)  識別  紅外                          
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          FPGA實現(xiàn)OFDM水聲通信系統(tǒng)定時同步
          
                                                            
                                        
            
                    	
          • FPGA實現(xiàn)OFDM水聲通信系統(tǒng)定時同步,引 言　　正交頻分復(fù)用(Orthogonal Frequency Division Multiplexing，OFDM)技術(shù)是一種多載波調(diào)制技術(shù)，它將寬帶信道分解為相互正交的一組窄帶子信道，利用各個子信道進行并行數(shù)據(jù)傳輸，因此其頻譜利用率高、抗多徑衰
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          • 關(guān)鍵字：
                        系統(tǒng)  定時  同步  通信  水聲  實現(xiàn)  OFDM  FPGA                          
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          S2C為Xilinx原型驗證系統(tǒng)提供突破性驗證模塊技術(shù) 
          
                                                            
                                        
            
                    	
          •  S2C 日前宣布其Verification Module技術(shù)（專利申請中）已可用于其基于Xilinx的FPGA原型驗證系統(tǒng)中。V6 TAI Verification Module可以實現(xiàn)在FPGA原型驗證環(huán)境和用戶驗證環(huán)境之間高速海量數(shù)據(jù)傳輸。用戶可以使用Xilinx ChipScope或者第三方調(diào)試環(huán)境，同時查看4個FPGA。另外，V6 TAI Verification Module還可以用于1.3M～4.7M ASIC門的原型設(shè)計。V6 TAI Verification Module具有PCIe G
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          • 關(guān)鍵字：
                        S2C  Xilinx  FPGA                          
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          一款用DSP+FPGA實現(xiàn)的數(shù)字相關(guān)器
          
                                                            
                                        
            
                    	
          • 引　言數(shù)字相關(guān)器作為軟件無線電的典型應(yīng)用，在擴頻通信中成為必不可少的技術(shù)。在傳統(tǒng)的擴頻通信中，采用模擬器件(如：聲表面波器) 來實現(xiàn)解擴單元，而用數(shù)字相關(guān)器可以增加系統(tǒng)的靈活性和穩(wěn)定性，因此，對數(shù)字相關(guān)器
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          • 關(guān)鍵字：
                        相關(guān)  數(shù)字  實現(xiàn)  FPGA  DSP                          
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          基于FPGA的混合信號驗證流程
          
                                                            
            
                    	
          • 基于FPGA的混合信號驗證流程,隨著SoC設(shè)計上的混合信號組件數(shù)量增加了，基本的功能驗證對于硅初期能否成功也愈來愈重要。FPGA在系統(tǒng)整合難題上加入了一個新特點。在核心上，此新范例-可編程系統(tǒng)單芯片(programmable system chip,PSC)整合FPGA電閘
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          • 關(guān)鍵字：
                        驗證  流程  信號  混合  FPGA  基于                          
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          fpga介紹
          
      			
          
		      	
          
		      			      			      	 FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。 
FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可		      	[ 查看詳細 ]
		      			      	
          
    		
          
  		
          
  		  		
  		  		  		
  		  		  		
  		  		  		
  		  		  		
  		            
        		  		
  		  		
		
          
	
          
	
          

          

          
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