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FPGA開(kāi)發(fā)板快速教程(一)
- FPGA在復(fù)雜邏輯電路以及數(shù)字信號(hào)處理領(lǐng)域中扮演者越來(lái)越重要的角色,SOC(片上系統(tǒng))以其低功耗,高性能,低成本,高可靠性等優(yōu)點(diǎn)成為嵌入式系統(tǒng)的發(fā)展趨勢(shì)。作為一個(gè)簡(jiǎn)明的教程,主要宗旨是讓初學(xué)者快速地了解FPGA/SOPC(可編程片上系統(tǒng))開(kāi)發(fā)的流程。目前IT技術(shù)的發(fā)展可以說(shuō)是一日千里,以本人的觀點(diǎn)來(lái)講,如果希望在電子設(shè)計(jì)領(lǐng)域有所作為,則必須具備快速掌握新技術(shù)的能力。
- 關(guān)鍵字: SOPC FPGA 快速教程 開(kāi)發(fā)板
基于SOPC的簡(jiǎn)易運(yùn)動(dòng)控制芯片方案
- 現(xiàn)在的運(yùn)動(dòng)控制器已經(jīng)發(fā)展到了以專用芯片(ASIC)或FPGA作為核心處理部件的開(kāi)放式運(yùn)動(dòng)控制器。這樣的解決方案突出的特點(diǎn),是讓運(yùn)動(dòng)控制的處理部分以獨(dú)立的、硬件性方式展開(kāi),增加系統(tǒng)的性能和可靠性,從而有效地解決了以單純的MCU或DSP系統(tǒng)的處理帶寬限制,以及用戶系統(tǒng)軟件和運(yùn)動(dòng)控制軟件混雜性的問(wèn)題。
- 關(guān)鍵字: SOPC 運(yùn)動(dòng)控制 芯片
基于FPGA的等精度頻率計(jì)IP Core設(shè)計(jì)
- 介紹了等精度頻率測(cè)量方法的原理及誤差分析,利用基于FPGA的SoPC技術(shù)在QuartusⅡ5.0環(huán)境下用VHDL語(yǔ)言實(shí)現(xiàn)了等精度頻率計(jì)的軟核IP Core設(shè)計(jì),并在相應(yīng)的開(kāi)發(fā)平臺(tái)上作了驗(yàn)證。
- 關(guān)鍵字: 等精度頻率測(cè)量 IPCore SOPC
基于SoPC的多用途無(wú)線監(jiān)控報(bào)警系統(tǒng)
- 結(jié)合SoPC及GPRS技術(shù)設(shè)計(jì)了一個(gè)以FPGA為核心的多用途無(wú)線監(jiān)控報(bào)警系統(tǒng)。系統(tǒng)有多種工作模式,用戶可隨時(shí)主動(dòng)監(jiān)控現(xiàn)場(chǎng),也可啟用智能方式或手動(dòng)方式報(bào)警。
- 關(guān)鍵字: 無(wú)線監(jiān)控報(bào)警系統(tǒng) SOPC GPRS
μC/OS-II在SOPC中的硬件實(shí)現(xiàn)
- 本人在教學(xué)及科研實(shí)驗(yàn)中,對(duì)基于μC/OS-II的多任務(wù)系統(tǒng)在SOPC中的設(shè)計(jì)總結(jié)出了具體實(shí)現(xiàn)方法。經(jīng)過(guò)實(shí)踐驗(yàn)證,該方法簡(jiǎn)單、可靠,值得推廣。
- 關(guān)鍵字: 多任務(wù)系統(tǒng) SOPC 實(shí)時(shí)操作系統(tǒng)
基于SOPC的JPEG2000編碼器設(shè)計(jì)
- 為了滿足網(wǎng)絡(luò)及多媒體領(lǐng)域的應(yīng)用,JPEG2000的硬件實(shí)現(xiàn)具有重要意義。本文提出了一種改進(jìn)的行式二維小波變換器結(jié)構(gòu),設(shè)計(jì)了位平面并行的位平面編碼器和四級(jí)流水線結(jié)構(gòu)的算術(shù)編碼器,并將其整合于一個(gè)SOPC中,實(shí)現(xiàn)了JPEG2000編碼系統(tǒng)。整個(gè)設(shè)計(jì)通過(guò)Altera公司Stratix II系列的EP2S60F1020C5平臺(tái)驗(yàn)證,在最高時(shí)鐘頻率98MHz下能達(dá)到編碼分辨率512*512 灰度圖像52frame/s的速度,滿足了實(shí)時(shí)編碼的要求。
- 關(guān)鍵字: JPEG SOPC 行式二維小波變換器
基于FPGA/SOPC的預(yù)測(cè)控制器設(shè)計(jì)與實(shí)現(xiàn)
- 針對(duì)模型預(yù)測(cè)控制在微型設(shè)備及嵌入式系統(tǒng)應(yīng)用中的實(shí)時(shí)性問(wèn)題,從硬件實(shí)現(xiàn)控制算法的角度研究了基于FPGA(field programmable gate array)的預(yù)測(cè)控制器的設(shè)計(jì)和實(shí)現(xiàn)。采用基于Nios II嵌入式軟核處理器的FPGA/SOPC(system on pro-grammable chip,可編程片上系統(tǒng))方案,在FPGA芯片上構(gòu)建SOPC系統(tǒng),設(shè)計(jì)SOPC的硬件及軟件系統(tǒng),實(shí)現(xiàn)了基于FPGA的預(yù)測(cè)控制器;建立了基于FPGA和dSPACE系統(tǒng)的實(shí)時(shí)仿真平臺(tái),并進(jìn)行了控制器實(shí)時(shí)仿真實(shí)驗(yàn)。實(shí)時(shí)
- 關(guān)鍵字: 模型預(yù)測(cè)控制 SOPC FPGA
基于SOPC的調(diào)制解調(diào)器設(shè)計(jì)
- 在介紹以太網(wǎng)控制器DM9000A的數(shù)據(jù)幀收發(fā)過(guò)程的基礎(chǔ)上,運(yùn)用SOPC技術(shù),設(shè)計(jì)了用DM9000A作為調(diào)制解調(diào)器與主機(jī)間數(shù)據(jù)接口的調(diào)制解調(diào)器實(shí)現(xiàn)方案,并詳述了系統(tǒng)的軟、硬件設(shè)計(jì)過(guò)程。該方案具有實(shí)現(xiàn)簡(jiǎn)單,調(diào)制方式易調(diào)整的優(yōu)點(diǎn)。
- 關(guān)鍵字: SOPC 調(diào)制解調(diào)器 雙絞線傳輸
基于SoPC的震動(dòng)信號(hào)采集設(shè)備設(shè)計(jì)
- 震動(dòng)數(shù)據(jù)分析技術(shù)的不斷提高要求速度更快、精度更高、功能更強(qiáng)、成本更低的數(shù)據(jù)采集系統(tǒng)。AD7329恰好滿足這些要求,它集成了可編程輸入范圍切換矩陣、高精度基準(zhǔn)源和高性能A/D轉(zhuǎn)換單元于一體,而Nios Ⅱ嵌入式軟核CPU具有數(shù)據(jù)吞吐率高、配置靈活、可升級(jí)性強(qiáng)等特點(diǎn),是一款性價(jià)比很高的微控制器,結(jié)合兩者并通過(guò)高速SPI總線進(jìn)行通信,構(gòu)成了高速、高精度震動(dòng)信號(hào)采集設(shè)備。
- 關(guān)鍵字: 震動(dòng)數(shù)據(jù)分析 SOPC NIOSⅡ
可進(jìn)化芯片的FPGA接口設(shè)計(jì)與實(shí)現(xiàn)
- 針對(duì)FPGA IP核在可進(jìn)化可編程系統(tǒng)芯片(SoPC)中嵌入時(shí)存在FPGA IP核端口時(shí)序控制和位流下載的問(wèn)題,實(shí)現(xiàn)一種適用于可進(jìn)化SoPC芯片的FPGA接口。該FPGA接口使用異步FIFO、雙口RAM的結(jié)構(gòu)和可擴(kuò)展的讀/寫命令傳輸方式來(lái)實(shí)現(xiàn)FPGA IP核與系統(tǒng)的異步通信。嵌入式CPU可以通過(guò)FPGA接口實(shí)現(xiàn)FPGA IP核的片內(nèi)位流配置。FPGA接口中的硬件隨機(jī)數(shù)發(fā)生器實(shí)現(xiàn)進(jìn)化算法的硬件加速。
- 關(guān)鍵字: IP核 SOPC 片內(nèi)位流配置
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SOPC(System-on-a-Programmable-Chip)
即可編程片上系統(tǒng)
用可編程邏輯技術(shù)把整個(gè)系統(tǒng)放到一塊硅片上,稱作SOPC??删幊唐舷到y(tǒng)(SOPC)是一種特殊的嵌入式系統(tǒng):首先它是片上系統(tǒng)(SOC),即由單個(gè)芯片完成整個(gè)系統(tǒng)的主要邏輯功能;其次,它是可編程系統(tǒng),具有靈活的設(shè)計(jì)方式,可裁減、可擴(kuò)充、可升級(jí),并具備軟硬件在系統(tǒng)可編程的功能。
SOPC的特點(diǎn) [ 查看詳細(xì) ]
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