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          Tensilica靈活配置的DSP助力自主知識(shí)產(chǎn)權(quán)

          • 亮相IIC-China 2010,聚焦自主知識(shí)產(chǎn)權(quán) Tensilica將于3月15-16日亮相上海IIC-China 2010(國(guó)際集成電路研討會(huì)暨展覽會(huì))。針對(duì)金融危機(jī)對(duì)半導(dǎo)體產(chǎn)業(yè)的影響、半導(dǎo)體廠商在研發(fā)成本方面的問(wèn)題以及領(lǐng)先的中國(guó)半導(dǎo)體廠商對(duì)于自主知識(shí)產(chǎn)權(quán)的孜孜追求,Tensilica 在本屆展會(huì)上將著重展示其可配置處理器在幫助企業(yè)研發(fā)自主知識(shí)產(chǎn)權(quán)方面的卓越表現(xiàn)(展位號(hào):8S35)。Tensilica亞太區(qū)總監(jiān)黃啟弘將在高峰論壇做出“Tensilica靈活配置的DSP,幫您實(shí)現(xiàn)自主知
          • 關(guān)鍵字: 自主知識(shí)產(chǎn)權(quán)  Xtensa  ConnX DSP IP核  

          基于DSP的車載GPS/DR組合導(dǎo)航系統(tǒng)硬件設(shè)計(jì)

          • 基于DSP的車載GPS/DR組合導(dǎo)航系統(tǒng)硬件設(shè)計(jì) 針對(duì)低成本組合導(dǎo)航技術(shù)發(fā)展的需要,結(jié)合主要傳感器特點(diǎn),本文介紹了以浮點(diǎn)DSPTMS320VC33為組合導(dǎo)航算法實(shí)現(xiàn)的核心處理器,利用TL16C554進(jìn)行通信口擴(kuò)展的GPS/DR組合導(dǎo)航系
          • 關(guān)鍵字: DSP  GPS  車載  組合    

          伺服控制系統(tǒng)中高精度電流采樣的設(shè)計(jì)

          • 本文探討了在高精度伺服控制系統(tǒng)中基本控制方案以及電流環(huán)的控制策略。詳細(xì)敘述了電流采樣與處理,以及關(guān)鍵件的選型,并給出了實(shí)驗(yàn)結(jié)果。所設(shè)計(jì)的伺服驅(qū)動(dòng)控制器在數(shù)控加工中心進(jìn)行機(jī)械加工測(cè)試,得到了微米級(jí)加工精度的良好結(jié)果。
          • 關(guān)鍵字: 伺服控制  DSP  電流傳感器  空間矢量控制  LEM  201003  

          德州儀器上調(diào)第一季度業(yè)績(jī)預(yù)期

          •   據(jù)國(guó)外媒體報(bào)道,德州儀器公司(Texas Instruments)本周一上調(diào)了第一季度業(yè)績(jī)預(yù)期,預(yù)計(jì)第一季度每股收益為48美分到52美分,營(yíng)收為30.7億美元至31.9億美元。 公司今年一月底預(yù)期,第一季度每股收益44美分至52美分,營(yíng)收最低則可達(dá)29.5億美元。   分析預(yù)計(jì)德州儀器每股收益49美分,營(yíng)收為30.8億美元。
          • 關(guān)鍵字: TI  DSP  

          激光微加工系統(tǒng)及基于DSP+FPGA的控制單元的研究

          • 針對(duì)納秒脈沖激光微加工系統(tǒng)的發(fā)展,提出了一種集成圖形文件解析和高速運(yùn)動(dòng)控制的加工系統(tǒng),包括控制單元、激光器、機(jī)械結(jié)構(gòu)和光路系統(tǒng)。在介紹了各個(gè)部分的功能之后,重點(diǎn)分析了控制單元,包括上位機(jī)圖形解析平臺(tái)及以DSP和FPGA為核心的下位機(jī)控制硬件。通過(guò)實(shí)驗(yàn)分析和算法優(yōu)化,解決了加工誤差,在單晶硅表面得到了較好的微結(jié)構(gòu)加工效果。
          • 關(guān)鍵字: FPGA  DSP  激光  加工    

          汽車電子中的DSP和FPGA運(yùn)用

          •  1  引言   20世紀(jì)末,全球范圍內(nèi)興起的信息革命浪潮,為汽車工業(yè)的突破性發(fā)展提供了千載難逢的機(jī)遇,信息技術(shù)的廣泛應(yīng)用是解決汽車帶來(lái)的諸如交通擁擠、交通安全、環(huán)境污染、能源枯竭等問(wèn)題的最佳途徑。同時(shí),隨
          • 關(guān)鍵字: FPGA  DSP  汽車電子    

          基于高性能多DSP互連技術(shù)

          • 基于高性能多DSP互連技術(shù), 由于現(xiàn)代數(shù)字信號(hào)處理器(dsp)設(shè)計(jì)、半導(dǎo)體工藝、并行處理和互連與傳輸技術(shù)的進(jìn)步,現(xiàn)代高性能dsp的處理能力得到極大發(fā)展。但在移動(dòng)通信、雷達(dá)信號(hào)處理和實(shí)時(shí)圖像處理等復(fù)雜電子系統(tǒng)中,單片dsp的性能仍可能無(wú)法滿足
          • 關(guān)鍵字: 技術(shù)  DSP  高性能  基于  

          基于DSP的EASI十二導(dǎo)聯(lián)多功能Holter系統(tǒng)

          • 基于DSP的EASI十二導(dǎo)聯(lián)多功能Holter系統(tǒng),一種以數(shù)字信號(hào)處理器(DSP)為核心,具有實(shí)時(shí)檢測(cè)、無(wú)線傳輸和24小時(shí)心電數(shù)據(jù)連續(xù)記錄功能的多功能Holter系統(tǒng)。在該系統(tǒng)中,通過(guò)EASI導(dǎo)聯(lián)系統(tǒng)模塊采集心電信號(hào),然后采用小波變換算法對(duì)心電信號(hào)進(jìn)行實(shí)時(shí)特征提取,并將心電數(shù)據(jù)存入MicroSD卡實(shí)現(xiàn)24小時(shí)心電數(shù)據(jù)記錄;或者通過(guò)Zigbee無(wú)線傳輸模塊將心電數(shù)據(jù)傳輸?shù)诫娔X進(jìn)行遠(yuǎn)程實(shí)時(shí)監(jiān)測(cè)及十二導(dǎo)聯(lián)心電數(shù)據(jù)的推導(dǎo)。
          • 關(guān)鍵字: Holter  系統(tǒng)  多功能  十二  DSP  EASI  基于  數(shù)字信號(hào)  

          一種基于FPGA/DSP的靈巧干擾平臺(tái)設(shè)計(jì)與實(shí)現(xiàn)

          • 引言目前,通信干擾的手段以信號(hào)大功率壓制為主,本質(zhì)上屬于物理層能量干擾,存在效費(fèi)比低,且容易暴露自...
          • 關(guān)鍵字: FPGA  DSP  干擾平臺(tái)  

          多路同步串口的FPGA傳輸實(shí)現(xiàn)

          •   引言   隨著集成電路技術(shù)的發(fā)展,F(xiàn)PGA和DSP以及ARM以其體積小、速度快、功耗低、設(shè)計(jì)靈活、利于系統(tǒng)集成、擴(kuò)展升級(jí)等優(yōu)點(diǎn),被廣泛地應(yīng)用于高速數(shù)字信號(hào)傳輸及數(shù)據(jù)處理,以DSP+FPGA+ARM的架構(gòu)組成滿足實(shí)時(shí)性要求的高速數(shù)字處理系統(tǒng)已成為一種趨勢(shì),本文主要研究FPGA在高速多路數(shù)據(jù)傳輸中的應(yīng)用。   系統(tǒng)結(jié)構(gòu)   在DSP多路串行數(shù)據(jù)同時(shí)向ARM發(fā)送的系統(tǒng)中,因?yàn)閿?shù)據(jù)通道有并行要求,應(yīng)用FPGA硬件并行的特點(diǎn),由FPGA并行接收多路數(shù)據(jù),經(jīng)過(guò)緩沖后再發(fā)送至ARM進(jìn)行數(shù)據(jù)的高級(jí)處理的方案,系
          • 關(guān)鍵字: 多路同步串口  FPGA  DSP  

          高性能多DSP互連技術(shù)

          •   前言   由于現(xiàn)代數(shù)字信號(hào)處理器(DSP)設(shè)計(jì)、半導(dǎo)體工藝、并行處理和互連與傳輸技術(shù)的進(jìn)步,現(xiàn)代高性能DSP的處理能力得到極大發(fā)展。但在移動(dòng)通信、雷達(dá)信號(hào)處理和實(shí)時(shí)圖像處理等復(fù)雜電子系統(tǒng)中,單片DSP的性能仍可能無(wú)法滿足需求,通常需要使用多片DSP構(gòu)成并行信號(hào)處理系統(tǒng)。   在多DSP系統(tǒng)中,互連技術(shù)連接DSP、接口及其他處理器,一起構(gòu)成系統(tǒng)的靜態(tài)體系結(jié)構(gòu),是數(shù)據(jù)傳輸?shù)闹虚g介質(zhì)的總和。互連技術(shù)傳輸代表計(jì)算任務(wù)、中間數(shù)據(jù)、結(jié)果或狀態(tài)控制信息的數(shù)據(jù)流,使接口與DSP中的算法模塊通過(guò)數(shù)據(jù)流動(dòng)態(tài)地連接起來(lái)
          • 關(guān)鍵字: 接口  DSP  處理器  互連  

          插值查找表:實(shí)現(xiàn)DSP功能的簡(jiǎn)便方法

          •   如果數(shù)字信號(hào)處理器內(nèi)核沒有您需要的確切功能,可使用插值查找表(ILUT)來(lái)解決這一問(wèn)題。   作為賽靈思的現(xiàn)場(chǎng)工程師,我常常問(wèn)這樣的問(wèn)題:我們是否能夠提供一款其功能可滿足客戶所有獨(dú)特設(shè)計(jì)要求的DSP內(nèi)核。有時(shí)候內(nèi)核會(huì)太大,太小或者不夠快。有時(shí),我們會(huì)開發(fā)一款能確切滿足客戶需求的內(nèi)核,并迅速以CORE Generator商標(biāo)推出。不過(guò)即便在這種情況下,客戶仍然想要一套特定的DSP功能,而且刻不容緩。在這些情況下,我常常建議他們使用我們器件中的插值查找表來(lái)定制他們的DSP功能。   查找表(LUT)實(shí)
          • 關(guān)鍵字: Xilinx  DSP  插值查找表  

          雙開關(guān)正激轉(zhuǎn)換器及其應(yīng)用設(shè)計(jì)

          •   中心議題:   低功耗模式以及內(nèi)部時(shí)脈   DSP: 降低功耗與提高效能   解決方案:   關(guān)閉無(wú)線電,將晶片切換至淺層或深層睡眠模式   Casual不定時(shí)掃瞄   功耗是決定可攜式裝置發(fā)展成敗的關(guān)鍵因素。由于這類裝置的趨勢(shì)朝向功能匯整的方向演進(jìn),最明顯的跡象就是百萬(wàn)像素?cái)?shù)字相機(jī)整合至照相手機(jī)中,新型的多功能裝置必須持續(xù)迎合消費(fèi)者的需求,尤其是在功耗方面。   雖然藍(lán)牙本身就已是低功耗技術(shù),但為了進(jìn)一步延長(zhǎng)電池續(xù)航力,藍(lán)牙技術(shù)聯(lián)盟(Bluetooth SIG)仍持續(xù)整合許多新方法,以
          • 關(guān)鍵字: DSP  轉(zhuǎn)換器  藍(lán)牙  

          利用MSGQ模塊簡(jiǎn)化復(fù)雜DSP的應(yīng)用

          • 利用MSGQ模塊簡(jiǎn)化復(fù)雜DSP的應(yīng)用, 電信基礎(chǔ)設(shè)備、視頻基礎(chǔ)設(shè)備以及影像應(yīng)用等對(duì)于帶寬的要求迅速提升,這些系統(tǒng)需要支持具有更高分辨率、更快幀速率以及更出色音質(zhì)的音視頻流。同時(shí),上述系統(tǒng)還要提高信道密度,降低每信道的功耗。此外,該市場(chǎng)不僅要
          • 關(guān)鍵字: DSP  應(yīng)用  復(fù)雜  簡(jiǎn)化  MSGQ  模塊  利用  

          基于FPGA設(shè)計(jì)DSP的實(shí)踐與改進(jìn)

          • 當(dāng)設(shè)計(jì)的系統(tǒng)需要對(duì)數(shù)字信號(hào)進(jìn)行處理時(shí),常采用通用 DSP(Digital Signal Process)處理器,這樣的設(shè)計(jì)方案通用性好,且還有各種較為成熟的 DSP算法可以參考。但是,這類方案通常是雙核設(shè)計(jì),即采用通用控制器(MCU)加上通用 DSP處理器實(shí)現(xiàn),在實(shí)現(xiàn)系統(tǒng)時(shí)開發(fā)的復(fù)雜程度、難度都較大,也難以滿足定制特殊處理的需要。為了解決這些問(wèn)題,人們開始尋求新的設(shè)計(jì)方案,基于通用處理器加上FPGA(大規(guī)??删庨T陣列)的架構(gòu)方案逐漸成為主流,在新的方案中通用控制器完成控制和管理功能,專用的數(shù)字信號(hào)處理和組
          • 關(guān)鍵字: FPGA  DSP  實(shí)踐    
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