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          EEPW首頁 >> 主題列表 >> 混合仿真

          2.5 Gbps收發(fā)器中1:2解復(fù)用電路的設(shè)計

          • 摘要:在2.5 Gbps高速串行收發(fā)系統(tǒng)接收端中1到2解復(fù)用電路位對于降低群斯ぷ魎俁齲減輕設(shè)計壓力,提高電路穩(wěn)定性起著關(guān)鍵作用。本文描述了基于電流模式邏輯的解復(fù)用電路工作原理,按照全定制設(shè)計流程采用SMIC0.18u
          • 關(guān)鍵字: 解復(fù)用電路  電流模式邏輯  混合仿真  半速率結(jié)構(gòu)  

          混合仿真下DDS的改進(jìn)研究與實現(xiàn)

          •   1 引 言   DDS(Direct Digital Frequency Synthesis,直接數(shù)字頻率合成器)是一種從相位概念出發(fā)直接合成所需波形的頻率合成技術(shù)。由于DDS具有相對頻帶寬、頻率分辨率高、頻率變化速度快與相位可連續(xù)線性變化等一系列特點,已被廣泛應(yīng)用于數(shù)字通信系統(tǒng)中。目前,可供用戶選擇的高性能、多功能的專用DDS芯片比較多。然而在某些對控制方式、置頻速率等方面有特殊要求的場合,設(shè)計一個基于高性能FPGA(Field Programming Gate Array,現(xiàn)場可編程門陣列)的D
          • 關(guān)鍵字: 嵌入式系統(tǒng)  單片機(jī)  DDS  混合仿真  MCU和嵌入式微處理器  
          共2條 1/1 1

          混合仿真介紹

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