降低功耗 文章 進入降低功耗技術(shù)社區(qū)
采用低功耗28nm FPGA降低系統(tǒng)總成本
- 降低成本和功耗，提高效能，讓產(chǎn)品更快地運行，這些均是設(shè)計工程師目前必須面對的棘手問題，因此，F(xiàn)PGA的選擇很重要。Altera Cyclone V FPGA通過多種方法幫助設(shè)計人員降低系統(tǒng)總成本，設(shè)計人員受益的不僅是TSMC的28nm低功耗（28LP）制造工藝，還包括Cyclone V器件系列內(nèi)置的體系結(jié)構(gòu)，以及Altera設(shè)計工具輔助系統(tǒng)所提供的強大的高效能工具。采用Cyclone V FPGA，不僅能實現(xiàn)業(yè)界最低的總體擁有成本，還可獲得型號最全的低成本器件——從25K邏輯單元（LE）到301K LE，
- 關(guān)鍵字： 降低功耗 28nm 體系結(jié)構(gòu)
經(jīng)驗之談，工程師在電路設(shè)計中的八大誤區(qū)
- 我們常常會發(fā)現(xiàn)，自己想當然的一些規(guī)則或道理往往會存在一些差錯。電子工程師在電路設(shè)計中也會有這樣的例子。下面是一位工程師總結(jié)的八大誤區(qū)點?，F(xiàn)象一：這板子的PCB設(shè)計要求不高，就用細一點的線，自動布吧點評：
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一種大功率開關(guān)電源降低功耗的經(jīng)典技術(shù)方法
- 隨著能源效率和環(huán)保的日益重要，人們對開關(guān)電源待機效率期望越來越高，客戶要求電源制造商提供的電源產(chǎn)品能滿足...
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降低功耗：小心“過度設(shè)計”
- 當前，降低功耗不僅成為節(jié)電的必由之路，并且被賦予了環(huán)保的神圣使命。因此所有的設(shè)計者都十分關(guān)心功耗問題。不過，在設(shè)計時還要謹防過度設(shè)計（overdesign）現(xiàn)象，使各個部分協(xié)調(diào)一致，達到整個功耗的降低。 應用是個很復雜的問題，其中有許多要素。你需要針對問題提供整體化的解決方案。在深刻理解最終應用的情況下，你會發(fā)現(xiàn)是否出現(xiàn)了過度設(shè)計；有時候，出于市場等方面的考慮，會出現(xiàn)過度設(shè)計的做法，這最終會導致功耗過高。 系統(tǒng)設(shè)計與SoC設(shè)計的相對比例問題，軟、硬件比例問題，IC的驅(qū)動電壓是否越低就越好？
- 關(guān)鍵字： 降低功耗 SoC 過度設(shè)計 DSP Bolosigno 300 Bolosigno250
降低功耗是節(jié)電的主要手段
- 作者:安森美半導體亞太區(qū)電源管理部市場推廣經(jīng)理 蔣家亮先生 我們認為，模擬/電源領(lǐng)域未來最主要的技術(shù)發(fā)展趨勢包括： 整體性能更高。目前最大的發(fā)展趨勢在于減少電源浪費這一關(guān)鍵要求，因其涉及到使用電力或其它電能形式的每一種產(chǎn)品。電源消耗成為全球性的話題，但“電源轉(zhuǎn)換”則相對地較少被談及。電源轉(zhuǎn)換是要求很高的技術(shù)挑戰(zhàn)，因為它關(guān)乎降低電源轉(zhuǎn)換中的功耗，而且如今也被視為創(chuàng)建所謂的“綠色技術(shù)”的一個關(guān)鍵。采用電源轉(zhuǎn)換功耗盡可能最低的技術(shù)將所有電子系統(tǒng)中“未處理的”電源轉(zhuǎn)換為“經(jīng)過調(diào)節(jié)”的電源是必要且是未來
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降低功耗介紹
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