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          多并行處理器接收機(jī)設(shè)計(jì)與實(shí)現(xiàn)

          作者: 時(shí)間:2009-07-15 來源:網(wǎng)絡(luò) 收藏

          為了檢驗(yàn)實(shí)際布線后信號(hào)的完整性,在布線完成之后對(duì)數(shù)據(jù)線和地址線分別做了后仿真,這里只取數(shù)據(jù)線AED50和地址線AEA3的后仿真波形圖,如圖7,圖8所示。

          本文引用地址:http://cafeforensic.com/article/195802.htm

          圖7,圖8中,U6為DSP,它作為驅(qū)動(dòng)源,輸出100 MHz的矩形波信號(hào)驅(qū)動(dòng)它的外設(shè);U7,U8為SDRAM,U10為DPRAM,U13為FPGA,它們作為DSP的外設(shè),接收DSP發(fā)送來的信號(hào)。從這兩幅圖中可以看出,反射信號(hào)對(duì)數(shù)據(jù)線和地址線都有一定的影響,但都滿足信號(hào)完整性的要求,同時(shí)也驗(yàn)證了在兩種不同拓?fù)浣Y(jié)構(gòu)下所產(chǎn)生的信號(hào)質(zhì)量不同。


          5 測(cè)試結(jié)果
          板已經(jīng)設(shè)計(jì)實(shí)現(xiàn)。為了檢測(cè)電路板的功能和性能,針對(duì)DSP和FPGA編制了所需的驅(qū)動(dòng)程序,并通過各種測(cè)試程序?qū)﹄娐钒遄隽舜罅康?、長(zhǎng)時(shí)間的各種測(cè)試。經(jīng)過測(cè)試,可以確定電路板的功能已經(jīng)按照設(shè)計(jì)的初衷實(shí)現(xiàn),也符合板要求的技術(shù)指標(biāo)。另外,對(duì)電路板上各種資源訪問性能的測(cè)試結(jié)果做了統(tǒng)計(jì),如表2所示。

          6 結(jié) 語
          板的運(yùn)算能力強(qiáng),通用性強(qiáng),存儲(chǔ)容量大,可以通用于各種視頻圖像處理、雷達(dá)信號(hào)處理和衛(wèi)星信號(hào)處理等領(lǐng)域,目前已應(yīng)用在對(duì)處理速率和存儲(chǔ)容量要求較高的衛(wèi)星接收機(jī)技術(shù)方案中。


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          關(guān)鍵詞: 并行 處理器 接收機(jī)

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