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	 fpga
          

          
	
          
    	
          
    	  	
          
              	
                                
          
                  

                                
          
                    
          ModelSim+Synplify+Quartus的Altera FPGA的仿真實(shí)現(xiàn)
          
                                                            
                                        
            
                    	
          • ModelSim+Synplify+Quartus的Altera FPGA的仿真實(shí)現(xiàn),工作內(nèi)容: 
            1、設(shè)計(jì)一個(gè)多路選擇器，利用ModelSimSE做功能仿真； 
            2、利用Synplify Pro進(jìn)行綜合，生成xxx.vqm文件； 
            3、利用Quartus II導(dǎo)入xxx.vqm進(jìn)行自動(dòng)布局布線(xiàn)，并生成xxx.vo(Verilog 
            4、利用ModelSimSE做
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          • 關(guān)鍵字：
                        仿真  實(shí)現(xiàn)  FPGA  Altera  Synplify  Quartus  ModelSim                          
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          搭建Xilinx FPGA開(kāi)發(fā)環(huán)境的方法
          
                                                            
                                        
            
                    	
          • 搭建Xilinx FPGA開(kāi)發(fā)環(huán)境的方法,一、計(jì)算機(jī)硬件環(huán)境要求：
            1、操作系統(tǒng)：
            Microsoft Windows XP Home Edition SP2
            2、基本配置：
            A、處理器：Intel CPU T2050 1.6GHz
            B、內(nèi)存：512MB
            C、硬盤(pán)：60GB(其中軟件安裝的空問(wèn)需要3GB)補(bǔ)充
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          • 關(guān)鍵字：
                        環(huán)境  方法  開(kāi)發(fā)  FPGA  Xilinx  搭建                          
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          對(duì)FPGA進(jìn)行系統(tǒng)設(shè)計(jì)的Xilinx軟件使用方法
          
                                                            
                                        
            
                    	
          • 對(duì)FPGA進(jìn)行系統(tǒng)設(shè)計(jì)的Xilinx軟件使用方法,Solution:在對(duì)FPGA設(shè)計(jì)進(jìn)行最初步的系統(tǒng)規(guī)劃的時(shí)候，需要進(jìn)行模塊劃分，模塊接口定義等工作。通常，我們只能在紙上進(jìn)行設(shè)計(jì)。雖然在紙上我們可以很隨意地書(shū)寫(xiě)，而用紙畫(huà)的不方便就在于，如果對(duì)某一個(gè)模塊進(jìn)行較大改動(dòng)
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          • 關(guān)鍵字：
                        軟件  使用方法  Xilinx  設(shè)計(jì)  進(jìn)行  系統(tǒng)  FPGA                          
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          基于FPGA過(guò)采樣技術(shù)及實(shí)現(xiàn)
          
                                                            
                                        
            
                    	
          • 過(guò)采樣技術(shù)應(yīng)用于通用模塊時(shí)，低通濾波器的參數(shù)隨著下抽取率不同而發(fā)生改變。本文設(shè)計(jì)了適合通用模塊應(yīng)用的可變參數(shù)低通濾波器，并利用FPGA進(jìn)行實(shí)現(xiàn)。模塊測(cè)試結(jié)果表明：可變參數(shù)濾波器設(shè)計(jì)合理，基于FPGA的過(guò)采樣模塊最高分辨率可達(dá)25bit/s。

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          • 關(guān)鍵字：
                        可變參數(shù)濾波器  FPGA  過(guò)采樣  插值濾波器  201006                          
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          基于FPGA的高速串行交換模塊實(shí)現(xiàn)方法研究
          
                                                            
            
                    	
          • 摘要：采用Xilinx公司的Virtex-5系列FPGA設(shè)計(jì)了一個(gè)用于多種高速串行協(xié)議的數(shù)據(jù)交換模塊，并解決了該模...
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          • 關(guān)鍵字：
                        FPGA  RapidIO  PCIe  高速串行交換                          
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          基于CPCI體系的高性能監(jiān)測(cè)測(cè)向處理平臺(tái)研究
          
                                                            
            
                    	
          • 摘要：提出一種新的高速并行采樣技術(shù)架構(gòu)以及基于可編程芯片技術(shù)和支持靈活配置的并行處理嵌入式硬件...
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          • 關(guān)鍵字：
                        CPCI  DSP  FPGA  Cyclone                          
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          基于FPGA的電網(wǎng)實(shí)時(shí)數(shù)據(jù)采集與控制
          
                                                            
            
                    	
          • 為了消除FFT頻譜泄漏和柵欄效應(yīng)，提高諧波分析精度，文中給出了用高速A／D采集IPcore來(lái)實(shí)現(xiàn)電網(wǎng)數(shù)據(jù)實(shí)時(shí)采集的設(shè)計(jì)方法，同時(shí)采用數(shù)字鎖相倍頻同步方法進(jìn)行了誤差修正。其中全數(shù)字鎖相倍頻電路和A／D采集控制電路均采用VHDL語(yǔ)言和可編程邏輯器件設(shè)計(jì)實(shí)現(xiàn)，并用quartusII軟件進(jìn)行了仿真。 
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          • 關(guān)鍵字：
                        FPGA  電網(wǎng)實(shí)時(shí)  數(shù)據(jù)采集                            
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          FPGA DCM時(shí)鐘管理單元簡(jiǎn)介及原理
          
                                                            
                                        
            
                    	
          • FPGA DCM時(shí)鐘管理單元簡(jiǎn)介及原理,DCM概述
            DCM內(nèi)部是DLL(Delay Lock Loop(?)結(jié)構(gòu),對(duì)時(shí)鐘偏移量的調(diào)節(jié)是通過(guò)長(zhǎng)的延時(shí)線(xiàn)形成的。DCM的參數(shù)里有一個(gè)PHASESHIFT（相移）,可以從0變到255。所以我們可以假設(shè)內(nèi)部結(jié)構(gòu)里從clkin到clk_1x之間應(yīng)該有256根延
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          • 關(guān)鍵字：
                        簡(jiǎn)介  原理  單元  管理  DCM  時(shí)鐘  FPGA                          
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          FPGA和單片機(jī)的串行通信接口設(shè)計(jì)
          
                                                            
                                        
            
                    	
          • FPGA和單片機(jī)的串行通信接口設(shè)計(jì),摘要：本文針對(duì)由FPGA構(gòu)成的高速數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問(wèn)題，提出FPGA與單片機(jī)實(shí)現(xiàn)數(shù)據(jù)串行通信的解決方案。在通信過(guò)程中完全遵守RS232協(xié)議，具有較強(qiáng)的通用性和推廣價(jià)值。1 前言
            現(xiàn)場(chǎng)可編程邏輯器件（F
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          • 關(guān)鍵字：
                        接口  設(shè)計(jì)  通信  串行  單片機(jī)  FPGA                          
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          FPGA設(shè)計(jì)的SPI自動(dòng)發(fā)送模塊技術(shù)
          
                                                            
                                        
            
                    	
          • FPGA設(shè)計(jì)的SPI自動(dòng)發(fā)送模塊技術(shù),一、摘要：
            SPI 接口應(yīng)用十分廣泛，在很多情況下，人們會(huì)用軟件模擬的方法來(lái)產(chǎn)生SPI 時(shí)序或是采用帶SPI 功能模塊的MCU。但隨著可編程邏輯技術(shù)的發(fā)展，人們往往需要自己設(shè)計(jì)簡(jiǎn)單的SPI 發(fā)送模塊。本文介紹一種基于
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          • 關(guān)鍵字：
                        模塊  技術(shù)  發(fā)送  自動(dòng)  設(shè)計(jì)  SPI  FPGA                          
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          一種基于FPGA的數(shù)字復(fù)接系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
          
                                                            
            
                    	
          • 引言數(shù)字通信網(wǎng)中，為擴(kuò)大傳輸容量和提高傳輸效率，常運(yùn)用數(shù)字復(fù)接技術(shù)，將若干低速碼流合并成高速碼流，...
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          • 關(guān)鍵字：
                        FPGA  數(shù)字復(fù)用系統(tǒng)  數(shù)字通信                          
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          基于FPGA及模擬電路的模擬信號(hào)波形的實(shí)現(xiàn)
          
                                                            
            
                    	
          • 1引言波形發(fā)生器已經(jīng)廣泛的應(yīng)用在通信、控制、測(cè)量等各個(gè)領(lǐng)域，如鋸齒波、正弦波、方波等波形常用...
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          • 關(guān)鍵字：
                        FPGA  模擬電路  模擬波形  示波器  FLEX10                          
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          FPGA電路設(shè)計(jì): 如何應(yīng)對(duì)電源相關(guān)問(wèn)題的挑戰(zhàn)
          
                                                            
            
                    	
          • 引言在設(shè)計(jì)可編程門(mén)陣列(FPGA)電路時(shí)，必須極端重視電源問(wèn)題，從而使最終產(chǎn)品能在所有可能的條件下無(wú)...
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          • 關(guān)鍵字：
                        FPGA  電路設(shè)計(jì)  電源                          
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          基于Fution模數(shù)混合FPGA芯片的心電儀片上系統(tǒng)開(kāi)發(fā)
          
                                                            
                                        
            
                    	
          • 利用Actel公司的基于Flash構(gòu)架的模數(shù)混合型Fusion系列FPGA芯片，設(shè)計(jì)了一款低功耗片上的心電監(jiān)護(hù)儀采集顯示系統(tǒng)。結(jié)合Fusion系列的FPGA芯片的各種資源，實(shí)現(xiàn)了心電采集預(yù)處理模塊、數(shù)據(jù)的處理和顯示模塊的系統(tǒng)集成，完整地形成了片上系統(tǒng)。
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          • 關(guān)鍵字：
                        心電  系統(tǒng)  開(kāi)發(fā)  芯片  FPGA  Fution  模數(shù)  混合  基于  數(shù)字信號(hào)                          
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          一種基于Petri網(wǎng)的并行控制器的VHDL實(shí)現(xiàn)
          
                                                            
            
                    	
          • 摘要：Petri網(wǎng)是離散事件系統(tǒng)建模的重要工具，本文使用硬件描述語(yǔ)言VHDL實(shí)現(xiàn)了基于Petri網(wǎng)的并行控制器...
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          • 關(guān)鍵字：
                        VHDL  FPGA  Petri  并行控制器                          
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           fpga介紹
          
      			
          
		      	
          
		      			      			      	您好，目前還沒(méi)有人創(chuàng)建詞條 fpga!
           
		      	歡迎您創(chuàng)建該詞條，闡述對(duì) fpga的理解，并與今后在此搜索 fpga的朋友們分享。    創(chuàng)建詞條
		      			      	
          
    		
          
  		
          
  		  		  		
  		  		  		
  		  		  		
  		  		            
        		  		
          
    		
          
      			
          
        			
          熱門(mén)主題
          
      			
          
      			
          
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