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基于FPGA控制的溫度檢測無線發(fā)射接收系統(tǒng)
- 摘要：本文介紹基于FPGA控制的溫度檢測無線發(fā)射接收系統(tǒng)。本系統(tǒng)采甩EPlKl000C208-3作為控制核心，系統(tǒng)比較溫度是否超出人體最佳溫度范圍，如果過高則發(fā)出降溫信號，如果過低則發(fā)出升溫信號；得出需要加溫還是降溫的
- 關(guān)鍵字： FPGA 溫度檢測 接收系統(tǒng) 無線發(fā)射
基于FPGA的任意波形發(fā)生器設(shè)計與實現(xiàn)
- 摘要：本文提出了一種基于可編程邏輯器件(FPGA)芯片EP2C20F484的任意波形發(fā)生器的設(shè)計方法。完成了在FPGA的控制下，USB接口控制模塊、SRAM控制模塊、DA轉(zhuǎn)換模塊等協(xié)同工作的硬件設(shè)計、固件設(shè)計以及軟件設(shè)計，并給出了
- 關(guān)鍵字： FPGA 任意波形發(fā)生器
FPGA的功耗概念與低功耗設(shè)計研究
- 隨著半導(dǎo)體工藝的飛速發(fā)展和芯片工作頻率的提高，芯片的功耗迅速增加，而功耗增加又導(dǎo)致芯片發(fā)熱量的增大和可靠性的下降。因此，功耗已經(jīng)成為深亞微米集成電路設(shè)計中的一個重要考慮因素。本文圍繞FPGA功率損耗的組成和產(chǎn)生原理，從靜態(tài)功耗、動態(tài)功耗兩大方面出發(fā)，分析了影響FPGA功率耗散的各種因素，并通過Actel產(chǎn)品中一款低功耗的FPGA進一步進行說明。最后提出了在FPGA低功耗設(shè)計中的一些問題。
- 關(guān)鍵字： FPGA 功耗 概念 低功耗設(shè)計
從錯誤中學(xué)習(xí) —— 不再仿真
- 前幾天，我與一位從事硬核FPGA設(shè)計的設(shè)計師談起我開發(fā)系統(tǒng)芯片的方式。由于我提到了‘FPGA’，因此他問我對于仿真器的感覺怎么樣。而當(dāng)我告訴他我已近三年不依賴仿真器后，他大吃一驚，覺得不可思議。 這同我與許多其他FPGA設(shè)計師圍繞著提高設(shè)計抽象度的對話很類似。正如軟件開發(fā)人員非常依賴調(diào)試器和代碼仿真器來查找錯誤和驗證功能一樣，F(xiàn)PGA設(shè)計師同樣一直習(xí)慣利用仿真器來進行這些工作。仿真器為FPGA設(shè)計師提供了開發(fā)復(fù)雜IP所需的控制手段和可視性，隨后設(shè)計師們設(shè)計流程就可以以良好
- 關(guān)鍵字： Altium 電子設(shè)計 FPGA
一種基于FPGA的多路視頻通道控制系統(tǒng)設(shè)計
- 視頻監(jiān)控以其直觀、方便、信息內(nèi)容豐富而廣泛應(yīng)用于許多場合。視頻監(jiān)控成為人們生活中不可缺少的技術(shù)。...
- 關(guān)鍵字： FPGA DSP 視頻監(jiān)控
從錯誤中學(xué)習(xí)――不再仿真
- 從錯誤中學(xué)習(xí)――不再仿真,前幾天，我與一位從事硬核FPGA設(shè)計的設(shè)計師談起我開發(fā)系統(tǒng)芯片的方式。由于我提到了‘FPGA’，因此他問我對于仿真器的感覺怎么樣。而當(dāng)我告訴他我已近三年不依賴仿真器后，他大吃一驚，覺得不可思議。這同我與許多其
- 關(guān)鍵字： 仿真 不再 學(xué)習(xí) FPGA
FPGA低功耗設(shè)計須權(quán)衡多項指標(biāo)
- FPGA的功耗高度依賴于用戶的設(shè)計，沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低，如同其它多數(shù)事物一樣，降低功耗的設(shè)計就是一種協(xié)調(diào)和平衡藝術(shù)，在進行低功耗器件的設(shè)計時，人們必須仔細(xì)權(quán)衡性能、易用性、成本、密
- 關(guān)鍵字： FPGA 低功耗設(shè)計 指標(biāo)
基于Xilinx FPGA的千兆以太網(wǎng)及E1信號的光纖傳輸
- 本文設(shè)計的基于Xilinx FPGA的千兆位以太網(wǎng)及E1信號的光纖傳輸系統(tǒng)采用Xilinx XC5VLX30T芯片，通過以太網(wǎng)測試儀和數(shù)據(jù)誤碼儀對本系統(tǒng)分別進行性能測試，測試結(jié)果滿足設(shè)計要求，系統(tǒng)工作穩(wěn)定。從而實現(xiàn)了千兆位以太網(wǎng)信號和E1信號的接入功能，為用戶搭建了一個大容量、多業(yè)務(wù)的傳輸平臺。
- 關(guān)鍵字： Xilinx FPGA 千兆以太網(wǎng) 光纖傳輸
基于FPGA的LDPC編碼設(shè)計
- 針對低密度奇偶校驗碼(簡稱LDPC碼)的直接編碼運算量較大、復(fù)雜度高，根據(jù)RicIlarclson和Urbanke(RU)建議的編碼方案，介紹一種適于在FPGA上實現(xiàn)，利用有效校驗矩陣來降低編碼復(fù)雜度的LDPC編碼方案，給出了編碼器設(shè)計實現(xiàn)的原理和編碼器的結(jié)構(gòu)和基本組成。在QuartusⅡ7．2軟件平臺上采用基于FPGA的VHDL語言實現(xiàn)了有效的編碼過程。結(jié)果表明：此方案在保證高效可靠傳輸?shù)耐瑫r降低了實現(xiàn)的復(fù)雜度。這種編碼方案可靈活應(yīng)用于不同的校驗矩陣H，碼長和碼率的系統(tǒng)中。
- 關(guān)鍵字： FPGA LDPC 編碼
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