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          EEPW首頁 >> 主題列表 >> 10 bit 160 msps

          集成低功耗輸入驅(qū)動(dòng)器和基準(zhǔn)電壓源的16位6 MSPS SAR ADC系統(tǒng),針對多路復(fù)用應(yīng)用優(yōu)化

          一種單端10-bit SAR ADC IP核的設(shè)計(jì)

          • 摘要:本設(shè)計(jì)通過采用分割電容陣列對DAC進(jìn)行優(yōu)化,在減小了D/A轉(zhuǎn)換開關(guān)消耗的能量、提高速度的基礎(chǔ)上,實(shí)現(xiàn)了一款采樣速度為1MS /s的10-bit單端逐次逼近型模數(shù)轉(zhuǎn)換器。使用cadence spectre工具進(jìn)行仿真,仿真結(jié)果表
          • 關(guān)鍵字: IP  設(shè)計(jì)  ADC  SAR  10-bit  單端  

          基于內(nèi)裝測試(BIT)技術(shù)的裝備控制系統(tǒng)故障診斷

          • 引言  內(nèi)裝測試(BIT)是20世紀(jì)70年代美國在軍用測試領(lǐng)域提出的全新的技術(shù)概念,其目的在于改善裝備的維修性、測試性和自診斷能力,同時(shí)也使裝備系統(tǒng)的機(jī)動(dòng)性和保障性得到很大改善。20世紀(jì)70年代以來,以航天航空等國
          • 關(guān)鍵字: BIT  內(nèi)裝  測試  故障診斷    

          航天測控:系統(tǒng)級BIT設(shè)計(jì)及BIT驗(yàn)證技術(shù)

          • 系統(tǒng)級BIT是監(jiān)控系統(tǒng)關(guān)鍵功能、檢測隔離系統(tǒng)級故障的主要手段和方法,也是可測試性設(shè)計(jì)的關(guān)鍵部分。而系...
          • 關(guān)鍵字: 航天測控  BIT  驗(yàn)證技術(shù)  故障注入  

          具有抗混疊濾波器和184.32 MSPS采樣速率的高性能中

          • 電路功能與優(yōu)勢圖1所示電路是基于超高動(dòng)態(tài)范圍差分放大器驅(qū)動(dòng)器ADL5565和11位、200 MSPS四通道中頻接收機(jī)AD6657A的65 MHz帶寬接收機(jī)前端。四階巴特沃茲抗混疊濾波器基于放大器和中頻接收機(jī)的性能和接口要求而優(yōu)化。由
          • 關(guān)鍵字: 184.32  MSPS  抗混疊濾波器  采樣    

          一種用于13 bit 40 MS/s流水線ADC中的采樣保持電路

          • 近年來,隨著通信和多媒體市場的快速增長,數(shù)字系統(tǒng)無論在處理能力還是處理速度上都取得了飛速的發(fā)展,因此對作為模擬信號通向數(shù)字信號橋梁的模數(shù)轉(zhuǎn)換器(ADC)的性能要求也越來越高 [1]。在各種ADC結(jié)構(gòu)中,流水線ADC在
          • 關(guān)鍵字: bit  ADC  40  MS    

          16-bit MCU實(shí)現(xiàn)超低功耗運(yùn)動(dòng)檢測

          • 諧振LC傳感器技術(shù)用于運(yùn)動(dòng)檢測已有數(shù)年,包括流量計(jì)量以及其它低速轉(zhuǎn)動(dòng)檢測系統(tǒng)等。幾乎在所有情況下,推動(dòng)上...
          • 關(guān)鍵字: 16-bit  MCU實(shí)  LC  傳感器  

          采用16-bit MCU實(shí)現(xiàn)超低功耗運(yùn)動(dòng)檢測

          • 諧振 LC 傳感器技術(shù)用于運(yùn)動(dòng)檢測已有數(shù)年,包括流量計(jì)量以及其它低速轉(zhuǎn)動(dòng)檢測系統(tǒng)等。幾乎在所有情況下,推動(dòng)上述傳感器設(shè)計(jì)發(fā)展的共同主線都是低功耗解決方案的需求,它通常為電池供電設(shè)備的低功耗解決方案。通過模
          • 關(guān)鍵字: 功耗  運(yùn)動(dòng)  檢測  超低  實(shí)現(xiàn)  16-bit  MCU  采用  

          bit和byte的關(guān)系及區(qū)別

          • bit和byte的關(guān)系:一byte等于8bitbit意為“位”或“比特”,是計(jì)算機(jī)運(yùn)算的基礎(chǔ),屬于二進(jìn)制的范籌; Byte意為“ ...
          • 關(guān)鍵字: bit  byte  區(qū)別  

          基于BIT技術(shù)的裝備控制系統(tǒng)故障診斷

          • 引言  內(nèi)裝測試(BIT)是20世紀(jì)70年代美國在軍用測試領(lǐng)域提出的全新的技術(shù)概念,其目的在于改善裝備的維修性、測試性和自診斷能力,同時(shí)也使裝備系統(tǒng)的機(jī)動(dòng)性和保障性得到很大改善。20世紀(jì)70年代以來,以航天航空等國
          • 關(guān)鍵字: BIT  裝備控制  系統(tǒng)  故障診斷    

          Intersil推出12位500MSPS模數(shù)轉(zhuǎn)換器

          • 全球高性能模擬混合信號半導(dǎo)體設(shè)計(jì)和制造領(lǐng)導(dǎo)廠商Intersil公司2010年8月4日宣布, 推出全新 8 位、10 位、12 位 500MSPS 模數(shù)轉(zhuǎn)換器系列。12 位的ISLA112P50 IRZ 500MSPS 模數(shù)轉(zhuǎn)換器作為該系列的領(lǐng)銜產(chǎn)品,其功耗僅為 468 毫瓦,比所有12 位 500MSPS ADC 同類競爭產(chǎn)品都低 5 倍。
          • 關(guān)鍵字: Intersil  MSPS  ISLA112P50 IRZ 500MSPS   

          高頻AD8331 VGA與10位、65 MSPS/80 MSPS/105 MSPS

          • 對于直流或低頻模擬信號,分辨率最高達(dá)24位的Σ-Δ型ADC經(jīng)濟(jì)實(shí)惠、款式多樣,但采樣頻率通常限制在數(shù)百kHz?,F(xiàn)有的先進(jìn)ADC的分辨率會(huì)隨著采樣頻率的提高而降低,這使得利用標(biāo)準(zhǔn)ADC對高頻、低振幅信號進(jìn)行精確數(shù)字化處理極其困難??勺冊鲆娣糯笃骺梢苑奖愕亟鉀Q這一問題
          • 關(guān)鍵字: MSPS  AD  8331  9215    

          BIT技術(shù)在裝備控制系統(tǒng)故障診斷中的應(yīng)用

          •   BIT系統(tǒng)   內(nèi)裝測試及自診斷系統(tǒng)包括信號調(diào)理模塊、數(shù)據(jù)采集模塊、數(shù)據(jù)存儲模塊、故障診斷、自激勵(lì)模塊和通訊電纜輸出模塊六部分(見圖1)。模擬電壓采集中信號調(diào)理電路負(fù)責(zé)完成對信號的差分放大、濾波和限幅等調(diào)理工作。邏輯量、頻率量、時(shí)間量和脈沖量采集中的信號調(diào)理電路負(fù)責(zé)完成對信號的限幅和數(shù)據(jù)緩沖等調(diào)理工作。光電隔離主要是為了把所測量的信號和計(jì)算機(jī)相隔離,這樣可以確保數(shù)據(jù)采集的讀數(shù)不會(huì)受到接地電勢差或共模電壓的影響。數(shù)據(jù)存儲模塊主要用來存儲一些內(nèi)裝測試及自診斷系統(tǒng)的診斷信息,包括測量的數(shù)字信息、設(shè)備上的模
          • 關(guān)鍵字: BIT  A/D  裝備控制  

          9位100 MSPS流水線結(jié)構(gòu)A/D轉(zhuǎn)換器的設(shè)計(jì)

          • 提出一種采用三級流水線型結(jié)構(gòu)的9位100 MSPS折疊式A/D轉(zhuǎn)換器,具體分析了其內(nèi)部結(jié)構(gòu)。電路使用0.6μm Bipolar工藝實(shí)現(xiàn),由5 V/3.3V雙電源供電,經(jīng)優(yōu)化設(shè)計(jì)后,實(shí)現(xiàn)了9位精度。100MSPS的轉(zhuǎn)換速度,功耗為650mW,差分輸入范圍2.2V。給出了在Cadence Spectre的仿真結(jié)果,討論了流水線A/D轉(zhuǎn)換器設(shè)計(jì)的關(guān)鍵問題。
          • 關(guān)鍵字: MSPS  100  D轉(zhuǎn)換  流水線結(jié)構(gòu)    

          適用于12 bit流水線ADC采樣保持電路的設(shè)計(jì)

          • 本文設(shè)計(jì)了一個(gè)可用于12 bit,20 MS/s流水線ADC中的采樣/保持電路。該電路使用CSMC公司的0.5μm CMOS工藝庫,在20 MS/s采樣頻率下,當(dāng)輸入信號的頻率為9.8193 MHz時(shí),SFDR為76 dB,精度達(dá)0.012%,完全滿足12 bit要求。本文運(yùn)用增益增強(qiáng)型折疊式運(yùn)算放大器,以獲得較高的增益和帶寬。同時(shí)采用柵壓自舉開關(guān),并通過對電路中的開關(guān)組合優(yōu)化,極大的提高了電路的線性性能;采用全差分結(jié)構(gòu)、底極板采樣來消除電荷注入和時(shí)鐘饋通。該采樣保持電路能夠直接應(yīng)用于高速高精度模/數(shù)轉(zhuǎn)換
          • 關(guān)鍵字: 保持  電路  設(shè)計(jì)  采樣  ADC  bit  流水線  適用于  
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