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《Cortex-M0權(quán)威指南》之體系結(jié)構(gòu)---嵌套中斷控制器（NVIC）
- 為了管理中斷請(qǐng)求的優(yōu)先級(jí)并處理其他異常，Cortex-M0處理器內(nèi)置了嵌套中斷控制器(NVIC)。NVIC的一些可編程控制器控制著中斷管理功能，這些寄存器被映射到系統(tǒng)地址空間里，它們所處的區(qū)域被稱為系統(tǒng)控制空間(SCS)?！ VIC有以下特性： 靈活的中斷管理; 支持嵌套中斷; 向量化的異常入口 中斷屏蔽 靈活的中斷管理 Cortex-M0處理器中，每一個(gè)外部中斷都可以被使能或者禁止，并且可以被設(shè)置為掛起狀態(tài)或者清除狀態(tài)。處理器的中斷可以是信號(hào)級(jí)的(在中斷服務(wù)程序清除中斷請(qǐng)求以前，外設(shè)的
- 關(guān)鍵字： Cortex-M0 NVIC
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