為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設定不當帶來的數(shù)據(jù)不連續(xù)問題,結合LabVIEWFPGA的編程特點和DMA FIFO的工作原理,提出了一種設定FIFO深度的方法。對FIFO不同深度的實驗表明,采用該方法設定的FIFO深度能夠
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LabVIEW FPGA FIFO 模塊
0 引言 傳統(tǒng)數(shù)字濾波器硬件的實現(xiàn)主要采用專用集成電路(ASIC)和數(shù)字信號處理器(DSP)來實現(xiàn)。FPGA內(nèi)部的功能塊中采用了SRAM的查找表(lo-ok up table,LUT)結構,這種結構特別適用于并行處理結構,相對于傳統(tǒng)方法來
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FPGA FIR 分布式算法 低通
摘要:為了產(chǎn)生穩(wěn)定激勵信號的目的,采用Verilog硬件語言在FPGA上實現(xiàn)了數(shù)字頻率合成器的設計,該設計包括累加器、波形存儲器、AD轉換、低通濾波器等;對累加器、波形存儲器都進行了仿真,并下載到FPGA中,經(jīng)A/D轉換
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FPGA 數(shù)字頻率合成器
摘要:高量程加速度傳感器在小信號的激勵下輸出在10 mV以內(nèi),傳統(tǒng)測試系統(tǒng)的噪聲可能覆蓋如此小的電壓信號,使高量程的加速度傳感器無法測試小的加速度信號。針對這一問題提出了基于自動增益切換控制理論的自適應數(shù)字
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FPGA 數(shù)字 傳感器設計
Maxim Integrated Products (NASDAQ: MXIM)推出能夠直接插入符合Digilent? Pmod?標準的任意FPGA/CPU擴展端口的15個外設模塊套裝。簡單的連接操作和便利的軟件集成可加速原型開發(fā)進度,實現(xiàn)從概念至設計方案的快速移植。這套模塊的價格極具競爭力,即使在預算最緊張的情況下,也可以采用先進的高性能IC進行方案測試。
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Maxim FPGA
All Programmable FPGA、SoC和3D IC的全球領先企業(yè)賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )宣布推出針對采用Virtex?-7 FPGA 集成模塊設計的全新解決方案, 該集成模塊可支持PCI Express (簡稱PCI-E) 3.0 x8標準和 DDR3 外部存儲器,能為開發(fā)人員提供立即啟動基于PCI-E 3.0的設計所需的全部構建模塊。
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賽靈思 FPGA Virtex-7
基于FPGA+嵌入式處理器的違章車輛視頻檢測系統(tǒng),0 引 言隨著我國經(jīng)濟的發(fā)展,機動車輛不斷地增長,現(xiàn)有道路等硬件設施的增長已經(jīng)滿足不了日益膨脹的交通問題,智能交通系統(tǒng)(Intelligent Transportation System,ITS)越來越受重視。所謂智能交通系統(tǒng)(ITS)就是將先
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車輛 視頻 檢測系統(tǒng) 違章 處理器 FPGA 嵌入式 基于
0 引言目前,液晶顯示行業(yè)得到迅速的發(fā)展,但由于液晶模塊的生產(chǎn)不可能達到100%的成品率,或多或少地存在缺陷,目前在TFT模塊的生產(chǎn)工藝中就有可能產(chǎn)生點缺陷和線缺陷等。為了及早對產(chǎn)品的質(zhì)量進行檢測,液晶測試儀器成為
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TFTLCD FPGA 信號源
解本土IC設計之“渴”
近來中國IC市場的最重磅新聞要屬大小“M”——臺灣聯(lián)發(fā)科(MTK)和晨星半導體(MStar)宣布合并?!癕兄弟”的聯(lián)手對已跨入“1億美元俱樂部”的少數(shù)剛崛起的大陸本土IC設計公司帶來很大的競爭壓力,而原本就缺資金、缺平臺、缺資源的本土小型和微型IC廠商的生存空間更加令人堪憂。
正如富士通半導體ASIC/COT業(yè)務市場部副經(jīng)理劉哲女士在不久前閉幕的&
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IC 富士通 半導體 ASIC/COT
不久前,All Programmable技術和器件的企業(yè)——賽靈思公司(Xilinx)正式發(fā)貨 Virtex-7 H580T FPGA—全球首款3D異構All Programmable產(chǎn)品。
Virtex-7 HT采用賽靈思的堆疊硅片互聯(lián) (SSI)技術,是提供業(yè)界帶寬最高的FPGA,可提供多達16個28 Gbps收發(fā)器和72個13.1 Gbps收發(fā)器,也是能滿足關鍵Nx100G和400G線路卡應用功能要求的單芯片解決方案。
為此,本刊訪問了該公司負責人,澄
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Xilinx 賽靈思 3D FPGA all programmable 異構
一種基于ARM和FPGA的可重構MAC協(xié)議設計,摘要:為了在實際信道條件下研究Ad Hoc網(wǎng)絡MAC協(xié)議,克服商業(yè)網(wǎng)卡芯片和理論仿真等帶來的局限性,搭建了基于ARM和FPGA相結合的硬件平臺,設計與實現(xiàn)了基于CSMA/CA的可重構MAC協(xié)議,并進行了仿真測試,驗證了該協(xié)議設
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協(xié)議 設計 MAC 重構 ARM FPGA 基于
傳統(tǒng)的綜合技術越來越不能滿足當今采用 90 納米及以下工藝節(jié)點實現(xiàn)的非常大且復雜的 FPGA 設計的需求了。問題是傳統(tǒng)的 FPGA 綜合引擎是基于源自 ASIC 的方法,如底層規(guī)劃、區(qū)域內(nèi)優(yōu)化 (IPO,In-place Optimization) 以
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Synplify Premier FPGA 時序收斂
摘要:在分析了IRIG-B(DC)碼碼型特點的基礎上,提出了一種IRIG-B(DC)時間碼解碼的設計方法。該方法由少量外圍電路與一片現(xiàn)場可編程門陣列(FPGA)芯片組成,來實現(xiàn)對IRG-B(DC)碼的解碼、1 PPS信號輸出、實時時間顯示以
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IRIG-B FPGA DC 解碼
摘要:以XC2V1500-FPGA為硬件架構,設計了一種圖像信號發(fā)生器,作為自適應光學系統(tǒng)波前處理機的信號源,為波前處理機的調(diào)試和算法驗證提供支持。系統(tǒng)采用大容量的NAND型FLASH存儲數(shù)據(jù),存儲容量為1 GB。圖像數(shù)據(jù)通過
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FLASH FPGA ROM 圖像信號發(fā)生器
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