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基于FPGA的混合擴(kuò)頻發(fā)射機(jī)設(shè)計(jì)與實(shí)現(xiàn)
- 摘要：以Alter公司的FPGA為硬件平臺(tái)，以QuartusⅡ?yàn)樵O(shè)計(jì)工具，來(lái)實(shí)現(xiàn)該直擴(kuò)／跳頻混合發(fā)射系統(tǒng)。頂層采用圖形設(shè)計(jì)方式，各個(gè)模塊均采用Verilog語(yǔ)言進(jìn)行設(shè)計(jì)。編碼模塊采用了RS(255，223)碼與卷積碼(2，1，7)相結(jié)合，
- 關(guān)鍵字： FPGA 混合擴(kuò)頻 射機(jī)設(shè)計(jì)
基于FPGA的HDB3碼編碼器優(yōu)化設(shè)計(jì)與分析
- 摘要：利用四進(jìn)程和結(jié)構(gòu)化設(shè)計(jì)兩種不同的VHDL程序設(shè)計(jì)方法，對(duì)HDB3編碼器進(jìn)行了設(shè)計(jì)、實(shí)現(xiàn)和功能分析。設(shè)計(jì)的兩種編碼器在Quartus Ⅱ7．2中進(jìn)行了功能分析，并且下載到EP2C5T144C6中實(shí)現(xiàn)了HDB3編碼轉(zhuǎn)換功能。分析與實(shí)
- 關(guān)鍵字： FPGA HDB3 編碼器 優(yōu)化設(shè)計(jì)
導(dǎo)航計(jì)算機(jī)系統(tǒng)中CPLD配置軟件串口更新研究
- 摘要：針對(duì)嵌入式導(dǎo)航計(jì)算機(jī)系統(tǒng)中CPLD器件軟件更新需求，提出了通過(guò)串行方式基于DSP的CPLD軟件更新方案，通過(guò)DSP的I／O口模擬CPLD的JTAG時(shí)序邏輯，將由串口接收到的CPLD配置信息文件，移入到其內(nèi)部邏輯中，從而實(shí)現(xiàn)
- 關(guān)鍵字： CPLD 導(dǎo)航計(jì)算機(jī) 串口 系統(tǒng)
一種基于FPGA的雷達(dá)數(shù)字信號(hào)處理機(jī)設(shè)計(jì)與實(shí)現(xiàn)
- 摘要：結(jié)合具體的雷達(dá)導(dǎo)引頭型號(hào)項(xiàng)目．從數(shù)字信號(hào)處理機(jī)的原理出發(fā)，根據(jù)項(xiàng)目的要求提出了一種基于DBF技術(shù)的某型導(dǎo)引頭信號(hào)處理機(jī)設(shè)計(jì)方案，方案以Xilinx公司Virtex4 SX55 FPGA作為數(shù)字信號(hào)處理的核心器件，實(shí)現(xiàn)對(duì)6陣
- 關(guān)鍵字： FPGA 雷達(dá)數(shù)字 信號(hào)處理機(jī)
Altera發(fā)售Cyclone V系列
- Altera公司今天宣布，開始發(fā)售其28-nm Cyclone V FPGA。Cyclone V器件是目前市場(chǎng)上功耗最低、成本最低的28-nm FPGA。該系列通過(guò)集成，前所未有的同時(shí)實(shí)現(xiàn)了高性能、低系統(tǒng)成本和低功耗，非常適合工業(yè)、無(wú)線、固網(wǎng)、軍事和汽車等市場(chǎng)應(yīng)用。Cyclone V系列完成了Altera的28-nm定制系列產(chǎn)品的全系列發(fā)售，提供多種器件以滿足用戶的各類設(shè)計(jì)需求——從最大帶寬到最低功耗。
- 關(guān)鍵字： Altera FPGA Cyclone V
基于DSP的實(shí)時(shí)數(shù)據(jù)處理系統(tǒng)淺析
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： DSP SOPC 實(shí)時(shí)數(shù)據(jù) FPGA
基于單片機(jī)及FPGA的程控濾波器設(shè)計(jì)與實(shí)現(xiàn)
- 濾波器是一種用來(lái)消除干擾雜訊的器件，可用于對(duì)特定頻率的頻點(diǎn)或該頻點(diǎn)以外的頻率進(jìn)行有效濾除。它在電子領(lǐng)域中占有很重要的地位，在信號(hào)處理、抗干擾處理、電力系統(tǒng)、抗混疊處理中都得到了廣泛的應(yīng)用。而對(duì)于程控濾
- 關(guān)鍵字： FPGA 單片機(jī) 程控 濾波器設(shè)計(jì)
基于FPGA+DSP雷達(dá)導(dǎo)引頭信號(hào)處理中FPGA設(shè)計(jì)的關(guān)鍵
- 1 引言隨著同防工業(yè)對(duì)精確制導(dǎo)武器要求的不斷提高，武器系統(tǒng)總體設(shè)計(jì)方案的日趨復(fù)雜，以及電子元器件水平的飛速發(fā)展。導(dǎo)引頭信號(hào)處理器的功能越來(lái)越復(fù)雜，硬件規(guī)模越來(lái)越大．處理速度也越來(lái)越高．而且產(chǎn)品的更新速度
- 關(guān)鍵字： FPGA DSP 雷達(dá)導(dǎo)引頭 關(guān)鍵技術(shù)
基于DSP與CPLD的輸電線路局部氣象監(jiān)測(cè)裝置設(shè)計(jì)
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： DSP 氣象監(jiān)測(cè) CPLD
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