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基于CPLD的CCD相機圖像信號模擬器的設(shè)計
- 1 引言 多年來CCD 器件以體積小、重量輕、功耗小、工作電壓低和抗燒毀等優(yōu)點以及在分辨率、動態(tài)范圍、靈敏度、實時傳輸、自掃描等特性，廣泛地應(yīng)用于攝像器材、氣象、航天航空、軍事、醫(yī)療以及工業(yè)檢測等眾多領(lǐng)域。 在對某多通道高速CCD相機輸出圖像信號的采集系統(tǒng)設(shè)計過程當(dāng)中，我們需要對此系統(tǒng)在正式使用之前進行調(diào)試，來測試它能否正常工作。本文利用CPLD和LVDS嚴格對CCD相機的輸出接口進行了模擬，并且以LVDS方式輸出圖像信號。 &n
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基于CPLD的數(shù)字濾波抗干擾電路設(shè)計
- 引言 紅外密集度光電立靶測試系統(tǒng)是一種用于測量低伸彈道武器射擊密集度的新型的測試系統(tǒng)，它既可用于金屬彈丸的測試，又可測試非金屬彈丸，具有反映靈敏、精度高而穩(wěn)定、操作簡單、容易維護等優(yōu)點，已被許多靶場投入使用。 光電靶的基本原理是：當(dāng)光幕內(nèi)的光通量發(fā)生足夠大的變化時，光電傳感器會響應(yīng)這種變化而產(chǎn)生電信號。這就是說，一些非彈丸物體在穿過光幕時也會使光幕內(nèi)的光通量發(fā)生變化以使光電傳感器產(chǎn)生電信號。從原理上講。這種現(xiàn)象并非異常，而從測試來講，則屬于干擾。在具體靶場測試中，當(dāng)干擾嚴重時，可能會導(dǎo)致測試無法進行
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基于CPLD的聲發(fā)射信號傳輸系統(tǒng)設(shè)計
- 引言 聲發(fā)射技術(shù)是光纖傳感技術(shù)和聲發(fā)射技術(shù)相結(jié)合的產(chǎn)物，是目前聲發(fā)射技術(shù)的發(fā)展趨勢。它將高靈敏度聲發(fā)射傳感器安裝于受力構(gòu)件表面以形成一定數(shù)目的傳感器陣列，實時接收和采集來自于材料缺陷的聲發(fā)射信號，進而通過對這些聲發(fā)射信號的識別、判斷和分析來對材料損傷缺陷進行檢測研究并對構(gòu)件強度、損傷、壽命等進行分析和研究。 在實際的構(gòu)件檢測中，現(xiàn)場聲源信號通常是在100～800 kHz之間的微弱高頻信號，而且材料損傷檢測、聲發(fā)射源定位往往需要多個傳感器形成傳感器陣列，而聲發(fā)射信號的數(shù)據(jù)傳輸系統(tǒng)必須達到640 Mbp
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采用靈活的汽車FPGA來提高片上系統(tǒng)級集成和降低物料成本
- 汽車制造商們堅持不懈地改進車內(nèi)舒適性、安全性、便利性、工作效能和娛樂性，反過來，這些努力又推動了各種車內(nèi)數(shù)字技術(shù)的應(yīng)用。然而，汽車業(yè)較長的開發(fā)周期卻很難跟上最新技術(shù)的發(fā)展，尤其是一直處于不斷變化中的車內(nèi)聯(lián)網(wǎng)規(guī)范，以及那些來自消費市場的快速興起和消失的技術(shù)，從而造成了較高的工程設(shè)計成本和大量過時。向這些組合因素中增加低成本目標、擴展溫度范圍、高可靠性與質(zhì)量目標和有限的物理板空間，以及汽車設(shè)計中存在的挑戰(zhàn)，最多使人進一步感到沮喪?？删幊踢壿嬈骷?nbsp;(PLD)，如現(xiàn)場可編程門陣列 (FPGA)
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基于IP核的FPGA設(shè)計方法
- 前 言 幾年前設(shè)計專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實現(xiàn), 系統(tǒng)制造公司的設(shè)計人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級功能(System L evel In tegrete - SL I) , 或稱片上系統(tǒng)(System on a ch ip ) , 但ASIC 設(shè)計能力跟不上制造能力的矛盾也日益突出?，F(xiàn)在設(shè)計人員已不必全部用邏輯門去設(shè)計ASIC, 類似于用集成電路( IC) 芯片在印制板上的設(shè)計,ASIC 設(shè)計人員可以應(yīng)用等
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PDH通信二次群復(fù)接器在CPLD中的實現(xiàn)
- 1 引 言 數(shù)字復(fù)接就是把兩個或兩個以上的支路數(shù)字信號按時分復(fù)接方式合并成單一的合路數(shù)字信號。按照各低次群時鐘的情況，復(fù)接有3種方式：如果各輸入支路數(shù)字信號相互同步，且與本機定時信號也同步，那么調(diào)整單元只需調(diào)整相位，這就是同步復(fù)接；如果輸入支路數(shù)字信號不同步且與本機定時信號也異步，那么調(diào)整單元就要對各支路信號進行頻率和相位的調(diào)整，使之成為同步信號，這就是異步復(fù)接；如果輸入支路數(shù)字信號的生效瞬間相對于本機對應(yīng)的定時信號是以同一標稱速度出現(xiàn)，而速度的任何變化都限制在規(guī)定的容差范圍內(nèi)，這種就是準同步(PDH
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CPLD在三相PFC矩陣變換器中的應(yīng)用
- 1 引言 隨著電子技術(shù)的不斷發(fā)展，在通訊、控制工程中應(yīng)運而生的各種硬件平臺在功率電子領(lǐng)域中顯示出了獨有的特色，例如：MCU，DSP和復(fù)雜可編程邏輯器(Complex Programmable Logic Device。簡稱CPLD)等集成度很高的數(shù)字芯片就是以其精度高，溫度漂移小，升級換代簡便，長期工作不老化等特點，而廣泛用于功率變換器中，且大有取代傳統(tǒng)模擬控制芯片的勢頭。CPLD的多個通道可以并行工作的這一特點，使得控制三相功率因數(shù)校正(PFC)矩陣變換器的6只雙向開關(guān)同步、協(xié)調(diào)地工作。在此，介紹的
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基于DSP和CPLD的低功耗多路數(shù)據(jù)處理系統(tǒng)設(shè)計
- 引言 隨著電子技術(shù)的應(yīng)用和發(fā)展，數(shù)字信號處理內(nèi)容日益復(fù)雜，同時，很多情況下要求整個系統(tǒng)具有低功耗的特點。為滿足這種要求，DSP芯片設(shè)計技術(shù)也在向低功耗、高性能的方向發(fā)展。從處理速度來看，TMS320VC5502的運算能力已經(jīng)達到了600MMACS，即每秒鐘可以完成6億次乘加運算。從功耗來看，TMS320VC5502內(nèi)核電壓只有1.26V，整個芯片的功耗也大大降低了。本文介紹了基于TMS320VC5502和CPLD XC95144的低功耗多路數(shù)據(jù)處理系統(tǒng)。 模擬信號的輸入經(jīng)過50Hz陷波電路(濾除工頻
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MCS-51單片機與CPLD/FPGA接口邏輯設(shè)計
- 在功能上，單片機與大規(guī)模CPLD有很強的互補性。單片機具有性能價格比高、功能靈活、易于人機對話、良好的數(shù)據(jù)處理能力濰點；CPLD/FPGA則具有高速、高可靠以及開發(fā)便捷、規(guī)范等優(yōu)點。以此兩類器件相結(jié)合的電路結(jié)構(gòu)在許多高性能儀器儀表和電子產(chǎn)品中仍將被廣泛應(yīng)用。本文就單片機與CPLD/FPGA的接口方式作一簡單介紹，希望對從事單片機和CPLD/FPGA研發(fā)的朋友能有所啟發(fā)。 單片機與CPLD/FPGA的接口方式一般有兩種，即總線方式與獨立方式，分別說明
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在CPLD管理下實現(xiàn)高效多串口中斷源
- 近幾年來，隨著后PC時代的來臨，具有簡潔、高效等特點的嵌入式系統(tǒng)得到了飛速的發(fā)展。嵌入式技術(shù)發(fā)展到今天已將各種計算機技術(shù)多層次、多方面的交叉融合在了一起。嵌入式系統(tǒng)加快了工業(yè)設(shè)計進程，降低了開發(fā)成本及其風(fēng)險，使用簡便，擴展靈活，高效精簡，可方便地應(yīng)用于各工業(yè)領(lǐng)域。 中斷請求采用邊沿觸發(fā)來進行中斷檢測，通過將信號送到特定的引線來檢測中斷。每條引線對應(yīng)一個可能的硬件中斷，因為系統(tǒng)不能辨認哪個設(shè)備使用中斷線，所以當(dāng)多個1個的設(shè)備被設(shè)置成使用同一個特定中斷時就產(chǎn)生了混亂。中斷產(chǎn)生時，由專用的中斷程序接管系統(tǒng)，首先
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