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基于CPLD／FPGA的VHDL語言電路優(yōu)化設(shè)計(jì)
- 杜志傳，鄭建立(上海理工大學(xué) 醫(yī)療器械與食品學(xué)院 上海 200093)0 引 言VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)
- 關(guān)鍵字： VHDL CPLD／FPGA 電路設(shè)計(jì) 優(yōu)化
基于嵌入式系統(tǒng)中DRAM控制器的CPLD解決方案
- 80C186XL16位嵌入式微處理器是Intel公司在嵌入式微處理器市場的上導(dǎo)產(chǎn)品之一，已廣泛應(yīng)用于電腦終端、程控交換和工控等領(lǐng)域。在該嵌入式微處理器片內(nèi)，集成有DRAM RCU單元，即DRAM刷新控制單元。RCU單元可以自動產(chǎn)生
- 關(guān)鍵字： 嵌入式系統(tǒng) DRAM控制器 CPLD
基于CPLD器件在時(shí)間統(tǒng)一系統(tǒng)中的應(yīng)用
- 引言隨著電子技術(shù)的發(fā)展，對遙測信號的幀結(jié)構(gòu)的可編程度、集成度的要求越來越高，用于時(shí)間統(tǒng)一系統(tǒng)的B碼源的設(shè)計(jì)也趨于高度集成化。為了適應(yīng)現(xiàn)代靶場試驗(yàn)任務(wù)的要求，我們采用Altera的CPLD器件，將用于產(chǎn)生B碼的各種
- 關(guān)鍵字： CPLD 時(shí)間統(tǒng)一系統(tǒng) IRIG－B碼
DSP與CPLD的輸電線路局部氣象監(jiān)測裝置設(shè)計(jì)
- 1 概 述輸電線路的狀態(tài)直接決定著整個(gè)電網(wǎng)的安全穩(wěn)定運(yùn)行，輸電線路微氣象參數(shù)的實(shí)時(shí)監(jiān)測能夠?yàn)殡娋W(wǎng)正常調(diào)度、以及自然災(zāi)害預(yù)測和控制提供必要的現(xiàn)場信息。輸電線路是電力系統(tǒng)的關(guān)鍵元件之一。為了安全、穩(wěn)定地運(yùn)行，
- 關(guān)鍵字： DSP CPLD 輸電線路 氣象監(jiān)測
CPLD電梯運(yùn)行控制器VHDL
- 西安航空職業(yè)技術(shù)學(xué)院 李軍法1 引言隨著社會的發(fā)展。使用電梯越來越普遍，已從原來只在商業(yè)大廈、賓館過渡到在辦公室、居民樓等多種建筑中，并且對電梯功能的要求也不斷提高，其相應(yīng)控制方式也在不斷發(fā)生變化。電梯的
- 關(guān)鍵字： CPLD 電梯 運(yùn)行控制器 VHDL
基于JTAG接口的內(nèi)建修調(diào)電路的設(shè)計(jì)
- 摘要：為減小基準(zhǔn)電壓源的誤差，提高集成電路精度，設(shè)計(jì)了一種基于JTAG接口的熔絲燒斷修調(diào)電路，著重分析JTAG接口及修調(diào)技術(shù)的具體實(shí)現(xiàn)。通過調(diào)整電路內(nèi)部結(jié)構(gòu)，使基準(zhǔn)電壓在-40到85度的范圍內(nèi)誤差不超過100ppm，并通
- 關(guān)鍵字： JTAG接口 修調(diào)技術(shù) 熔絲 基準(zhǔn)電壓
CPLD 實(shí)現(xiàn)DDS 信號源的設(shè)計(jì)
- 中文摘要:利用CPLD 在高速數(shù)據(jù)處理方面的特點(diǎn)設(shè)計(jì)出以VHDL 硬件描述語言為設(shè)計(jì)輸入, 以AL TERA 公司的 EPM 7256 芯片為設(shè)計(jì)載體, 基于DDS 技術(shù)的任意波形信號發(fā)生器。該信號發(fā)生器能同時(shí)輸出兩路信號, 輸出信號的頻
- 關(guān)鍵字： CPLD DDS 信號源 設(shè)計(jì)
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