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          利用EDA工具提高系統(tǒng)級芯片測試的效率

          • 高度復(fù)雜的SoC設(shè)計正面臨著高可靠性、高質(zhì)量、低成本以及更短的產(chǎn)品上市周期等日益嚴峻的挑戰(zhàn)??蓽y性設(shè)計通過提高電路的可測試性,從而保證芯片的高質(zhì)量生產(chǎn)和制造。借助于EDA技術(shù),可以實現(xiàn)可測試性設(shè)計的自動化,
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          北京:重點轉(zhuǎn)向幫助IC設(shè)計企業(yè)做強做大

          •   北京ICC(集成電路設(shè)計園)在運作模式上有其特殊之處。國內(nèi)其他地區(qū)的ICC大多是事業(yè)單位,而北京集成電路設(shè)計園是一家企業(yè),所以公司在給北京地區(qū)的IC設(shè)計企業(yè)提供公益性的技術(shù)服務(wù)的同時還可以租賃優(yōu)良的地產(chǎn),自身具有一定的造血機能,因此在為行業(yè)服務(wù)時既有較大的靈活性,同時本身抵抗風險的能力也更強。   市場化運作模式更貼近客戶   從北京集成電路設(shè)計園的收入組成來看,我們提供給企業(yè)的EDA(電子設(shè)計自動化)五金|工具、MPW(多項目晶圓)、IP和測試等服務(wù)是我們收入來源的一部分,但這部分收入所占的比重
          • 關(guān)鍵字: EDA  IC設(shè)計  

          數(shù)字電子技術(shù)與EDA技術(shù)相結(jié)合的探討

          • 針對目前電子信息工程專業(yè)《數(shù)字電子技術(shù)》課程和《EDA技術(shù)》課程相結(jié)合的研究比較少的現(xiàn)狀,對兩課程相結(jié)合的益處進行了探討。通過介紹常用的EDA軟件Max+PlusⅡ,結(jié)合例子,通過仿真分析得出EDA技術(shù)與數(shù)字電子技術(shù)相結(jié)合具有如下三點益處:實現(xiàn)硬件電路設(shè)計軟件化,分析疑難電路現(xiàn)象,實現(xiàn)“開放”的數(shù)字電路實驗室。通過將兩課程相結(jié)合,可以使教師對理論知識的講解更透徹,使學(xué)生有更多的機會設(shè)計并驗證電路,對“教”與“學(xué)”都具有積極作用。
          • 關(guān)鍵字: EDA  數(shù)字電子技術(shù)    

          基于EDA的嵌入式系統(tǒng)軟硬件劃分方法

          • 1 引言   嵌入式系統(tǒng)是由一個或若干個微處理器、ASICs、存儲器和總線構(gòu)成的,在一定時間內(nèi)響應(yīng)輸人的系統(tǒng)。傳統(tǒng)的嵌入式系統(tǒng)的設(shè)計方法將硬件和軟件劃分為兩個獨立的部分,由硬件工程師和軟件工程師按照擬定的設(shè)計
          • 關(guān)鍵字: EDA  嵌入式系統(tǒng)  方法  軟硬件    

          數(shù)字電子系統(tǒng)的EDA設(shè)計方法研究

          • 0 引 言
            隨著計算機與微電子技術(shù)的發(fā)展,電子設(shè)計自動化EDA領(lǐng)域已成為電子技術(shù)發(fā)展的主體,數(shù)字系統(tǒng)的設(shè)計正朝著速度快、容量大、體積小、重量輕的方向發(fā)展。推動該潮流發(fā)展的引擎,就是日趨進步和完善的CPLD
          • 關(guān)鍵字: EDA  數(shù)字電子  設(shè)計方法  系統(tǒng)    

          Synphony:IC設(shè)計因此而改變

          •   假如IC設(shè)計的速度能夠加快數(shù)倍,那么擁有各種復(fù)雜功能的各類電子產(chǎn)品將再次改變我們的生活。   IC設(shè)計中設(shè)計與驗證的流程通常需要數(shù)月甚至數(shù)年,其中的人工重新編碼的過程費時且容易出錯,Synopsys選擇這一環(huán)節(jié)為突破,開發(fā)出了Synphony高層次綜合EDA工具,通過其獨特的MATLAB語言、基于模型的解決方案,針對ASIC和FPGA芯片設(shè)計實現(xiàn)了10倍的設(shè)計與驗證能力。   據(jù)Synopsys公司總監(jiān)Chris Eddington介紹,Synphony的創(chuàng)意來自被收購的Synplicity公司,
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          臺積電試產(chǎn)腳步不停歇 設(shè)備材料廠加碼投資

          •   盡管絕大多數(shù)半導(dǎo)體業(yè)者對于景氣抱持保守觀望態(tài)度,然臺積電仍逆勢加碼先進制程,18寸晶圓廠發(fā)展腳步并未放緩,不僅2012年試產(chǎn)18寸晶圓規(guī)畫不變,近期更緊鑼密鼓與國際半導(dǎo)體設(shè)備、材料業(yè)者合作推進22奈米制程,吸引包括艾斯摩爾(ASML)、比利時前瞻研發(fā)中心(IMEC)及陶氏化學(xué)近日均宣示將加碼臺灣研發(fā)中心投資。   受到金融風暴及全球景氣不明朗影響,業(yè)界一度傳出臺積電18寸晶圓廠計畫受阻,包括設(shè)備、材料業(yè)者配合意愿都大幅降低,不過,近期臺積電仍積極與半導(dǎo)體設(shè)備、材料業(yè)者展開合縱連橫,持續(xù)推動18寸晶圓
          • 關(guān)鍵字: 臺積電  晶圓  半導(dǎo)體設(shè)備  EDA  

          基于EDA技術(shù)的555單穩(wěn)態(tài)觸發(fā)器設(shè)計與仿真

          • 1 引言
            當前電子線路已大量采用計算機輔助仿真設(shè)計,尤其是電子設(shè)計EDA仿真技術(shù)。EDA仿真軟件中Electronics Workbench仿真設(shè)計分析軟件是計算機數(shù)字電路與邏輯設(shè)計模擬和仿真的軟件包,是實用的電子電路在線仿真
          • 關(guān)鍵字: EDA  555  單穩(wěn)態(tài)觸發(fā)器  仿真    

          3大EDA業(yè)者搶搭中國大陸數(shù)百億核高基列車

          •   鎖定中國大陸官方端出人民幣數(shù)百億元的核高基計劃,可望進一步大力扶植IC設(shè)計、IC制造與IC設(shè)備業(yè)者,3大IC自動化設(shè)計平臺(EDA)業(yè)者無不將此市場大餅當成大陸市場的營運重點,強化與產(chǎn)、官、學(xué)各界更緊密合作。益華(Cadence)、新思(Synopsys)與明導(dǎo)(Mentor)高層對于掌握核高基商機無不使出全力,希望搭上這班列車。   在大陸官方推出的2006~2020年600億元人民幣核高基計劃,被大陸半導(dǎo)體視為十一五計劃中的重點環(huán)節(jié),除了重點扶植IC設(shè)計、IC制造與IC設(shè)備業(yè)者,在半導(dǎo)體項目中涉
          • 關(guān)鍵字: EDA  IC設(shè)計  IC制造  

          Altium Designer最新版本Summer 09 技術(shù)研討會

          •   (上海站—2009年9月7日/北京站—2009年9月9日/深圳站—2009年9月11日)   邀請函   為適應(yīng)日新月異的電子設(shè)計技術(shù),Altium于2009年7月在全球范圍內(nèi)推出最新版本Altium Designer Summer 09 (Protel系列軟件最新版本)。Summer 09的誕生延續(xù)了連續(xù)不斷的新特性和新技術(shù)的應(yīng)用過程。   為讓廣大Altium用戶更好了解并應(yīng)用Altium Designer最新版本的強大功能,億道電子攜手Altium(中國
          • 關(guān)鍵字: Altium  EDA  億道  

          基于EDA技術(shù)的FPGA設(shè)計計算機應(yīng)用

          • 對傳統(tǒng)電子系統(tǒng)設(shè)計方法與現(xiàn)代電子系統(tǒng)設(shè)計方法進行了比較,引出了基于EDA技術(shù)的現(xiàn)場可編程門陣列(FPGA)電路,提出現(xiàn)場可編程門陣列(FPGA) 是近年來迅速發(fā)展的大規(guī)模可編程專用集成電路(ASIC),在數(shù)字系統(tǒng)設(shè)計和控制電路
          • 關(guān)鍵字: FPGA  EDA  計算機應(yīng)用    

          利用矢量旋轉(zhuǎn)求解平方根的算法及其FPGA實現(xiàn)*

          • 本文提出了一種基于矢量旋轉(zhuǎn)求三角函數(shù)進而求得任意數(shù)平方根的算法,并用VHDL語言在Altera EP2S60開發(fā)板上加以驗證,本算法相比其他傳統(tǒng)開平方算法具有更高的性能。
          • 關(guān)鍵字: VHDL  FPGA  三角函數(shù)  開平方  矢量旋轉(zhuǎn)  EDA  200908  

          基于EDA軟件和FPGA的IP核保護技術(shù)

          • 隨著電路復(fù)雜性的增加,越來越多的設(shè)計者開始采用擁有知識產(chǎn)權(quán)的、設(shè)計良好的功能模塊來加快系統(tǒng)開發(fā)。因此,需要相應(yīng)的技術(shù)手段保護這些功能模塊不被非法復(fù)制、篡改或竊取。針對FPGA開發(fā)中的知識產(chǎn)權(quán)保護問題,提出一種結(jié)合EDA軟件和FPGA的IP(Intellectual Proterty)核保護方法,有效的防止IP核被竊取,以及防止最終在FPGA上實現(xiàn)設(shè)計的非法復(fù)制。
          • 關(guān)鍵字: FPGA  EDA  軟件  IP核    

          EDA第一季度同比下滑幅度縮小 或提前回暖

          •   據(jù)EDA Consortium(EDAC)的統(tǒng)計,第一季度全球EDA收入下滑至11.9億美元,同比減少10.7%。   同步大幅下滑的主要原因是Cadence調(diào)整了其會計模式。   與去年第四季度的13.2億美元相比,第一季度EDA收入降9.9%。EDAC主席、Mentor Graphics公司主席兼CEO Walden Rhines表示,EDA每年第一季度的收入都會環(huán)比下滑。   Rhines指出,10.7%的同比下滑幅度較去年第四季度的18%有所減小,這可能說明EDA先于芯片產(chǎn)業(yè)開始回暖。
          • 關(guān)鍵字: Mentor  EDA  芯片  

          基于EDA技術(shù)的數(shù)字頻率計的設(shè)計

          • 摘 要:選用Altera公司的可編程邏輯器件EPF10K10LC84-4作為硬件電路。依據(jù)EDA技術(shù)的設(shè)計思想,運用VHDL硬件描述語言和Max+PlusⅡ軟件,針對數(shù)字頻率計的工作原理,對其各個部分進行編程。該設(shè)計結(jié)構(gòu)清晰,避免了用原
          • 關(guān)鍵字: EDA  數(shù)字頻率計    
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          eda 介紹

            一、什么是EDA   EDA是電子設(shè)計自動化(Electronic Design Automation)的縮寫,在20世紀90年代初從計算機輔助設(shè)計(CAD)、計算機輔助制造(CAM)、計算機輔助測試(CAT)和計算機輔助工程(CAE)的概念發(fā)展而來的。   20世紀90年代,國際上電子和計算機技術(shù)較先進的國家,一直在積極探索新的電子電路設(shè)計方法,并在設(shè)計方法、工具等方面進行了徹底的變革, [ 查看詳細 ]

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