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基于FPGA腦機(jī)接口設(shè)計(jì)
- 腦機(jī)接口BCI（Brain Computer Interface）是一種新穎的人機(jī)接口方式。它的定義是：不依賴于腦的正常輸出通路（外周神經(jīng)系統(tǒng)及肌肉組織）的腦-機(jī)（計(jì)算機(jī)或其他裝置）通訊系統(tǒng)。要實(shí)現(xiàn)腦機(jī)接口，必須有一種能反映人腦不同狀態(tài)的信號(hào)，并且能夠?qū)崟r(shí)或短時(shí)對(duì)這種信號(hào)進(jìn)行提取和分類。
- 關(guān)鍵字： 腦機(jī) 接口設(shè)計(jì) FPGA
北京公交GPS車輛監(jiān)控系統(tǒng)研究
- 介紹了北京市公共交通總公司智能化調(diào)度指揮系統(tǒng)中的GPS車輛監(jiān)控系統(tǒng)的組成及其所采用的一些關(guān)鍵技術(shù):DGPS、組合定位、集群通信、電子地圖等,描述了系統(tǒng)中采用的具體工作方式:TDMA、專用信道、廣播同步等,闡述了硬件設(shè)計(jì)及實(shí)現(xiàn)中的FPGA技術(shù)。最后說明了系統(tǒng)的應(yīng)用環(huán)境。
- 關(guān)鍵字： 車輛監(jiān)控系統(tǒng) GPS FPGA
Xilinx一級(jí)代理：賽靈思半導(dǎo)體的優(yōu)勢(shì)
- Xilinx(賽靈思)是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP核。客戶使用Xilinx及其合作伙伴的自動(dòng)化軟件工具和IP核對(duì)器件進(jìn)行編程，從而完成特定Xilinx(賽靈思)是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。 Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP核?？蛻羰褂肵ilinx及其合作伙伴的自動(dòng)化軟件工具和IP核對(duì)器件進(jìn)行編程，從而完成特定的邏輯
- 關(guān)鍵字： Xilinx FPGA
ARM將推新一代mbed OS 5.5,加速物聯(lián)網(wǎng)產(chǎn)品開發(fā)
- 以ARM的Cortex-M作為核心，不少物聯(lián)網(wǎng)開發(fā)者都會(huì)將其作為首選進(jìn)行產(chǎn)品開發(fā)，ARM也因應(yīng)此推出mbed平臺(tái)服務(wù)，包含系統(tǒng)底層的mbedOS以及云端平臺(tái)mbedCloud，協(xié)助開發(fā)者加速軟硬整合進(jìn)行開發(fā)。ARM在此次Computex展會(huì)期間，也順勢(shì)向媒體公開新一代mbedOS5.5即將上線，除了針對(duì)前代產(chǎn)品進(jìn)行改善之外，也增加了部分新功能。 ARM預(yù)計(jì)將在6月16日發(fā)布最新的mbedOS5.5版本，將會(huì)針對(duì)前一代版本進(jìn)行改善并加入新功能。 雖然ARM并非第一個(gè)推出物聯(lián)網(wǎng)平臺(tái)或OS的廠商
- 關(guān)鍵字： ARM 物聯(lián)網(wǎng)
一種基于FPGA的可重構(gòu)密碼芯片的設(shè)計(jì)與實(shí)現(xiàn)
- 目前，國內(nèi)外廣泛使用的密碼處理芯片大都是實(shí)現(xiàn)某種特定密碼算法的專用芯片，如MD5芯片、SHA-1芯片等。由于專用密碼芯片實(shí)現(xiàn)的密碼算法是確定的且不可更改的，因此難以滿足不同密碼用戶多層次的安全性需要。為克服這一缺陷，本文設(shè)計(jì)一種新型的密碼處理芯片——可重構(gòu)密碼芯片。
- 關(guān)鍵字： SHA-1 SHA-224 SHA-256 可重構(gòu)密碼芯片 FPGA
利用FPGA IP平臺(tái)引進(jìn)微控制器系統(tǒng)級(jí)芯片
- 工業(yè)設(shè)計(jì)人員所面對(duì)的上市時(shí)間壓力從未如此巨大。不論是設(shè)計(jì)網(wǎng)絡(luò)接口、電機(jī)控制器、邏輯控制器、通信系統(tǒng)、或任何數(shù)以百計(jì)的工業(yè)應(yīng)用，F(xiàn)PGA結(jié)合種類繁多的可用IP正成為工業(yè)設(shè)計(jì)的優(yōu)選方案。就上市時(shí)間、執(zhí)行的靈活性及未來的產(chǎn)品廢棄過時(shí)等因素而言，F(xiàn)PGA較ASSP和ASIC解決方案具有更多優(yōu)勢(shì)。
基于FPGA的8051微控制器接口實(shí)現(xiàn)
- 本設(shè)計(jì)充分利用了Vertex器件的LUTs(Look-Up Tables)替代觸發(fā)器和基本門電路搭建乘法器和加法器這兩個(gè)顯著的結(jié)構(gòu)特點(diǎn)，節(jié)省了大量的觸發(fā)器資源，增加了器件利用率、布通率，DLL的運(yùn)用降低了布線延遲，實(shí)現(xiàn)了通信的完全同步。筆者采用Xilinx公司的FPGA芯片自行設(shè)計(jì)了8051IP核與外圍設(shè)備的接口，完成了8051與外圍設(shè)備之間的通信功能，并且源代碼中的參數(shù)可調(diào)，可作為IP軟核提供給8051開發(fā)用戶。
- 關(guān)鍵字： 微控制器 8051 FPGA 接口實(shí)現(xiàn)
如何采用SystemVerilog來改善基于FPGA的ASIC原型
- ASIC在解決高性能復(fù)雜設(shè)計(jì)概念方面提供了一種解決方案,但是ASIC也是高投資風(fēng)險(xiǎn)的,如90nm ASIC/SoC設(shè)計(jì)大約需要2000萬美元開發(fā)成本.為了降低成本,現(xiàn)在可采用FPGA來實(shí)現(xiàn)ASIC.但是,但ASIC集成度較大時(shí),需要幾個(gè)FPGA來實(shí)現(xiàn),這就需要考慮如何來連接ASIC設(shè)計(jì)中所有的邏輯區(qū)塊.采用SystemVerilog,可以簡化這一問題.
- 關(guān)鍵字： SystemVerilog ASIC FPGA
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