摘要 基于FPGA、PCI9054、SDRAM和DDS設計了用于某遙測信號模擬源的專用板卡。PCI9054實現(xiàn)與上位機的數(shù)據(jù)交互,F(xiàn)PGA實現(xiàn)PCI本地接口轉(zhuǎn)換、數(shù)據(jù)接收發(fā)送控制及DDS芯片的配置。通過WDM驅(qū)動程序設計及MFC交互界面設計,最
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數(shù)據(jù)通信 設計 高速 LVDS FPGA
FPGA的高速多通道數(shù)據(jù)采集控制器IP核設計,隨著可編程邏輯器件的不斷進步和發(fā)展,F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測系統(tǒng)中信號采集模塊控制器的 IP核,是采用硬件描述語言來實現(xiàn)的。首先它是以ADS8364芯片為控制對象,結(jié)合
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IP 設計 控制器 數(shù)據(jù)采集 高速 通道 FPGA
采用FPGA解決通信接口問題,引言 在過去兩年里,用于消除IC、電路板和系統(tǒng)之間數(shù)據(jù)傳輸瓶頸的接口標準層出不窮,本文將考評通信應用標準部件的某些最流行的標準,并研究眾多新標準出現(xiàn)的原因,此外還探討設計者可如何解決互用性的難題。 新興
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接口 問題 通信 解決 FPGA 采用
基于FPGA的中文字符顯示的VHDL程序,--文件名:lcd_driver.vhd?! ?-功能:FGAD驅(qū)動LCD顯示中文字符“年”?! ?-最后修改日期:2004.3.24?! ibrary IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL; use
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VHDL 程序 顯示 字符 FPGA 中文 基于
用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程,用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程為: 1.文本編輯:用任何文本編輯器都可以進行,也可以用專用的HDL編輯環(huán)境。通常VHDL文件保存為.vhd文件,Verilog文件保存為.v文件 2.功能仿真:將文件調(diào)入HDL仿真
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完整 流程 PLD/FPGA 開發(fā) 語言 VHDL/VerilogHD
基于FPGA的LED電視動態(tài)背光系統(tǒng)設計,本文設計一款基于FPGA(現(xiàn)場可編程門陣列)的液晶電視動態(tài)背光系統(tǒng),采用LED側(cè)背光方式,符合當前液晶電視LED背光應用主流?! ‰娨晞討B(tài)背光 以往的電視機主板將圖像信號通過LVDS(LowVoltageDifferentialSignal,低
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背光 系統(tǒng) 設計 動態(tài) 電視 FPGA LED 基于
基于FPGA的IPV6數(shù)字包的分離與封裝的實現(xiàn),筆者在參加國家“863”重大專題項目“高速密碼芯片及驗證平臺系統(tǒng)”的過程中,遇到了將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分拆開,然后在數(shù)據(jù)部分送密碼芯片進行加/解密處理,最后再將處理后的數(shù)據(jù)部分與
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封裝 實現(xiàn) 分離 數(shù)字 FPGA IPV6 基于
摘要:為了有效地節(jié)省語音數(shù)據(jù)的傳輸帶寬和存儲系統(tǒng)的磁盤空間,需要在保證語音質(zhì)量的前提下盡可能降低其編碼比特率。本設計采用經(jīng)過優(yōu)化的G.729語音壓縮編譯碼算法,以ARM處理器為載體,開發(fā)的嵌入式語音存儲系統(tǒng)可
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系統(tǒng) 設計 存儲 語音 ARM 嵌入式 基于
摘要:隨著嵌入式WinCE系統(tǒng)的發(fā)展和近距離無線通信的廣泛使用,有必要為近距離無線通信芯片編寫驅(qū)動。由于nRF24L01在WinCE系統(tǒng)下驅(qū)動的缺乏,使得WinCE與nRF24L01芯片之間的直接通信成為困難。本文的驅(qū)動設計正好解決
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設計 驅(qū)動 nRF24L01 WinCE6 ARM
海思半導體(HiSilicon)和ARM聯(lián)合宣布,海思半導體已獲得一系列ARM Mali? 圖形處理器(GPU)授權,包括市場領先的Mali-400 MP GPU和最新的高性能Mali-T658 GPU。通過這些新的授權,海思半導體能夠為移動、消費和家庭設備生產(chǎn)廠商提供更多的圖形處理器性能選擇。在此之前,海思半導體已經(jīng)取得了最新的ARM CortexTM處理器技術的授權,用于下一代設備。
這些新的授權將為海思半導體帶來杰出的圖形處理性能,其支持的范圍可從目前使用于領先移動和消費設備中的一流圖形處
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ARM 圖形處理器
FPGA在經(jīng)過了從上世紀90年代到2000年的快速發(fā)展、隨后短期的泡沫破裂、以及近幾年的平穩(wěn)增長的發(fā)展階段,未來會邁入硅片融合時代。
Altera公司資深副總裁兼首席技術官Misha Burich
下面這張圖能夠很直觀的表示FPGA的演進過程,結(jié)構(gòu)越來越復雜,功能越來越強大,應用越來越廣泛。
F
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Altera FPGA 硅片融合
摘要:本設計采用XILINX Spartan-3E系列FPGA芯片,在基于FPGA(現(xiàn)場可編程門陣列)器件的設計中,狀態(tài)機是目前應用最普遍的設計方法之一。
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FPGA XILINX 201205
摘要 提出一種實時數(shù)字化光纖傳輸系統(tǒng),該系統(tǒng)分為發(fā)送端和接收端。發(fā)送端用A/D轉(zhuǎn)換器將輸入的模擬信號數(shù)字化,再用FPGA對數(shù)據(jù)進行處理,并通過光纖傳輸。同時,F(xiàn)PGA還控制A/D轉(zhuǎn)換器的工作。接收端用串行收發(fā)器TLK
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FPGA 實時數(shù)字 光纖傳輸 系統(tǒng)
摘要:提出了基于數(shù)字信號處理器(DSP)和現(xiàn)場可編程門陣列(FPGA)的開關磁阻電動機全數(shù)字控制系統(tǒng),對DSP和FPGA的功能進行了分配。根據(jù)開關磁阻電動機的驅(qū)動要求,分析控制邏輯,由FPGA實現(xiàn)了電流斬波、角度位置和PWM電
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FPGA 開關磁阻電機 全數(shù)字 控制系統(tǒng)
摘要:設計了一款嵌入FPGA的乘法器,該乘法器能夠滿足兩個18 b有符號或17 b無符號數(shù)的乘法運算。該設計基于改進的布斯算法,提出了一種新的布斯譯碼和部分積結(jié)構(gòu),并對9-2壓縮樹和超前進位加法器進行了優(yōu)化。該乘法器
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FPGA 算法 嵌入式 乘法器
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