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UWB - 智能物聯(lián)的未來之星，你怎么看他？低功耗Wi-Fi解決方案在智能家居的應(yīng)用和發(fā)展結(jié)合超寬帶測距和雷達(dá)功能以實(shí)現(xiàn)高級IoT應(yīng)用來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>>

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fpga+arm 文章進(jìn)入fpga+arm技術(shù)社區(qū)

ARM超級手機(jī)2012年問世

　　4月22日消息，據(jù)國外媒體報道，ARM移動解決方案工程師詹姆斯布魯斯(JamesB ruce)表示，Cortex A15多核心處理器運(yùn)算速度大約是當(dāng)前A9設(shè)計架構(gòu)(例如：Nvidia Tegra2)的兩倍，預(yù)計2012年能夠問世。屆時消費(fèi)者將可以60-150美元的未綁約價格買到內(nèi)置A5(Sparrow)架構(gòu)處理器(單核，500兆赫)的入門級智能手機(jī)。布魯斯預(yù)計明年中檔智能機(jī)(采用Cortex A9處理器)未綁約售價約200-400美元。　
關(guān)鍵字： ARM A15多核芯片

各品牌ARM SoC技術(shù)比較分析

各品牌ARM SoC技術(shù)比較分析,本文將介紹三個常見的ARM SoC，包含ARM7和ARM9，并試著分析與比較它們的性能?！　RM7族群　　低耗電量和低成本是ARM7的優(yōu)點(diǎn)。不過，ARM7的最大執(zhí)行速率不到100 MHz，因此，在應(yīng)用上，它和8051之類的微控制器(MCU)類
關(guān)鍵字：比較分析技術(shù) SoC ARM 品牌

基于ARM 926EJ-S微控制器的網(wǎng)絡(luò)廣播設(shè)計

基于ARM 926EJ-S微控制器的網(wǎng)絡(luò)廣播設(shè)計,本文提出了一種基于ARM和PoE的嵌入式系統(tǒng)的網(wǎng)絡(luò)廣播設(shè)計方案。該方案以ARM926EJ-S處理器及其外圍模塊作為硬件平臺，以嵌入式Linux作為操作系統(tǒng)，構(gòu)成整個系統(tǒng)。該系統(tǒng)應(yīng)用以太網(wǎng)供電，實(shí)現(xiàn)網(wǎng)絡(luò)廣播的功能，不必進(jìn)行專
關(guān)鍵字：網(wǎng)絡(luò)廣播設(shè)計控制器 926EJ-S ARM 基于

基于Xilinx FPGA的片上系統(tǒng)無線保密通信終端設(shè)計

0引言利用軟件實(shí)施加密算法已經(jīng)成為實(shí)時安全通信系統(tǒng)的重要瓶頸。標(biāo)準(zhǔn)的商品化CPU和DSP無法跟上數(shù)據(jù)...
關(guān)鍵字： FPGA 片上系統(tǒng) 無線保密通信終端

基于FPGA+DSP的高速中頻采樣信號處理平臺的實(shí)現(xiàn)

基于FPGA+DSP的高速中頻采樣信號處理平臺的實(shí)現(xiàn),摘要：高速中頻采樣信號處理平臺在實(shí)際應(yīng)用中有很大的前景，提出采用FPGA+DSP的處理結(jié)構(gòu)，結(jié)合高性能A／D和D／A處理芯片，設(shè)計了一個通用處理平臺，并對其主要性能進(jìn)行了測試。實(shí)驗(yàn)與實(shí)際應(yīng)用表明，該系統(tǒng)具有很強(qiáng)的
關(guān)鍵字：信號處理平臺實(shí)現(xiàn) 采樣中頻 FPGA DSP 高速基于

FPGA在數(shù)字式心率計中的電路組成及工作原理

本心率計在數(shù)字式心率計的基礎(chǔ)上，采用FPGA和VHDL語言實(shí)現(xiàn)，減少了元器件使用數(shù)量，提高了測量精度和可靠性。該電路能夠?qū)崟r采集并測量人體心跳的瞬時和平均心跳速率，判斷并顯示心率狀態(tài)（即心跳是否正常、是否過快或過慢、是否有心率不齊現(xiàn)象）。如果心率過快或過慢或者有心率不齊現(xiàn)象，那么將用不同顏色發(fā)光管進(jìn)行閃爍報警顯示。
關(guān)鍵字： FPGA 數(shù)字式電路工作原理

基于POWER PC+FPGA架構(gòu)的飛行試驗(yàn)振動數(shù)據(jù)實(shí)時分析

摘要：飛行試驗(yàn)振動信號具有采樣率高、數(shù)據(jù)量大、處理復(fù)雜的特點(diǎn)，在現(xiàn)有條件下，通過遙測鏈路很難將大量的振動數(shù)據(jù)實(shí)時傳輸至地面監(jiān)控系統(tǒng)。針對試飛測試的需要，結(jié)合某型號的試飛關(guān)鍵技術(shù)攻關(guān)研究，突破試飛振動數(shù)
關(guān)鍵字： POWER FPGA PC 架構(gòu)

基于Cyclone III FPGA的DDR2接口設(shè)計分析

DDR SDRAM是Double Data Rate SDRAM的縮寫，即雙倍速率同步動態(tài)隨機(jī)存儲器。DDR內(nèi)存是在SDRAM內(nèi)存基礎(chǔ)上發(fā)展而來的，能夠在時鐘的上升沿和下降沿各傳輸一次數(shù)據(jù)，可以在與SDRAM相同的總線時鐘頻率下達(dá)到更高的數(shù)據(jù)傳輸率。雖然DDR2和DDR一樣,都采用相同采樣方式進(jìn)行數(shù)據(jù)傳輸，但DDR2擁有兩倍于DDR的預(yù)讀取系統(tǒng)命令數(shù)據(jù)的能力。
關(guān)鍵字： Cyclone FPGA DDR2 III

高性能FPGA中的高速SERDES接口

引言　串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)的帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES （串化器/ 解串器）所取代。起初， SERDES是獨(dú)立的ASSP或ASIC器
關(guān)鍵字： SERDES FPGA 性能接口

基于Xilinx FPGA的片上系統(tǒng)無線保密通信終端

本設(shè)計使用硬件描述語言VHDL在FPGA數(shù)字邏輯層面上實(shí)現(xiàn)AES加解密，為了系統(tǒng)的擴(kuò)展性和構(gòu)建良好的人機(jī)交互，設(shè)計通過PS/2鍵盤輸入加密密鑰，并將其顯示在LCD上。在軟核MicroBlaze上，通過SPI總線讀寫FIFO和RAM控制射頻芯片CC2420，使系統(tǒng)具有信道選擇、地址識別、自動CRC校驗(yàn)功能，使系統(tǒng)更加安全、通信誤碼率更低。
關(guān)鍵字：保密通信終端無線系統(tǒng) Xilinx FPGA 基于

基于FPGA數(shù)據(jù)流控制動態(tài)可重構(gòu)的實(shí)現(xiàn)

摘要基于FPGA基本數(shù)據(jù)流的下載控制方式，利用遺傳算法，通過單片機(jī)控制數(shù)據(jù)流的方式對FPGA進(jìn)行編程配置，實(shí)現(xiàn)自身重構(gòu)，使系統(tǒng)具有自適應(yīng)、自組織和自修復(fù)的特性。
關(guān)鍵詞 FPGA；遺傳算法；動態(tài)重構(gòu)；單片機(jī)
關(guān)鍵字： FPGA 數(shù)據(jù)流動態(tài)可重構(gòu)

異步FIFO在FPGA與DSP通信中的運(yùn)用

摘要利用異步FIFO實(shí)現(xiàn)FPGA與DSP進(jìn)行數(shù)據(jù)通信的方案。FPGA在寫時鐘的控制下將數(shù)據(jù)寫入FIFO，再與DSP進(jìn)行握手后，DSP通過EMIFA接口將數(shù)據(jù)讀入。文中給出了異步FIFO的實(shí)現(xiàn)代碼和FPGA與DSP的硬件連接電路。經(jīng)驗(yàn)證，利用
關(guān)鍵字：通信運(yùn)用 DSP FPGA FIFO 異步

基于FIash和JTAG接口的FPGA多配置系統(tǒng)

摘要：針對需要切換FPGA器件的配置以實(shí)現(xiàn)不同功能的特殊應(yīng)用場合，提出了一種使用大容量的Flash存儲器作配置碼流載體的FPGA多配置系統(tǒng)。該系統(tǒng)采用傳輸速度快的JTAG接口提高了配置碼流的燒寫速度，采用并行從模式減少
關(guān)鍵字： FIash JTAG FPGA 接口

基于FPGA的CAN總線控制器SJA1000軟核的設(shè)計

基于FPGA的CAN總線控制器SJA1000軟核的設(shè)計
湯書森，劉棟，李建明
(蘭州大學(xué)信息科學(xué)與工程學(xué)院，蘭州 730000)
摘要：分析了CAN控制器SJA1000的特點(diǎn)及CAN協(xié)議通信格式。設(shè)計了控制器SJA1000的IP軟核，能為應(yīng)用提
關(guān)鍵字： SJA1000 軟核設(shè)計控制器總線 FPGA CAN

基于USB和FPGA的隨機(jī)數(shù)發(fā)生器驗(yàn)證平臺

摘要：為了方便基于FPGA實(shí)現(xiàn)的隨機(jī)數(shù)發(fā)生器的驗(yàn)證與演示，以CycloneII FPGA芯片EP2C20Q240C8N為核心，設(shè)計實(shí)現(xiàn)了隨機(jī)數(shù)發(fā)生器IP核下載與測試的開發(fā)驗(yàn)證平臺，并詳細(xì)闡述了各模塊的設(shè)計原理及關(guān)鍵技術(shù)。最后，通過下載
關(guān)鍵字： FPGA USB 隨機(jī)數(shù)發(fā)生器

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fpga+arm介紹

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fpga+arm電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計的方法
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實(shí)現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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基于UDP協(xié)議和FPGA的點(diǎn)到點(diǎn)數(shù)據(jù)傳輸方案

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