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          高性能數(shù)字接收機FPGA設(shè)計

          • 摘要:基于Xilinx FPGA設(shè)計出一種高性能數(shù)字接收機。該數(shù)字接收機由高速、高分辨率A/D和高性能FPGA構(gòu)成。高速A/D實現(xiàn)中頻數(shù)字化,高性能FPGA實現(xiàn)數(shù)字下變頻、數(shù)字多相濾波、半帶抽取、匹配濾波和位同步功能,使得中頻載波為153.6MHz的TD-SCDMA信號,下變頻-抽取-濾波-位同步后得到高質(zhì)量的采樣率為1.28MHz的基帶信號。
          • 關(guān)鍵字: FPGA  載波  A/D  201305  

          DSP 在電源設(shè)計中的應(yīng)用

          • DSP 在電源設(shè)計中的應(yīng)用,采用分立元件或CPLD、FPGA 進行電源的信號發(fā)生和測量的設(shè)計,會增加硬件設(shè)計復(fù)雜程度,延長開發(fā)周期。為了簡化電源信號發(fā)生及測量的硬件設(shè)計,縮短開發(fā)周期,本文提出一種基于DSP 的嵌入式操作平臺,采用DDS( 直接數(shù)字式頻率合成器) 及乘法器矢量測量技術(shù)的設(shè)計方案。該方案利用DSP 的高速運算能力,通過實時計算來實現(xiàn)分立元件或CPLD、FPGA 的硬件邏輯功能。實驗結(jié)果表明該方案切實可行。
          • 關(guān)鍵字: 電源  頻率  DSP  

          FPGA雙雄策略變 圈地為王發(fā)揮能量

          •   在FGPA戰(zhàn)場上,眾所皆知的頭號兩大對手就是Altera與Xilinx。一般認為這兩對手會在同一個戰(zhàn)場上爭個你死我活,然而經(jīng)過多年的鏖戰(zhàn),兩廠商已經(jīng)從過去積極的正面廝殺對決,改而轉(zhuǎn)向較為保守的畫地為王,以既有優(yōu)勢為基礎(chǔ),固守疆域,進而轉(zhuǎn)化為更大的研發(fā)能量。    ?   據(jù)了解,Xilinx在既有的28奈米FPGA市場已經(jīng)打下穩(wěn)定基礎(chǔ),而目前xilinx也不側(cè)重在更先進製程上與對手爭個你死我活,反倒是穩(wěn)扎穩(wěn)打固守疆土,選擇將FPGA的可程式化優(yōu)勢發(fā)揮到極致。Xilinx認為,可程式
          • 關(guān)鍵字: Altera  FPGA  

          基于萊迪思FPGA的視頻顯示接口的實現(xiàn)

          • 視頻顯示器市場分為:大批量應(yīng)用,如臺式機、筆記本顯示器和電視機面板;中等批量應(yīng)用,如小型人機接口(HMI)面板和大尺寸數(shù)字標(biāo)牌。本文將探討的是大尺寸顯示器面板應(yīng)用(表1),其中FPGA是一個備受關(guān)注的選擇,它可以滿
          • 關(guān)鍵字: FPGA  視頻顯示  接口    

          FPGA核心知識詳解(3):那些讓FPGA初學(xué)者糾結(jié)的仿真

          • 對于FPGA初學(xué)者而言,如何正確了解并理解FPGA的仿真是關(guān)鍵。應(yīng)廣大FPGA初學(xué)者和愛好者要求,電子發(fā)燒友網(wǎng)編輯根 ...
          • 關(guān)鍵字: FPGA  核心知識  仿真  

          CEVA推出AMF- Android多媒體框架

          • 全球領(lǐng)先的硅產(chǎn)品知識產(chǎn)權(quán)(SIP)平臺解決方案和數(shù)字信號處理器(DSP)內(nèi)核授權(quán)廠商CEVA公司針對基于Android系統(tǒng)推出全新低能耗軟件框架,它使用異構(gòu)CPU和DSP系統(tǒng)架構(gòu),能夠有效地降低復(fù)雜多媒體應(yīng)用所需的功耗。這款框架稱作Android Multimedia Framework (AMF?),面向包括音頻、語音、成像和視覺的最密集的實時信號處理應(yīng)用。
          • 關(guān)鍵字: CEVA  DSP  Android  

          基于FPGA協(xié)處理器的算法加速的實現(xiàn)

          • 當(dāng)今的設(shè)計工程師受到面積、功率和成本的約束,不能采用GHz級的計算機實現(xiàn)嵌入式設(shè)計。在嵌入式系統(tǒng)中,通常是由相對數(shù)量較少的算法決定最大的運算需求。使用設(shè)計自動化工具可以將這些算法快速轉(zhuǎn)換到硬件協(xié)處理器中。
          • 關(guān)鍵字: FPGA  協(xié)處理器  算法    

          淺析FPGA設(shè)計流程及布線資源

          • 1、電路設(shè)計與輸入  電路設(shè)計與輸入是指通過某些規(guī)范的描述方式,將工程師電路構(gòu)思輸入給EDA工具。常用的 ...
          • 關(guān)鍵字: FPGA  設(shè)計流程  布線資源  

          FPGA硬件電路的調(diào)試必備原則和技巧

          • 在調(diào)試FPGA電路時要遵循必須的原則和技巧,才能降低調(diào)試時間,防止誤操作損壞電路。通常情況下,參考以下步驟執(zhí)行 ...
          • 關(guān)鍵字: FPGA  硬件電路  調(diào)試必備  

          基于FPGA的自動門控制設(shè)計

          • 引 言門和人類文明是孿生的,它伴隨著人類文明的發(fā)展而躍動。21 世紀的今天,門更加突出了安全理念,強調(diào)了有效性:有效地防范、通行、疏散,同時還突出了建筑藝術(shù)的理念,強調(diào)門與建筑以及周圍環(huán)境整體的協(xié)調(diào)、和諧
          • 關(guān)鍵字: FPGA  自動門  控制設(shè)計    

          基于FPGA的ARM圖像縮放器的實現(xiàn)

          • ARM是目前全球最大的嵌入式芯片技術(shù)的IP提供商,其所擁有的IP已經(jīng)成為眾多芯片設(shè)計公司采納的一種技術(shù)標(biāo)準(zhǔn)和開發(fā)平臺。所以基于ARM 內(nèi)核的SoC已經(jīng)成為嵌入式處理器的開發(fā)重點,可通過ARM實現(xiàn)LCD控制器來完成對嵌入式
          • 關(guān)鍵字: FPGA  ARM  圖像    

          聯(lián)芯科技獲CEVA DSP技術(shù)授權(quán)許可用于移動芯片

          • 全球領(lǐng)先的硅產(chǎn)品知識產(chǎn)權(quán)(SIP)平臺解決方案和數(shù)字信號處理器(DSP)內(nèi)核授權(quán)廠商CEVA公司宣布大唐電信科技產(chǎn)業(yè)集團(Datang Telecom Technology and Industry Group)的核心企業(yè)之一聯(lián)芯科技有限公司(Leadcore Technology Co., Ltd.)已經(jīng)獲得CEVA公司DSP技術(shù)和平臺授權(quán)許可,用于其下一代移動芯片。
          • 關(guān)鍵字: 聯(lián)芯  DSP  CEVA  

          FPGA平臺的VGA圖像顯示的設(shè)計與實現(xiàn)

          • 摘要:根據(jù)VGA(Video Graphic Array)的原理,采用VHDL硬件描述語言,設(shè)計了一種基于Zedboard FPGA板卡的圖像顯示方案。實驗結(jié)果表明,在FPGA實現(xiàn)圖片顯示,達到了預(yù)期的效果,依據(jù)該原理,可以實現(xiàn)圖像的采集及在VGA顯示屏上顯示的實現(xiàn)。
          • 關(guān)鍵字: VGA  FPGA  圖片顯示  201304  

          基于DSP的嵌入式智能相機的研究

          • 智能相機是一種小型的視覺檢測系統(tǒng),主要運用于工況監(jiān)視,產(chǎn)品檢驗和質(zhì)量監(jiān)控等領(lǐng)域,能夠提高生產(chǎn)制造的柔性和自動化程度。與傳統(tǒng)的PC式視覺系統(tǒng)相比,它具有易學(xué)、易用、易維護、易安裝等特點。在此主要是提出了一種嵌入式智能相機的設(shè)計方案,它是以ADSP-BF537為系統(tǒng)控制核心,以CMOS傳感器為圖像采集裝置,結(jié)合Oscar軟件框架和OpenCV進行軟件設(shè)計。最后通過一個檢測條形碼的應(yīng)用來說明研究出來的智能相機的可行性,并且通過實驗數(shù)據(jù)來說明智能相機運行速度和工作效率。
          • 關(guān)鍵字: 相機  研究  智能  嵌入式  DSP  基于  

          基于FPGA的IRIG-B標(biāo)準(zhǔn)DC code編碼器VHDL設(shè)計

          • 為了實現(xiàn)靶場時統(tǒng)終端輸出IRIG-B標(biāo)準(zhǔn)DC code信號,采用VHDL語言在FPGA邏輯電路中設(shè)計了DC code編碼器硬件電路,通過QuartusⅡ軟件建立工程文件對VHDL語言DC code編碼器電路進行編譯和仿真,獲得了符合IRIG-B標(biāo)準(zhǔn)的DC code信號。經(jīng)過實踐驗證,該電路具有實現(xiàn)方法簡單、電路穩(wěn)定性好、精度高的特點,實測同步精度小于1μs。
          • 關(guān)鍵字: IRIG-B  FPGA  code  VHDL    
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