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Altera發(fā)售業(yè)界首款65nm低成本FPGA
- 日前，Alter宣布，利用TSMC 65nm低功耗工藝的低成本FPGA Cyclone III系列開始發(fā)售。根據(jù)Altera廣播、汽車電子及消費(fèi)電子業(yè)務(wù)部副總裁Tim Colleran的介紹，利用TSMC的工藝，Cyclone III FPGA提供豐富的邏輯、存儲器和DSP方案功能功耗更低。結(jié)合Quartus II開發(fā)軟件7.0，Cyclone III系列在嚴(yán)格的成本和功耗預(yù)算下，以高性能滿足應(yīng)用需求。 Altera資深營銷副總裁Jordan Plofsky認(rèn)為，這一系列產(chǎn)品與其他競爭對手的方案
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Altera中國大學(xué)生電子設(shè)計文章競賽2007
- Altera? 公司一直致力于通過大學(xué)合作項(xiàng)目的實(shí)施來幫助中國培養(yǎng)優(yōu)秀電子設(shè)計人才，并推動可編程技術(shù)產(chǎn)品和應(yīng)用的研究。Altera中國大學(xué)計劃更是公司的一項(xiàng)長期戰(zhàn)略計劃。Altera大學(xué)計劃為全球范圍內(nèi)的大專院校提供先進(jìn)、容易學(xué)習(xí)并容易使用的開發(fā)軟件、可編程邏輯器件、開發(fā)工具以及完整的設(shè)計套件。我們希望提高學(xué)生們在電子設(shè)計領(lǐng)域方面的知識和能力，幫助他們畢業(yè)后在工作崗位上能夠發(fā)揮所長，實(shí)現(xiàn)Altera幫助中國提升電子設(shè)計水平的承諾。 首屆中國大學(xué)生電子設(shè)計文章競賽在2006年成功舉辦，推動了中國
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PCI Express——高速串行互聯(lián)接口標(biāo)準(zhǔn)
- 摘要：?本文介紹了PCI Express以及用FPGA實(shí)現(xiàn)PCI Express接口的優(yōu)勢。關(guān)鍵詞：?PCI Express；FPGA PCI Express是從PCI發(fā)展而來的一種系統(tǒng)互聯(lián)接口標(biāo)準(zhǔn)。PCI和PCI-X都是基于32位以及64位的并行總線，而PCI Express則使用高速串行總線。PCI Express后向兼容于PCI，能夠靈活地提供大峰值帶寬。表1對比了三種PCI標(biāo)準(zhǔn)的特性。 表1 PCI標(biāo)準(zhǔn)對比一對同時工作的發(fā)送和接收通道被稱為一個通路。發(fā)送和接收通道使用低
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Altera Stratix II FPGA達(dá)到軍用溫度級標(biāo)準(zhǔn)
- Altera公司宣布，其90nm高性能Stratix®II FPGA器件系列所有封裝型號均達(dá)到軍用溫度級標(biāo)準(zhǔn)。 Altera的Stratix和Stratix®II器件能夠可靠地工作在商用、工業(yè)和軍用溫度級范圍內(nèi)，符合嚴(yán)格的規(guī)范標(biāo)準(zhǔn)。公司將工業(yè)級Stratix®II器件的工作范圍擴(kuò)展到-55
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pcb電路抗干擾
- 在電子系統(tǒng)設(shè)計中，為了少走彎路和節(jié)省時間，應(yīng)充分考慮并滿足抗干擾性 的要求，避免在設(shè)計完成后再去進(jìn)行抗干擾的補(bǔ)救措施。形成干擾的基本要素有三個： （1）干擾源，指產(chǎn)生干擾的元件、設(shè)備或信號，用數(shù)學(xué)語言描述如下：du/dt， di/dt大的地方就是干擾源。如：雷電、繼電器、可控硅、電機(jī)、高頻時鐘等都可 能成為干擾源。 （2）傳播路徑，指干擾從干擾源傳播到敏感器件的通路或媒介。典型的干擾傳 播路徑是通過導(dǎo)線的傳導(dǎo)和空間的輻射。 （3）敏感器件，指容易被干擾的對象。如：A/D、D/A變換器，單片機(jī)，數(shù)字IC，
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Cadence的Global Route Environment技術(shù)為PCB設(shè)計制訂新標(biāo)準(zhǔn)
- Cadence設(shè)計系統(tǒng)公司發(fā)布了面向Cadence® Allegro® PCB設(shè)計的Global Route Environment技術(shù)。這一革命性的技術(shù)結(jié)合了圖形化的互連流規(guī)劃架構(gòu)和層次化全局布線引擎，為PCB設(shè)計人員提供了自動、智能的規(guī)劃和布線環(huán)境。作為首個將智能自動化引入前所未有領(lǐng)域的自動布線解決方案，Global Route Environment 技術(shù)代表了一次意義重大的飛躍，并建立了一種全新的PCB設(shè)計規(guī)
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Cadence為PCB設(shè)計制訂新標(biāo)準(zhǔn)Global Route Environment
- Cadence設(shè)計系統(tǒng)公司今日發(fā)布了面向Cadence® Allegro® PCB設(shè)計的Global Route Environment技術(shù)。這一革命性的技術(shù)結(jié)合了圖形化的互連流規(guī)劃架構(gòu)和層次化全局布線引擎，為PCB設(shè)計人員提供了自動、智能的規(guī)劃和布線環(huán)境。作為首個將智能自動化引入前所未有領(lǐng)域的自動布線解決方案，Global Route Environment 技術(shù)代表了一次意義重大的飛躍，并建立了一種全新的PCB設(shè)計規(guī)范。 該技術(shù)問世之前，PCB設(shè)計人員要花費(fèi)幾周或幾個月的時間
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基于FPGA的雷達(dá)脈沖壓縮系統(tǒng)設(shè)計
- 脈沖壓縮技術(shù)是指對雷達(dá)發(fā)射的寬脈沖信號進(jìn)行調(diào)制(如線性調(diào)頻、非線性調(diào)頻、相位編碼)，并在接收端對回波寬脈沖信號進(jìn)行脈沖壓縮處理后得到窄脈沖的實(shí)現(xiàn)過程。脈沖壓縮有效地解決了雷達(dá)作用距離與距離分辨率之間的矛盾，可以在保證雷達(dá)在一定作用距離下提高距離分辨率。 線性調(diào)頻信號的脈沖壓縮 脈沖壓縮的過程是通過對接收信號s(t)與匹配濾波器的脈沖響應(yīng)h(t)求卷積的方法實(shí)現(xiàn)的。而處理數(shù)字信號時，脈壓過程是通過對回波序列s(n)與匹配濾波器的脈沖響應(yīng)序列h(n)求卷積來實(shí)現(xiàn)的。匹配濾波器的輸出為： &nbs
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設(shè)計靈活、高性能的嵌入式系統(tǒng)
- 您的下一個嵌入式系統(tǒng)設(shè)計項(xiàng)目需要的是什么：是可以讓您輕松地定制設(shè)計的靈活的系統(tǒng)元件，還是額外的性能空間，以便您在設(shè)計周期中加入更多的功能？為什么要讓自己承受過度的開發(fā)壓力，并且只能舍此取彼呢？軟處理和IP定制能夠?yàn)橥瑫r確保靈活性和高性能提供了最佳的解決方案，將定制設(shè)計的概念和協(xié)處理帶來的性能加速結(jié)合起來。 分立處理器只能提供固定的外設(shè)選擇，并且一些性能受到時鐘頻率的限制。在嵌入式 FPGA所提供的平臺上，您可以創(chuàng)建一個具有大量定制處理器核、靈活的外設(shè)、甚至協(xié)處理減負(fù)引擎的系統(tǒng)。現(xiàn)在，您能設(shè)計出一個不折
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Altera發(fā)布Quartus II設(shè)計軟件7.0支持Cyclone III FPGA
- Altera公司推出了Quartus® II軟件7.0，其訂購版和免費(fèi)的網(wǎng)絡(luò)版均支持65nm Cyclone® III FPGA全系列產(chǎn)品。網(wǎng)絡(luò)版軟件對Cyclone III器件的支持表明，在所有FPGA供應(yīng)商免費(fèi)軟件包中，該軟件能夠支持密度最大的器件。與前一系列相比，Quartus II軟件的先進(jìn)技術(shù)和效能特性使設(shè)計人員能夠充分挖掘Cyclone III系列的潛能，器件功耗降低了50％，比最相近的低成本FPGA競爭
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基于DSP的高速PCB抗干擾設(shè)計
- 引 言 隨著DSP(數(shù)字信號處理器)的廣泛應(yīng)用，基于DSP的高速信號處理PCB板的設(shè)計顯得尤為重要。在一個DSP系統(tǒng)中，DSP微處理器的工作頻率可高達(dá)數(shù)百M(fèi)Hz，其復(fù)位線、中斷線和控制線、集成電路開關(guān)、高精度A／D轉(zhuǎn)換電路，以及含有微弱模擬信號的電路都非常容易受到干擾；所以設(shè)計開發(fā)一個穩(wěn)定的、可靠的DSP系統(tǒng)，抗干擾設(shè)計非常重要。 干擾即干擾能量使接收器處在不希望的狀態(tài)。干擾的產(chǎn)生分兩種：直接的(通過導(dǎo)體、公共阻抗耦合等)和間接的(通過串?dāng)_或輻射耦合)。很多電器發(fā)射源，如光照、電機(jī)和日光
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Actel和ARM聯(lián)合開發(fā)專為FPGA應(yīng)用而優(yōu)化的高性能32位處理器
- Actel公司進(jìn)一步擴(kuò)展其工業(yè)標(biāo)準(zhǔn)處理器系列，宣布推出ARM Cortex-M1處理器，這是與ARM公司聯(lián)合開發(fā)的小型高性能32位軟件微處理器核，專為在FPGA中的實(shí)施而優(yōu)化。不象許多業(yè)界領(lǐng)先的處理器核通常需要支付授權(quán)費(fèi)用和權(quán)益金，Actel的客戶能夠免費(fèi)獲得先進(jìn)的ARM處理器技術(shù)如Cortex-M1，適用于廣闊的市場領(lǐng)域。 免費(fèi)提供的Cortex-M1可與Actel以Flash為基礎(chǔ)且可運(yùn)行M1核的Actel Fusion FPGA和ProASIC3 FPGA同用，為設(shè)計人員提供編程靈活性和系統(tǒng)級集成，
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Altera Announces Quartus II Design Software Version 7.0 With Support for Cyclone III FPGAs
- Web Edition Offers Free Design Support for Industry’s Highest-Density Low-Cost FPGAsBeijing, March 20, 2007—Altera Corporation (NASDAQ:ALTR) today introduced Quartus II software version 7.0 with support for the entire 65-nm Cyclone? III FPGA family in bot
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SYNPLICITY為ALTERA的CYCLONE III FPGA提供低成本優(yōu)勢
- 領(lǐng)先的半導(dǎo)體設(shè)計與驗(yàn)證軟件供應(yīng)商 Synplicity 公司日前宣布即將為 Altera 公司的低成本 Cyclone III FPGA 提供支持。Synplicity 對其 Synplify Pro? FPGA 綜合軟件進(jìn)行了優(yōu)化，從而提供了更為快速而簡便易用的解決方案，使 Cyclone III 客戶能夠迅速實(shí)現(xiàn)時序目標(biāo)，并通過優(yōu)化面積利用來節(jié)約成本。這兩家公司保持長期的合作伙伴關(guān)系，并在產(chǎn)品開發(fā)過程中密切配合，從而快速實(shí)現(xiàn)了Synplify Pro 軟件的優(yōu)化。根據(jù)雙方合作，Altera 在產(chǎn)品公開
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Altera發(fā)售業(yè)界首款65nm低成本FPGA
- Cyclone III FPGA前所未有地同時實(shí)現(xiàn)了低功耗、低成本和高性能，適合無線通信、視頻、顯示等其他對成本敏感的應(yīng)用。 2007年3月20號，北京——Altera公司今天宣布，開始發(fā)售業(yè)界的首款65nm低成本FPGA——Cyclone III系列。Cyclone III FPGA比競爭FPGA的功耗低75％，含有5K至120K邏輯單元(LE)，288個數(shù)字信號處理(DSP)乘法器，存儲器達(dá)到4Mbits。Cyclone III系列比前一代產(chǎn)品每邏輯單元成本降低20％，使設(shè)計人員能夠更多地在成本敏感
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