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基于FPGA的IP核8051上實(shí)現(xiàn)TCP/IP的設(shè)計(jì)
- 該便攜式接觸網(wǎng)故障信號分析儀采用圖形化程序設(shè)計(jì)語言LabVIEW開發(fā)設(shè)計(jì), 可實(shí)現(xiàn)數(shù)據(jù)的高速實(shí)時采集、在線分析、自動存儲、顯示等功能。高速數(shù)字化儀NI PXI- 5112卡采樣速度高、性能穩(wěn)定可靠, 適宜對高速變化信號的實(shí)時監(jiān)測。將軟件安裝在PXI- 1042工控機(jī)上, 具有體積小、抗干擾能力強(qiáng)、攜帶方便等特點(diǎn), 同時具有故障性質(zhì)判斷、故障定位功能。該系統(tǒng)目前已經(jīng)在石家莊變電所現(xiàn)場運(yùn)行, 效果良好。
- 關(guān)鍵字： FPGA 8051 TCP IP
通過智能電機(jī)控制優(yōu)化實(shí)時性能與效率
- ??????? 摘要：本文介紹了高級電機(jī)的類型及利弊，并介紹了集成型電機(jī)控制方案。 關(guān)鍵詞：智能;電機(jī)控制;MCU;集成型 數(shù)十年來，大多數(shù)電機(jī)控制應(yīng)用都依賴于可為其實(shí)現(xiàn)低成本與實(shí)施簡便性的通用有刷 DC 與步進(jìn)電機(jī)。不過，隨著微處理器 (MCU) 架構(gòu)的不斷創(chuàng)新與集成度的不斷提高，當(dāng)今開發(fā)人員能夠采用更先進(jìn)與更智能的電機(jī)類型與控制機(jī)制，以極低的成本提高電機(jī)的精度、性能、電源效率和使用一系列狀態(tài)簡化控制復(fù)雜性。所支持的狀態(tài)越
- 關(guān)鍵字： TI 電機(jī)控制 MCU
符合中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中的HDLC協(xié)議的FPGA設(shè)計(jì)與實(shí)現(xiàn)
- 隨著通信與網(wǎng)絡(luò)技術(shù)的不斷發(fā)展，使我國用現(xiàn)有的E1資源來傳輸以太網(wǎng)業(yè)務(wù)成為廣泛的應(yīng)用。以太網(wǎng)數(shù)據(jù)要通過E1線路傳輸就必須對以太網(wǎng)凈荷數(shù)據(jù)進(jìn)行幀封裝，才能從E1線路上恢復(fù)出以太網(wǎng)數(shù)據(jù)幀，完成以太網(wǎng)數(shù)據(jù)的交換。通常，以太網(wǎng)數(shù)據(jù)是通過HDLC協(xié)議或GFP協(xié)議來進(jìn)行封裝的。本文介紹了中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中以太網(wǎng)到單路E1轉(zhuǎn)換器HDLC協(xié)議封裝的FPGA（現(xiàn)場可編程邏輯陣列）設(shè)計(jì)與實(shí)現(xiàn)。
- 關(guān)鍵字： 中國移動 FPGA 201106
AVR單片機(jī)集成CAN總線控制器分析與應(yīng)用
- CAN總線應(yīng)用中，總線節(jié)點(diǎn)是CAN總線的基本組成部分。CAN總線節(jié)點(diǎn)有兩種典型設(shè)計(jì)方法，第一種方法采用MCU結(jié)合獨(dú)立CAN控制器組成總線節(jié)點(diǎn)[1]；第二種方法采用獨(dú)立的MCU，這時MCU需要內(nèi)部集成CAN控制器。由于第二種設(shè)計(jì)方法所用的器件少，電路關(guān)系簡單，已得到廣泛應(yīng)用。本文重點(diǎn)分析AVR系列單片機(jī)內(nèi)部集成的CAN控制器及其應(yīng)用方法。
- 關(guān)鍵字： AVR MCU CAN 201106
IIR數(shù)字濾波器的Matlab和FPGA實(shí)現(xiàn)
- 摘要：提出一種通過兩個二階節(jié)級聯(lián)構(gòu)成四階IIR數(shù)字橢圓濾波器的設(shè)計(jì)方法，并利用Matlab仿真軟件設(shè)計(jì)了通帶內(nèi)波紋不大于0．1 dB，阻帶衰減不小于42 dB的IIR數(shù)字濾波器。論述了一種采用可編程邏輯器件，通過VHDL硬件描
- 關(guān)鍵字： Matlab FPGA IIR 數(shù)字濾波器
基于FPGA的多路數(shù)字信號復(fù)分接器的設(shè)計(jì)
- 在現(xiàn)代數(shù)字通信中，對數(shù)據(jù)傳輸容量和傳輸效率的要求越來越高，因此經(jīng)常依據(jù)時分復(fù)用[1]的原理通過數(shù)字復(fù)接與分...
- 關(guān)鍵字： 數(shù)字復(fù)接技術(shù) FPGA 時分復(fù)用
FPGA時鐘設(shè)計(jì)
- 摘要：在FPGA設(shè)計(jì)中，為了成功地操作，可靠的時鐘是非常關(guān)鍵的。設(shè)計(jì)不良的時鐘在極限的溫度、電壓下將導(dǎo)致錯誤的行為。在設(shè)計(jì)PLD／FPGA時通常采用如下四種類型時鐘：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。
- 關(guān)鍵字： FPGA 時鐘設(shè)計(jì)
基于FPGA的自適應(yīng)波束形成算法實(shí)現(xiàn)
- 1 引 言 在雷達(dá)及聲納信號處理系統(tǒng)中，波束形成算法通常采用DSP軟件編程實(shí)現(xiàn)，控制邏輯電路采用CPLD來完成，這種方法具有軟件編程靈活、功能易于擴(kuò)展的優(yōu)點(diǎn)，但對于實(shí)時性能要求很高的系統(tǒng)，如雷達(dá)、聲納探測和
- 關(guān)鍵字： FPGA 自適應(yīng)波束 算法
基于FPGA的實(shí)時中值濾波器硬件實(shí)現(xiàn)
- 針對高清圖像在中值濾波預(yù)處理過程中排序量多、速度慢的特點(diǎn)，提出適合鄰域圖像并行處理機(jī)的分塊存儲方法。在流水線結(jié)構(gòu)下，1個時鐘周期可以并行處理32個3×3鄰域的中值濾波運(yùn)算，實(shí)現(xiàn)了高速、實(shí)時的1 920×1 080灰度圖像中值濾波器。
- 關(guān)鍵字： FPGA 中值濾波 硬件實(shí)現(xiàn)
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