無(wú)奈，但沒(méi)能通過(guò)EDA Netlist Writer，查找錯(cuò)誤信息，簡(jiǎn)單六行：

主要錯(cuò)誤：

Error：Can''t generate netlist outout files because the fileC：/altera/72/ip/fft/lib/auk_dspip_math_pkg_fft_72.vhd is an OpenCore Plus time-limited file.

生成網(wǎng)表輸出文件出錯(cuò)。OpenCore Plus time-limited ，在之前進(jìn)行的一系列設(shè)置里（settings）ENA Netlist Writer options里選擇的是第三方仿真軟件modelsim，緣故就出在此。在沒(méi)有授權(quán)時(shí)opencore是不允許生成Netlist的，更改設(shè)置：settings里EDA Tool Settings ―>Simulation選擇“none”，重新編譯，通過(guò)。

接下來(lái)，理清管腳關(guān)系，進(jìn)行仿真。