1概 述

　　擴(kuò)展頻譜通信具有抗干擾能力強(qiáng)、隱蔽性好等優(yōu)點(diǎn)，已成為通信對抗與反對抗中最重要的技術(shù)手段，在軍事通信中日益受到重視，跳頻電臺就是擴(kuò)頻通信在軍事領(lǐng)域中的重要應(yīng)用。在通信對抗中如何有效地對抗跳頻電臺是目前的一個熱點(diǎn)問題。在通信對抗的教學(xué)中為了以實(shí)驗(yàn)的形式向人們展示跳頻通信中干擾與抗干擾的原理，并能對跳頻通信進(jìn)行偵察和實(shí)施多種干擾的效果進(jìn)行比較，為科研中尋找對跳頻通信的最有效干擾方式提供有效的數(shù)據(jù)和參考，本文給出了一種基于DDS與USB技術(shù)的通信對抗教學(xué)演示系統(tǒng)中硬件方案的設(shè)計(jì)與實(shí)現(xiàn)。

2 系統(tǒng)整體結(jié)構(gòu)設(shè)計(jì)及原理說明

　　系統(tǒng)主要由控制計(jì)算機(jī)、發(fā)射機(jī)、電子偵察模塊、電子干擾模塊和接收機(jī)等五部分組成，如圖1所示。計(jì)算機(jī)主要是用于控制與協(xié)調(diào)各個模塊的工作和數(shù)據(jù)傳輸，決定系統(tǒng)各部分的工作模式并對工作狀態(tài)進(jìn)行實(shí)時(shí)監(jiān)視。

　　發(fā)射機(jī)在計(jì)算機(jī)指令的控制下，在指定的工作頻段內(nèi)以相應(yīng)的方式發(fā)射跳頻信號。電子偵察模塊利用高速A/D采樣技術(shù)與高速FFT實(shí)時(shí)處理技術(shù)可以快速地捕捉并計(jì)算出發(fā)射信號的工作頻率點(diǎn)，同時(shí)將偵察到的跳頻數(shù)據(jù)送至電子干擾模塊。接收到偵察數(shù)據(jù)的干擾模塊在計(jì)算機(jī)控制下利用FPGA控制頻率合成器件產(chǎn)生各種調(diào)制信號，選擇不同的干擾方式對通信電臺實(shí)時(shí)有效的干擾。干擾信號與實(shí)際跳頻信號分別送人合路器中，由合路器送至接收機(jī)比較各種不同干擾方式的實(shí)際效果。

3器件的選擇

3．1 A/D芯片與FPGA芯片

　　A/D芯片選用的是為寬帶和多信道數(shù)字無線接收機(jī)系統(tǒng)而推出的12位中頻快速采樣芯片AD6640。

　　AD6640是一個高速度、高性能、低功耗，單片式12位AD轉(zhuǎn)換器，內(nèi)含采樣保持電路和基準(zhǔn)源。他由單電源+5 V供電，TTL/CMOS兼容電平輸出，中頻采樣頻率的典型值為70 MHz(多信道時(shí))和200 MHz(單信道時(shí))，采樣速率可達(dá)65 Mb/s，信噪比SNR的典型值為68 dB，SFDR值為80 dB，功耗為710 mW。AD6640采用兩級子區(qū)式的轉(zhuǎn)換結(jié)構(gòu)，既保證了精度又降低了功耗，其功能模塊如圖2所示。從圖2可以看出ADC所有需要的功能，包括輸入緩沖，跟蹤保持放大，數(shù)字糾錯以及2．4 V參考電壓都由芯片提供，從而使其設(shè)計(jì)變得更輕松。

　　FPGA芯片采用的是Altera公司的ACEXlK系列產(chǎn)品的EPlKl00芯片。其特點(diǎn)是將查找表(LUT)和EAB相結(jié)合，提供了高效率而又廉價(jià)的結(jié)構(gòu)?；贚UT的邏輯對數(shù)據(jù)路徑管理、寄存器強(qiáng)度、數(shù)學(xué)計(jì)算或數(shù)字信號處理(DSP)的設(shè)計(jì)提供優(yōu)化的性能和效率，而EAB可實(shí)現(xiàn)RAM，ROM，雙口RAM或FIFO功能。這使得ADEXlK適合于復(fù)雜邏輯及存儲器功能，如數(shù)字信號處理、寬域數(shù)據(jù)路徑管理、數(shù)據(jù)變換和微處理器等各種高性能通信應(yīng)用?；诳芍貥?gòu)CMOS SRAM單元，ACEX1K結(jié)構(gòu)具有實(shí)現(xiàn)一般門陣列宏功能需要的所有特征，相應(yīng)的多引腳數(shù)提供與系統(tǒng)元器件的有效接口。先進(jìn)的處理功能和2．5 V低電壓要求，使得AC2EX1K器件滿足廉價(jià)、高容量的應(yīng)用需要。

3．2 DDS芯片

　　DDS芯片選用的是美國的Analog Device Inc(ADI)公司生產(chǎn)的DDS器件AD9854。AD9854數(shù)字頻率合成器是一個采用了先進(jìn)的DDS技術(shù)的高集成器件。

　　他具有一對內(nèi)部高速、高性能的正交D/A轉(zhuǎn)換器和比較器，可實(shí)現(xiàn)數(shù)字合成正交的I和Q路輸出。當(dāng)輸入一準(zhǔn)確的參考頻率，AD9854即可產(chǎn)生一高穩(wěn)定的頻率、相位、幅度可編程的正弦和余弦信號。AD9854的DDS核心具有48 b的頻率分辨率。14 b相位截?cái)啾ＷC了優(yōu)良的SFDR指標(biāo)。AD9854的電路工藝使同步正交信號輸出的頻率最高達(dá)到150 MHz，平均每秒產(chǎn)生1百萬新頻率。AD9854中4～20整數(shù)倍的可編程參考頻率累加器能使外部輸入的低速時(shí)鐘轉(zhuǎn)變成內(nèi)部高速時(shí)鐘(最高300 MHz)。

　　AD9854能實(shí)現(xiàn)除了基本的FSK以外的增強(qiáng)頻譜特性的Ramped FSK。該器件采用了先進(jìn)的35μmC2MOS技術(shù)使該器件只需要+3．3 V的電源供應(yīng)。

3．3 DAC芯片與USB芯片

　　系統(tǒng)所用的DAC為ADI公司的AD5344，他是一種低功耗12 b數(shù)模轉(zhuǎn)換器。該芯片可應(yīng)用于便攜式電池電源儀器、可編程電壓和電流源、可編程衰減器、工業(yè)處理控制器以及數(shù)字放大和補(bǔ)償調(diào)節(jié)等方面。圖3為其內(nèi)部結(jié)構(gòu)原理圖。AD5344有4路12 b DAC，可在2．5～5．5 V之間正常工作，在外接+3 V電壓時(shí)典型電流值為500μA，并且具備進(jìn)一步將電流降至80 nA的節(jié)電模式。他的輸出緩存可將輸出驅(qū)動到兩個電源軌道之上。通過A0和A1可控制選擇哪一路輸出。