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	asic ip核
          

          
	
          
    	
          
    	  	
          
              	
                                
          
                  

                                
          
                    
          中國汽車半導(dǎo)體市場年末反彈
          
                                                            
                                        
            
                    	
          • 　　據(jù)IHS iSuppli公司的中國研究報(bào)告，盡管需求比前幾年放緩，但2012年中國汽車半導(dǎo)體市場仍有望強(qiáng)勁增長9.7%。政府激勵(lì)措施在第四季度促進(jìn)了中國汽車市場的增長。
　　今年中國汽車半導(dǎo)體市場營業(yè)收入預(yù)計(jì)達(dá)到41億美元，高于2011年的38億美元。明年，中國總體汽車半導(dǎo)體營業(yè)收入將增長12%，達(dá)到46億美元。2011-2016年，中國汽車半導(dǎo)體市場的復(fù)合年度增長率將達(dá)11%，如圖所示。
　　

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　　圖：中國汽車半導(dǎo)體市場營業(yè)收入預(yù)測
　　這種增長令人鼓舞。中國消費(fèi)者要求汽
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          • 關(guān)鍵字：
                        汽車  半導(dǎo)體  ASIC                          
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          基于UART的智能卡接口IP核設(shè)計(jì)
          
                                                            
            
                    	
          • 分析了UART核的結(jié)構(gòu)和智能卡的傳輸協(xié)議，提出一種基于UART核的智能卡接口IP核的設(shè)計(jì)。該設(shè)計(jì)以成熟的UART核為基礎(chǔ)，無需編寫異步串口的時(shí)序與接口邏輯，僅在串口核中增加收發(fā)緩沖器和協(xié)議處理等模塊，減少了工作量并縮短了開發(fā)周期。最后對所設(shè)計(jì)的IP核進(jìn)行仿真和實(shí)際測試，結(jié)果表明該IP核設(shè)計(jì)正確，運(yùn)行穩(wěn)定，適合在多卡系統(tǒng)中應(yīng)用。
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          • 關(guān)鍵字：
                        UART  IP核  智能卡  接口                            
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          Cadence合成技術(shù)為Renesas微系統(tǒng)公司加快生產(chǎn)時(shí)間
          
                                                            
            
                    	
          • 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè) Cadence 設(shè)計(jì)系統(tǒng)公司 (NASDAQ:CDNS) 日前宣布 Renesas 微系統(tǒng)有限公司已采用 Cadence? Encounter? RTL Compiler 用于綜合實(shí)現(xiàn)，尤其是將復(fù)雜 ASIC 設(shè)計(jì)的芯片利用率提高了 15%，面積減少了 8.4%，加速了實(shí)現(xiàn)周期并降低了成本。
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          • 關(guān)鍵字：
                        Cadence  Renesas  微系統(tǒng)  ASIC                          
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          基于IP核技術(shù)的SoC設(shè)計(jì)
          
                                                            
            
                    	
          • 1概述

            隨著集成電路(Integrated Circuit,IC)設(shè)計(jì)技術(shù)和工藝水平進(jìn)入超深亞微米,集成電路規(guī)模越來越大,芯片設(shè)計(jì)規(guī)模和設(shè)計(jì)復(fù)雜度也急劇提高,工藝流程呈現(xiàn)專業(yè)化,EDA設(shè)計(jì)逐步發(fā)展和完善。九十年代出現(xiàn)了SoC芯片,即可
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          • 關(guān)鍵字：
                        SoC  IP核                            
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          基于DDS IP核及Nios II的可重構(gòu)信號(hào)源設(shè)計(jì)
          
                                                            
            
                    	
          •  SOPC(System on a Programmable Chip，片上可編程系統(tǒng))是Altera公司提出的一種靈活、高效的SOC解決方案。它將處理器、存儲(chǔ)器、I／O接口、LVDS、CDR等系統(tǒng)設(shè)計(jì)需要的功能模塊集成到一個(gè)可編程邏輯器件上，構(gòu)建一個(gè)可
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          • 關(guān)鍵字：
                        Nios  DDS  IP核  可重構(gòu)                            
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          超低噪聲混合信號(hào)芯片 助力醫(yī)療CT性能顯著提升
          
                                                            
            
                    	
          • 　　2012年11月14日，奧地利微電子宣布開始供應(yīng)新款高集成ASIC，在較低的X射線劑量下，幫助西門子新型計(jì)算機(jī)斷層掃描(CT)光探測器模塊提供更高分辨率的圖像。奧地利微電子公司是全球領(lǐng)先的高性能模擬IC和傳感器解決方案的設(shè)計(jì)者及制造商，專為消費(fèi)通信、醫(yī)療電子、汽車應(yīng)用行業(yè)服務(wù)。
　　作為西門子新型Stellar CT光探測器模塊的組成部分，奧地利微電子的ASIC可捕捉并數(shù)字化病人身體的圖像。它在一個(gè)層疊骰子型(3D集成式)配置結(jié)構(gòu)內(nèi)，將一個(gè)高分辨率光電二極管同一個(gè)低噪聲模數(shù)轉(zhuǎn)換器(ADC)整合在了一
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          • 關(guān)鍵字：
                        西門子  ASIC  CT                          
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          基于IP核的FIR低通濾波器的設(shè)計(jì)與實(shí)現(xiàn)
          
                                                            
            
                    	
          • 0.引言 

            FIR（Finite Impulse Response，有限沖擊響應(yīng)）數(shù)字濾波器具有穩(wěn)定性高、可以實(shí)現(xiàn)線性相位等優(yōu)點(diǎn)，廣泛被應(yīng)用于信號(hào)檢測與處理等領(lǐng)域[1,2]。由于FPGA（Field Programmable Gate Array，現(xiàn)場可編程門陣列）
            • 
                    	                        
          • 關(guān)鍵字：
                        FIR  IP核  低通濾波器                            
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          基于IP核的FPGA 設(shè)計(jì)方法
          
                                                            
            
                    	
          • 幾年前設(shè)計(jì)專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計(jì)工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實(shí)現(xiàn), 系統(tǒng)制造公司的設(shè)計(jì)人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級(jí)功能(System L evel In tegrete - SL
            • 
                    	                        
          • 關(guān)鍵字：
                        FPGA  IP核  設(shè)計(jì)方法                            
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          Bluetooth ASIC及其嵌入式應(yīng)用
          
                                                            
            
                    	
          • 1 引言 Bluetooth（藍(lán)牙）作為新的短程無線電通信技術(shù)，可以隨時(shí)隨地用無線接口來代替有線電纜連接，可應(yīng)用于多種通 ...
            • 
                    	                        
          • 關(guān)鍵字：
                        Bluetooth  ASIC  PH2401                          
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          基于ARM的IEEE802.11bMAC層協(xié)議IP核設(shè)計(jì)
          
                                                            
            
                    	
          • 摘要：介紹了IEEE 802.11b MAC層協(xié)議IP核設(shè)計(jì)，提出了基于32位微處理器ARM7DMI的系統(tǒng)設(shè)計(jì)方案，闡述了系統(tǒng)硬件平 ...
            • 
                    	                        
          • 關(guān)鍵字：
                        ARM  IEEE802.11b  MAC層協(xié)議  IP核                          
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          基于快速傅里葉IP核的數(shù)字脈壓處理器的實(shí)現(xiàn)
          
                                                            
            
                    	
          •  引言

            脈沖壓縮體制在現(xiàn)代雷達(dá)中被廣泛采用，通過發(fā)射寬脈沖來提高發(fā)射的平均功率，保證足夠的作用距離；接收時(shí)則采用相應(yīng)的脈沖壓縮算法獲得脈寬較窄的脈沖，以提高距離分辨力，從而能夠很好地解決作用距離和距離
            • 
                    	                        
          • 關(guān)鍵字：
                        快速傅里葉  IP核  處理器  數(shù)字                            
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          AES加密算法的高速低功耗ASIC設(shè)計(jì)
          
                                                            
            
                    	
          • 摘 要：本文提出了一個(gè)AES加密算法的高速低功耗ASIC設(shè)計(jì)方案，使用Synopsys設(shè)計(jì)流程和VeriSilicON 0.18mu;m CMOS工藝，實(shí)現(xiàn)了最高工作頻率410MHz，數(shù)據(jù)吞吐率5.23Gbps，功耗為58 mW。采用改進(jìn)算法(T盒算法)，將輪變
            • 
                    	                        
          • 關(guān)鍵字：
                        ASIC  AES  加密算法  低功耗                            
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          淺談FPGA與ASIC的設(shè)計(jì)優(yōu)勢
          
                                                            
            
                    	
          • ASIC 和 FPGA 具有不同的價(jià)值主張，選擇其中之一之前，一定要對其進(jìn)行仔細(xì)評估。2種技術(shù)的比較信息非常豐富。這里介紹了ASIC和FPGA的優(yōu)勢與劣勢。FPGA 和 ASIC 的設(shè)計(jì)優(yōu)勢比較FPGA 的設(shè)計(jì)優(yōu)勢更快的面市時(shí)間 - 無需布
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          • 關(guān)鍵字：
                        FPGA  ASIC                            
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          JPEG編碼器IP核性能優(yōu)化解決方案
          
                                                            
            
                    	
          • 6月19日，半導(dǎo)體IP供應(yīng)商CAST公司宣布對其提供的JPEG編碼器IP核進(jìn)行功能及性能優(yōu)化?！　∠到y(tǒng)設(shè)計(jì)師現(xiàn)在有兩 ...
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          • 關(guān)鍵字：
                        JPEG  編碼器  IP核  性能優(yōu)化                          
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          FPGA和ASIC的比較
          
                                                            
            
                    	
          • ASIC是英文的Application Specific Integrated Circuits縮寫，即專用集成電路，是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計(jì)、制造的集成電路。目前用CPLD(復(fù)雜可編程邏輯器件)和FPGA(現(xiàn)場可編程邏輯陣列)來進(jìn)行AS
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          • 關(guān)鍵字：
                        FPGA  ASIC  比較                            
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          asic ip核介紹
          
      			
          
		      	
          
		      			      			      	您好，目前還沒有人創(chuàng)建詞條asic ip核!
           
		      	歡迎您創(chuàng)建該詞條，闡述對asic ip核的理解，并與今后在此搜索asic ip核的朋友們分享。    創(chuàng)建詞條
		      			      	
          
    		
          
  		
          
  		  		  		
  		  		  		
  		  		  		
  		  		            
          
        
          
            
          
              
          asic ip核專欄文章
          
              
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