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Cadence新芯片集成解決方案改進Virtuoso平臺
- Cadence 設(shè)計系統(tǒng)有限公司(紐約證券交易所代碼：CDN)今日宣布，他們結(jié)合最新版本的Virtuoso Chip Editor，推出了一種新的芯片集成流程，對原先Virtuoso
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CADENCE選擇在韓國設(shè)立新的設(shè)計研究院
- Cadence 設(shè)計系統(tǒng)公司 (紐約證券交易所代碼: CDN)今天宣布，公司將向韓國的SoC系統(tǒng)設(shè)計師提供專業(yè)培訓(xùn)和新一代設(shè)計技術(shù)，通過這一途徑來資助韓國軟件振興院 (KIPA) IT -SoC研究院和IT -SoC技術(shù)支持中心，并與之展開合作。近300位國際客人，其中包括政府高級官員，工業(yè)界主管，以及教授參加了該研究院的成立儀式。 韓國軟件振興院(KIPA)為韓國信息通信部下屬的單位，其宗旨為積極促進韓國信息技術(shù)產(chǎn)業(yè)的發(fā)展。該組織將許可她的研究院和技術(shù)支持中心使用Cadence的EDA設(shè)計軟件。 Cad
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CADENCE發(fā)布支持基于64位Intel® Itanium® 2的LINUX平臺
- Cadence設(shè)計系統(tǒng)公司（紐約證券交易所／納斯達克交易代碼：CDN）今天宣布它已經(jīng)發(fā)布了基于Intel
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CADENCE與MENTOR解決仿真專利糾紛并結(jié)束訴訟
- Cadence Design Systems公司(NYSE: CDN)與Mentor Graphics公司 (NASDAQ: MENT)宣布兩公司同意平息雙方之間有關(guān)仿真與加速系統(tǒng)相關(guān)的全部未完訴訟。它們還達成協(xié)議,在7年時間內(nèi)不向?qū)Ψ教崞鹩嘘P(guān)專利仿真與加速技術(shù)的訴訟。Mentor將向Cadence支付一千八百萬美元現(xiàn)金?！肮降母偁帟o我們的客戶帶來更好的技術(shù)平臺和更好的結(jié)果，而漫長的訴訟于事無補，”Cadence總裁兼首席執(zhí)行官Ray Bingham表示：“雖然我們會責(zé)無旁貸地保護我們的知識產(chǎn)權(quán)，但是
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CADENCE宣布ORCAD10.0面市
- Cadence設(shè)計系統(tǒng)公司(NYSE:CDN)今天宣布OrCAD
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智芯科技與Cadence合作開發(fā)基于CSMC流程的先進設(shè)計庫
- Cadence設(shè)計系統(tǒng)公司和智芯技術(shù)有限公司(IPCore)今天聯(lián)合宣布雙方合作開發(fā)了第一個基于CSMC流程的數(shù)字設(shè)計庫，并經(jīng)過實際客戶設(shè)計驗證。Cadence是第一個與IPCore合作開發(fā)基于CSMC流程的從RTL到GDSII數(shù)字設(shè)計庫的EDA公司?！爸切究萍际菄鴥?nèi)ASIC設(shè)計服務(wù)市場的主要公司，擁有應(yīng)對0.18微米以上設(shè)計挑戰(zhàn)的先進設(shè)計方法。另一方面，全球，特別是中國，對成熟技術(shù)的需求仍然很大。我們選擇Cadence先進的深亞微米設(shè)計工具作為我們的設(shè)計平臺，并合作開發(fā)基于CSMC流程的數(shù)字設(shè)計庫，來滿
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Cadence公布工業(yè)界第一個完整的針對千兆位速度的PCB系統(tǒng)設(shè)計環(huán)境
- 為了幫助設(shè)計工程師解決千兆速度PCB系統(tǒng)設(shè)計的挑戰(zhàn)，Cadence Design System公司（NYSE:CDN）今天公布了Cadence15.0版本的印刷電路板（PCB）和集成電路封裝（IC Packaging）設(shè)計環(huán)境。這一剛剛公布的版本在整個集成的流程包含了許多革新和增強功能?，F(xiàn)在，工程師終于第一次擁有了設(shè)計和實現(xiàn)千兆位串行接口高速PCB系統(tǒng)的集成環(huán)境，可以分析和約束驅(qū)動完成跨越芯片，封裝及PCB板三個系統(tǒng)層面的差分信號互連。這一強大的功能帶領(lǐng)計算機和網(wǎng)絡(luò)公司走上設(shè)計一次成功之路其它可以提高生產(chǎn)
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CADENCE將MATSUSHITA的驗證運行時間縮短到分鐘
- Cadence Design Systems公司（NYSE：CDN）今天宣布該公司由Palladium™驅(qū)動的Incisive™加速技術(shù)已經(jīng)使Matsushita Electric Industrial有限公司節(jié)省了關(guān)鍵的設(shè)計時間并大大增強了該公司的復(fù)雜、納米級設(shè)計的質(zhì)量。利用該平臺的仿真加速功能，Matsushita把其驗證性能提高了1000倍，從而把驗證測試時間從6周縮短到50分鐘。在充分利用這種生產(chǎn)率提高基礎(chǔ)上，Matsushita能夠運行更多的測試，極大加快了其消費電子應(yīng)用
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