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Giantec采用Virtuoso流程實現(xiàn)了30%的效率提升
- 2011年9月19日 — 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ: CDNS)，今日宣布Giantec Semiconductor Corp.已采用Cadence Virtuoso 統(tǒng)一定制/模擬（IC6.1）以及Encounter 統(tǒng)一數(shù)字流程生產(chǎn)其混合信號芯片。Giantec最近采用Cadence軟件設計并成功流片了一款用于低功耗微控制器的存儲器產(chǎn)品，這款低功耗微控制器應用于智能卡、智能電表和消費電子產(chǎn)品。使用Cadence Virtuoso統(tǒng)一定制/模擬流程開發(fā)其混合信號
- 關鍵字： Cadence 微控制器
Cadence采用最新數(shù)字端到端流程推動28納米的千兆門/千兆赫設計
- 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司，宣布推出28納米的可靠數(shù)字端到端流程，推動千兆門/千兆赫系統(tǒng)級芯片(SoC)設計，在性能與上市時間方面都有著明顯的優(yōu)勢。在Cadence的硅實現(xiàn)方法的驅動下，在統(tǒng)一化設計、實現(xiàn)與驗證流程中，通過技術集成和對核心架構與算法大幅改進，基于Encounter的全新流程提供了更快、更具決定性的途徑實現(xiàn)千兆門/千兆赫硅片。通過與Cadence的模擬/混合信號與硅/封裝協(xié)同設計領域的無縫綜合，新的數(shù)字28納米流程讓設計師能夠全局考慮整個芯片流程，在高性能、低功耗
- 關鍵字： Cadence 28納米
中芯國際采用Cadence公司 DFM 和低功耗硅技術
- 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司，今天宣布中國最大的半導體晶圓廠中芯國際集成電路制造有限公司，已經(jīng)將Cadence? Silicon Realization產(chǎn)品作為其65納米參考流程4.1版本(Reference Flow 4.1)可制造性設計(DFM)以及低功耗技術的核心。以Cadence Encounter Digital Implementation System為基礎，兩家公司合作為65納米系統(tǒng)級芯片(SoC)設計提供了一個完整的端到端的Silicon Realiza
- 關鍵字： 中芯國際 Cadence 65納米
Cadence劉國軍：65nm及以下芯片設計要破傳統(tǒng)
- 幾年前，65nm芯片設計項目已經(jīng)在中國陸續(xù)開展起來。中國芯片設計企業(yè)已逐步具備65nm芯片的設計能力。同時，由于65nm與以往更大特征尺寸的設計項目確實有很大不同，因此，對一些重要環(huán)節(jié)需要產(chǎn)業(yè)上下游共同關注。 關注一 如何確保IP質(zhì)量 雖然IP問題與65nm芯片設計并不直接相關，由于他們的一些客戶在實際設計項目中遇到的比較大的問題之一就是IP質(zhì)量問題，因此應該引起業(yè)界的關注。 隨著芯片設計采用更先進的工藝技術，芯片規(guī)模越來越大，對IP的需求越來越多。 目前不同IP來源，不同代工
- 關鍵字： Cadence 芯片 65nm
Cadence與ARM合作開發(fā)ARM優(yōu)化型系統(tǒng)實現(xiàn)方案
- 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司今天宣布拓展其與ARM的合作關系，為ARM處理器開發(fā)一個優(yōu)化的系統(tǒng)實現(xiàn)解決方案，將實現(xiàn)端到端的流程，包括一個全套的可互用型工具、ARM® 處理器和實體IP、內(nèi)置Linux到GDSII的方法學與服務。為了加快該解決方案的采用，Cadence將會提供完善的補充材料，如指南手冊與學習材料，包括兩本方法學參考書，并拓展服務、方法學與培訓機構的生態(tài)系統(tǒng)。 “軟件復雜性的不斷攀升驅使系統(tǒng)成本的提升，業(yè)界領先企業(yè)需要聯(lián)合起來，提供可靠而節(jié)約
- 關鍵字： Cadence 電子設計 ARM
國民技術選擇Cadence作為先進工藝系統(tǒng)SOC設計的優(yōu)選供應商
- 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司今天宣布，中國領先的無工廠IC設計企業(yè)國民技術股份有限公司在對Cadence® Virtuoso®、Encounter®、以及系統(tǒng)級封裝(SiP)技術進行了縝密的評估后，認為Cadence技術和方法學的強大組合，可幫助國民技術更好地實現(xiàn)在先進工藝條件下，復雜的系統(tǒng)級SOC的高品質(zhì)設計。寄予這樣的評估國民技術選擇Cadence公司作為公司設計的EDA優(yōu)選供應商，應用其EDA軟件開發(fā)安全、通信電子市場尖端的系統(tǒng)級芯片(SoC)。 國
- 關鍵字： Cadence IC設計 Virtuoso Encounter
Cadence使用最新開放型綜合平臺加快SoC實現(xiàn)，降低成本
- Cadence設計系統(tǒng)公司今天發(fā)布Cadence Open Integration Platform，該平臺能夠顯著降低SoC開發(fā)成本，提高質(zhì)量并加快生產(chǎn)進度。Cadence Open Integration Platform是支持其新一代應用驅動式開發(fā)的EDA360愿景的一個關鍵支柱，包含公司自身及其產(chǎn)業(yè)鏈參與者提供的面向集成而優(yōu)化的IP、全新Cadence Integration Design Environment 以及按需集成服務。Cadence混合信號(模擬與數(shù)字)設計、驗證與實現(xiàn)產(chǎn)品與解決
- 關鍵字： Cadence SoC EDA
Cadence推出驗證計算平臺加快系統(tǒng)開發(fā)時間并提高其質(zhì)量
- 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司今天公布了第一款全集成高性能驗證計算平臺，稱為Palladium XP，它在一個統(tǒng)一的驗證環(huán)境中綜合了模擬(Simulation)、加速(Acceleration)與仿真(Emulation)。這種高度可擴展的Palladium XP驗證計算平臺是為了支持下一代設計而開發(fā)的，讓設計與驗證團隊能夠更快地完善他們的軟硬件環(huán)境，在更短的時間內(nèi)生產(chǎn)出更高質(zhì)量的嵌入式系統(tǒng)。 Cadence® Palladium® XP 最高支持20億門的設
- 關鍵字： Cadence EDA設計 驗證計算平臺 Palladium
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