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基于TMS320C5410的256PPM調(diào)制設計

關鍵字： FSO PPM DSP 調(diào)制

語音編解碼算法G.723.1在DSP上的優(yōu)化

關鍵字： G.723.1 語音編解碼 DSP

低碼率語音編碼MELP聲碼器的SOPC實現(xiàn)

摘要：討論了低碼率語音編碼MELP的編解碼過程，有效降低了語音編碼碼率并能使說話者個人語音特征減弱，特...
關鍵字： SOPC MELP 語音編碼 FPGA NiosII

SignalTapII ELA的FPGA在線調(diào)試技術(shù)

通過對FPGA內(nèi)部信號的捕獲測試，可以實現(xiàn)對系統(tǒng)設計缺陷的實時分析和修正。與外部測試設備相比，可以總結(jié)出SignalTapII ELA的幾點優(yōu)越性：不占用額外的I／O引腳，不占用PCB上的空間，不破壞信號的時序和完整性，不需額外費用；從多方面證實，該測試手段可以減少調(diào)試時間，縮短設計周期。
關鍵字： SignalTapII FPGA ELA 在線調(diào)試

用DSP實現(xiàn)抖動（Jitter）測量的方法

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡家園
關鍵字： DSP 抖動（Jitter）測量時鐘頻率

基于DSP的逆變電源控制系統(tǒng)研究

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡家園
關鍵字： DSP 逆變電源 SPWM波形

誰會在代工投資“盛宴”中缺席？

　　在前3年之前全球代工總是在看前4大的動向，包括臺積電、聯(lián)電、中芯國際及特許。然而，臺積電一家獨大，聯(lián)電居老二似乎也相安無事。　　自AMD分出Globalfoundries，及ATIC又兼并特許，再把Globalfoundries與特許合并在一起。表面上看少了一個特許，實際上由于Globalfoundries在其金主支持下積極建新廠，在代工業(yè)界引發(fā)了波浪,至少誰將成為老二成為話題。　　加上存儲器大享三星近期開始投資代工，放言要接高通的手機芯片訂單;加上fabless大廠Xilinx改變策略，把2
關鍵字：臺積電 FPGA 28nm

基于FPGA的RS485接口誤碼測試儀的設計和實現(xiàn)

介紹了一種基于FPGA的誤碼測試儀的設計原理、實現(xiàn)過程及調(diào)試經(jīng)驗。該誤碼測試系統(tǒng)使用RS485接口，具有原理簡單、接口獨特、功能豐富等特點，系統(tǒng)具有較好的可擴展性。
關鍵字： FPGA 485 RS 接口

子帶分解的自適應濾波器的FPGA實現(xiàn)

基于子帶分解的自適應濾波器在提高收斂性能的同時又可以節(jié)省一定的計算量。采用Altera公司的仿真軟件Altera DSP Builder和QuartusⅡ7．2進行子帶分解的NLMS算法的自適應濾波器現(xiàn)場可編程門陣列設計，利用Simulink和ModelSim對設計方案進行了模型仿真和功能仿真，達到較好的效果。
關鍵字： FPGA 分解自適應濾波器

常用FPGA/CPLD四種設計技巧

常用FPGA/CPLD四種設計技巧,FPGA/CPLD的設計思想與技巧是一個非常大的話題，本文僅介紹一些常用的設計思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導日
關鍵字：技巧設計 FPGA/CPLD 常用

基于DSP的人臉識別系統(tǒng)設計

基于DSP的人臉識別系統(tǒng)設計,摘要：介紹了以DSP為核心的實時人臉識別系統(tǒng)設計。通過對視頻制式組成的充分學習，設計了包括圖像采集編碼、CPLD控制存儲器存取切換系統(tǒng)，以及圖像編碼輸出在內(nèi)的硬件平臺。在軟件設計過程中，分別設計了自動采集樣本
關鍵字：系統(tǒng) 設計識別人臉 DSP 基于

AEMB軟核處理器的SoC系統(tǒng)驗證平臺的構(gòu)建

SoC芯片的規(guī)模一般遠大于普通的ASIC，同時深亞微米工藝帶來的設計困難等使得SoC設計的復雜度大大提高。仿...
關鍵字： FPGA SoC 系統(tǒng)驗證平臺 AEMB 軟核處理器

基于FPGA的RS485接口誤碼測試儀的設計

摘要：介紹了一種基于FPGA的誤碼測試儀的設計原理、實現(xiàn)過程及調(diào)試經(jīng)驗。該誤碼測試系統(tǒng)使用RS485接口...
關鍵字： FPGA RS485 誤碼測試儀

可實現(xiàn)快速鎖定的FPGA片內(nèi)延時鎖相環(huán)設計

摘要：延時鎖相環(huán)(DLL)是一種基于數(shù)字電路實現(xiàn)的時鐘管理技術(shù)。DLL可用以消除時鐘偏斜，對輸入時鐘進行分頻、倍頻、移相等操作。文中介紹了FPGA芯片內(nèi)DLL的結(jié)構(gòu)和設計方案，在其基礎上提出可實現(xiàn)快速鎖定的延時鎖相環(huán)
關鍵字： FPGA 延時鎖相環(huán)

使用SignalTap II邏輯分析儀調(diào)試FPGA

摘要：本文介紹了可編程邏輯器件開發(fā)工具Quartus II 中SingalTap II 嵌入式邏輯分析器的使用，并給出一個具體的設計實例，詳細介紹使用SignalTap II對FPGA調(diào)試的具體方法和步驟。
關鍵字： SignalTap；硬件調(diào)試
關鍵字： SignalTap FPGA 邏輯分析儀調(diào)試

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