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fpga) 文章進(jìn)入fpga)技術(shù)社區(qū)

基于USB通信的FPGA高速數(shù)據(jù)采集系統(tǒng)

摘要：為了解決高速數(shù)據(jù)采集以及數(shù)據(jù)傳輸問題，設(shè)計了基于USB通信的FPGA高速數(shù)據(jù)采集系統(tǒng)。方案以FPGA為控制核心，實(shí)現(xiàn)A／D控制、數(shù)據(jù)緩存雙口RAM和控制CY7C68013A三個功能。系統(tǒng)采用Verilog HDL語言，通過ISE軟件編
關(guān)鍵字：數(shù)據(jù)采集系統(tǒng) 高速 FPGA USB 通信基于

基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設(shè)計

1、引言　　最佳聲納系統(tǒng)的設(shè)計需要從聲納波形、聲納信道和聲納接收機(jī)三方面進(jìn)行綜合考慮[1]。在聲納信道 ...
關(guān)鍵字： ARM FPGA 聲納波形產(chǎn)生

線性調(diào)頻信號基于FPGA IP核的脈沖壓縮設(shè)計

摘要：為實(shí)現(xiàn)線性調(diào)頻信號的數(shù)字脈沖壓縮，設(shè)計一個FPGA硬件平臺，并著重提出一種基于FPGA IP核的脈沖壓縮設(shè)計方法。針對脈沖壓縮進(jìn)行了理論分析和Matlab仿真，設(shè)計完成后對系統(tǒng)軟、硬件進(jìn)行了全面測試，并根據(jù)實(shí)測數(shù)
關(guān)鍵字： FPGA 線性調(diào)頻信號 IP核脈沖壓縮

基于FPGA的LCoS驅(qū)動和圖像處理系統(tǒng)設(shè)計

摘要：針對分辨率為1 024times;768的LCoS屏編寫了Verilog HDL驅(qū)動代碼，在quartusⅡ9．1平臺上綜合編譯，并在Altera的FPGA芯片EP3C5E14 4C8上進(jìn)行了功能驗(yàn)證和實(shí)際輸出信號測量。采用異步FIFO結(jié)構(gòu)解決了跨異步時鐘域
關(guān)鍵字： FPGA LCoS 驅(qū)動圖像處理

基于CPLD／FPGA的USB讀寫控制器

引言
隨著計算機(jī)科技的發(fā)展，無紙辦公日益成為各單位日常辦公的主要形式。而隨著USB存儲設(shè)備日益廣泛的使用，數(shù)據(jù)泄漏的危害也越來越嚴(yán)重。因此在單位內(nèi)部對USB存儲設(shè)備的操作權(quán)限進(jìn)行控制是很有必要的。
關(guān)鍵字： CPLD FPGA USB 讀寫

基于FPGA的交流電測量儀的設(shè)計

在電力調(diào)度自動化系統(tǒng)中，測量電壓和頻率是最重要的功能。如何快速、準(zhǔn)確地采集顯得尤為重要。目前根據(jù)采集信...
關(guān)鍵字： FPGA 交流電測量儀

Leon3軟核的FPGA SelectMap接口配置設(shè)計

摘要：與通常采用外圍的CPLD器件和CPU來產(chǎn)生配置接口控制邏輯的方法不同，本文設(shè)計了采用嵌入到FPGA的Leon3開源CPU軟核來控制實(shí)現(xiàn)Virtex系列FPGA的SelectMap接口配置的方法，可將其應(yīng)用于對FPGA芯片的在線配置。該方
關(guān)鍵字： SelectMap Leon3 FPGA 軟核

一種基于MCU+FPGA的LED大屏幕控制系統(tǒng)的設(shè)計

　　存儲器是用來存儲程序和數(shù)據(jù)的部件，有了存儲器，計算機(jī)才有記憶功能，才能保證正常工作。它根據(jù)控制器指定的位置存進(jìn)和取出信息。引言　　只要在現(xiàn)在的市場上走一圈就會發(fā)現(xiàn)，大部分的中小規(guī)模 LED 　LED（L
關(guān)鍵字： FPGA MCU LED 大屏幕

FPGA平臺實(shí)現(xiàn)最小開關(guān)損耗的SVPWM算法

摘要：詳細(xì)分析了SVPWM的原理，介紹一種根據(jù)負(fù)載的功率因子來決定電壓空間零矢量的分配與作用時間的SVPWM算法，使得橋臂開關(guān)在通過其電流最大時的一段連續(xù)時間內(nèi)沒有開關(guān)動作。這樣在提高開關(guān)頻率的同時減小了開關(guān)電
關(guān)鍵字： SVPWM FPGA 開關(guān)損耗算法

基于FPGA無線傳感器網(wǎng)絡(luò)MAC控制器的設(shè)計

摘要給出了一種由FPGA實(shí)現(xiàn)的無線傳感器網(wǎng)絡(luò)MAC控制器的設(shè)計方法，采用自頂向下的方法設(shè)計各個模塊，并在QuartusII8.0完成了仿真，該控制器主要支持IEEE802．15．4協(xié)議。測試結(jié)果表明，該MAC控制器支持20～250 kbmi
關(guān)鍵字： FPGA MAC 無線傳感器網(wǎng)絡(luò) 控制器

萊迪思獲得Flexibilis以太網(wǎng)交換IP核

　　萊迪思半導(dǎo)體公司和FLEXIBILIS Oy日前宣布了即可獲取Flexibilis以太網(wǎng)交換(FES)IP核。三速(10Mbps/100Mbps/1Gbps)FES IP核工作在以太網(wǎng)第2層，每個端口具有Gigabit的轉(zhuǎn)換能力。支持Gigabit光纖和Gigabit雙絞線銅以太網(wǎng)接口。支持的服務(wù)質(zhì)量高達(dá)每端口四個隊列。這些以太網(wǎng)交換IP核有五個版本，根據(jù)端口數(shù)和功能而不同：　
關(guān)鍵字：萊迪思 FPGA

基于FPGA的SoC原型驗(yàn)證的設(shè)計與實(shí)現(xiàn)

摘要：在SoC開發(fā)過程中，基于FPGA的原型驗(yàn)證是一種有效的驗(yàn)證方法，它不僅能加快SoC的開發(fā)，降低SoC應(yīng)用系統(tǒng)的開發(fā)成本，而且提高了流片的成功率。文章主要描述了基于FPGA的SoC原型驗(yàn)證的設(shè)計與實(shí)現(xiàn)，針對FPGA基驗(yàn)證
關(guān)鍵字： FPGA SoC 原型驗(yàn)證

基于FPGA的CAN總線控制器設(shè)計

摘要：使用Verilog HDL硬件描述語言完成了對CAN總線控制器的設(shè)計，能夠?qū)崿F(xiàn)符合CAN2．0A協(xié)議的所有功能。本總線控制器的外部接口采用Altera公司開發(fā)的Avalon總線接口，增強(qiáng)了控制器的應(yīng)用靈活性。本設(shè)計使用Modelsim
關(guān)鍵字： FPGA CAN 線控制器設(shè)計

OFDM水聲通信定時同步的FPGA實(shí)現(xiàn)

正交頻分復(fù)用(Orthogonal Frequency DivisionMultiplexing，OFDM)技術(shù)是一種多載波調(diào)制技術(shù)，它將寬帶信道分解為相互正交的一組窄帶子信道，利用各個子信道進(jìn)行并行數(shù)據(jù)傳輸，因此其頻譜利用率高、抗多徑衰落能力強(qiáng)。
關(guān)鍵字： FPGA 實(shí)現(xiàn) 同步定時水聲通信 OFDM

MSK信號檢測識別的FPGA實(shí)現(xiàn)

MSK信號檢測識別的FPGA實(shí)現(xiàn),采用MSK 調(diào)制的跳頻通信具有主瓣能量集中、旁瓣衰落滾降快、頻譜利用率高和抗干擾能力強(qiáng)等優(yōu)點(diǎn)，在軍事通信中應(yīng)用廣泛。如美軍現(xiàn)役的聯(lián)合戰(zhàn)術(shù)信息分發(fā)系統(tǒng)采用的通信信號，工作帶寬969~1 206 MHz，跳頻速率為70000 多
關(guān)鍵字： FPGA 實(shí)現(xiàn) 識別檢測信號 MSK

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fpga)介紹

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fpga)電路

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