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          基于FPGA實(shí)現(xiàn)多路模擬信號(hào)自適應(yīng)采集系統(tǒng)

          • 主要介紹基于FPGA實(shí)現(xiàn)多路模擬信號(hào)自適應(yīng)采集系統(tǒng)的設(shè)計(jì)。該系統(tǒng)主要包括軟件和硬件兩部分:硬件主要采用FPGA芯片,AD7982-1,ADG406和運(yùn)放AD824來(lái)搭建硬件平臺(tái);軟件包括FPGA程序和事后數(shù)據(jù)處理程序。系統(tǒng)采用動(dòng)態(tài)8位量化方式克服了固定8位量化對(duì)信號(hào)采集精度的影響,目前已成功用于產(chǎn)品中。
          • 關(guān)鍵字: FPGA  多路  采集系統(tǒng)  模擬信號(hào)    

          低碼率語(yǔ)音編碼MELP聲碼器的SOPC實(shí)現(xiàn)

          • 摘要:討論了低碼率語(yǔ)音編碼MELP的編解碼過(guò)程,有效降低了語(yǔ)音編碼碼率并能使說(shuō)話者個(gè)人語(yǔ)音特征減弱,特...
          • 關(guān)鍵字: SOPC  MELP  語(yǔ)音編碼  FPGA  NiosII  

          SignalTapII ELA的FPGA在線調(diào)試技術(shù)

          • 通過(guò)對(duì)FPGA內(nèi)部信號(hào)的捕獲測(cè)試,可以實(shí)現(xiàn)對(duì)系統(tǒng)設(shè)計(jì)缺陷的實(shí)時(shí)分析和修正。與外部測(cè)試設(shè)備相比,可以總結(jié)出SignalTapII ELA的幾點(diǎn)優(yōu)越性:不占用額外的I/O引腳,不占用PCB上的空間,不破壞信號(hào)的時(shí)序和完整性,不需額外費(fèi)用;從多方面證實(shí),該測(cè)試手段可以減少調(diào)試時(shí)間,縮短設(shè)計(jì)周期。
          • 關(guān)鍵字: SignalTapII  FPGA  ELA  在線調(diào)試    

          高校電子技術(shù)論壇——走進(jìn)電子科技大學(xué)圖片新聞

          •   5月21日14時(shí),由電子產(chǎn)品世界及抗干擾實(shí)驗(yàn)室主辦的EEPW技術(shù)論壇走進(jìn)電子科技大學(xué),于清水河校區(qū)圖書(shū)館二樓報(bào)告廳為我們舉辦了名為“高校電子技術(shù)論壇----走進(jìn)電子科技大學(xué)”系列報(bào)告。來(lái)自LeCroy公司、ARM公司、Texas Instrument公司的資深工程師就當(dāng)前最前沿的技術(shù)及最新的科技發(fā)展動(dòng)向進(jìn)行了詳細(xì)的介紹和深刻的剖析。以下是關(guān)于本次報(bào)告的精彩圖集: 校園海報(bào) 校園廣告牌 論壇現(xiàn)場(chǎng)主要負(fù)責(zé)人 簽到 等待 閱讀 ? &
          • 關(guān)鍵字: ARM  嵌入式  高校電子技術(shù)論壇  

          誰(shuí)會(huì)在代工投資“盛宴”中缺席?

          •   在前3年之前全球代工總是在看前4大的動(dòng)向,包括臺(tái)積電、聯(lián)電、中芯國(guó)際及特許。然而,臺(tái)積電一家獨(dú)大,聯(lián)電居老二似乎也相安無(wú)事。   自AMD分出Globalfoundries,及ATIC又兼并特許,再把Globalfoundries與特許合并在一起。表面上看少了一個(gè)特許,實(shí)際上由于Globalfoundries在其金主支持下積極建新廠,在代工業(yè)界引發(fā)了波浪,至少誰(shuí)將成為老二成為話題。   加上存儲(chǔ)器大享三星近期開(kāi)始投資代工,放言要接高通的手機(jī)芯片訂單;加上fabless大廠Xilinx改變策略,把2
          • 關(guān)鍵字: 臺(tái)積電  FPGA  28nm  

          基于FPGA的RS485接口誤碼測(cè)試儀的設(shè)計(jì)和實(shí)現(xiàn)

          • 介紹了一種基于FPGA的誤碼測(cè)試儀的設(shè)計(jì)原理、實(shí)現(xiàn)過(guò)程及調(diào)試經(jīng)驗(yàn)。該誤碼測(cè)試系統(tǒng)使用RS485接口,具有原理簡(jiǎn)單、接口獨(dú)特、功能豐富等特點(diǎn),系統(tǒng)具有較好的可擴(kuò)展性。
          • 關(guān)鍵字: FPGA  485  RS  接口    

          子帶分解的自適應(yīng)濾波器的FPGA實(shí)現(xiàn)

          • 基于子帶分解的自適應(yīng)濾波器在提高收斂性能的同時(shí)又可以節(jié)省一定的計(jì)算量。采用Altera公司的仿真軟件Altera DSP Builder和QuartusⅡ7.2進(jìn)行子帶分解的NLMS算法的自適應(yīng)濾波器現(xiàn)場(chǎng)可編程門(mén)陣列設(shè)計(jì),利用Simulink和ModelSim對(duì)設(shè)計(jì)方案進(jìn)行了模型仿真和功能仿真,達(dá)到較好的效果。
          • 關(guān)鍵字: FPGA  分解  自適應(yīng)濾波器    

          常用FPGA/CPLD四種設(shè)計(jì)技巧

          • 常用FPGA/CPLD四種設(shè)計(jì)技巧,FPGA/CPLD的設(shè)計(jì)思想與技巧是一個(gè)非常大的話題,本文僅介紹一些常用的設(shè)計(jì)思想與技巧,包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意,如果能有意識(shí)地利用這些原則指導(dǎo)日
          • 關(guān)鍵字: 技巧  設(shè)計(jì)  FPGA/CPLD  常用  

          AEMB軟核處理器的SoC系統(tǒng)驗(yàn)證平臺(tái)的構(gòu)建

          基于FPGA的RS485接口誤碼測(cè)試儀的設(shè)計(jì)

          • 摘要:介紹了一種基于FPGA的誤碼測(cè)試儀的設(shè)計(jì)原理、實(shí)現(xiàn)過(guò)程及調(diào)試經(jīng)驗(yàn)。該誤碼測(cè)試系統(tǒng)使用RS485接口...
          • 關(guān)鍵字: FPGA  RS485  誤碼測(cè)試儀  

          可實(shí)現(xiàn)快速鎖定的FPGA片內(nèi)延時(shí)鎖相環(huán)設(shè)計(jì)

          • 摘要:延時(shí)鎖相環(huán)(DLL)是一種基于數(shù)字電路實(shí)現(xiàn)的時(shí)鐘管理技術(shù)。DLL可用以消除時(shí)鐘偏斜,對(duì)輸入時(shí)鐘進(jìn)行分頻、倍頻、移相等操作。文中介紹了FPGA芯片內(nèi)DLL的結(jié)構(gòu)和設(shè)計(jì)方案,在其基礎(chǔ)上提出可實(shí)現(xiàn)快速鎖定的延時(shí)鎖相環(huán)
          • 關(guān)鍵字: FPGA  延時(shí)  鎖相環(huán)    

          ARM:明年50%平板機(jī)用我們的處理器

          •   據(jù)報(bào)道,ARM移動(dòng)運(yùn)算部門(mén)主管Bob Morris近日表示,明年將有50%的平板機(jī)采用其處理器平臺(tái)。Morris稱(chēng),今年平板機(jī)出貨量預(yù)計(jì)在400萬(wàn)臺(tái),這一數(shù)字將在明年上升至2100萬(wàn)臺(tái),其中有將近40款基于ARM處理器的平板機(jī)上市。   Morris還表示,包括聯(lián)想、戴爾、惠普和夏普在內(nèi)一線廠商已經(jīng)采用其處理器設(shè)計(jì)智能本和平板機(jī)產(chǎn)品。   ARM也為即將召開(kāi)的臺(tái)北電腦展預(yù)熱,展示了采用ARM處理器與Android操作系統(tǒng)的平板機(jī)和電子書(shū)閱讀器,其中涉及一款7寸平板機(jī),它可支持高 清視頻播放,不過(guò)具
          • 關(guān)鍵字: ARM  處理器  

          使用SignalTap II邏輯分析儀調(diào)試FPGA

          • 摘 要 :本文介紹了可編程邏輯器件開(kāi)發(fā)工具Quartus II 中SingalTap II 嵌入式邏輯分析器的使用,并給出一個(gè)具體的設(shè)計(jì)實(shí)例,詳細(xì)介紹使用SignalTap II對(duì)FPGA調(diào)試的具體方法和步驟。
            關(guān)鍵字 : SignalTap;硬件調(diào)試
          • 關(guān)鍵字: SignalTap  FPGA  邏輯分析儀  調(diào)試    
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