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	fpga+mpu+mcu
          

          
	
          
    	
          
    	  	
          
              	
                                
          
                  

                                
          
                    
          基于FPGA的短波通信接收機
          
                                                            
                                        
            
                    	
          • 　　短波通信又稱高頻通信，是利用HF波段(3-30MHz)電磁波進行的無線電通信。短波通信主要靠天波傳播，可經電離層一次或數次反射，最遠可傳至上萬里，如按氣候、電離層的電子密度和高度的日變化以及通信距離等因素選擇合適頻率，就可用較小功率進行遠距離通信。短波通信設備較簡單，機動性大，因此也適應于應急通信和抗災通信?，F(xiàn)代短波通信接收機正向著數字化、大通信帶寬方向發(fā)展。文獻[1-3]研究了短波通信的數字化實現(xiàn)方式，但其未對短波通信的大帶寬應用進行探討;文獻[4-6]研究了通信信道化算法，其對一定帶寬內的多信道高
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          • 關鍵字：
                        FPGA  接收機                          
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          FPGA的FIR抽取濾波器設計
          
                                                            
                                        
            
                    	
          • 　　用FPGA實現(xiàn)抽取濾波器比較復雜，主要是因為在FPGA中缺乏實現(xiàn)乘法運算的有效結構，現(xiàn)在，F(xiàn)PGA中集成了硬件乘法器，使FPGA在數字信號處理方面有了長足的進步。本文介紹了一種采用Xilinx公司的XC2V1000實現(xiàn)FIR抽取濾波器的設計方法。
　　具體實現(xiàn)
　　結構設計
　　基于抽取濾波器的工作原理，本文采用XC2V1000實現(xiàn)了一個抽取率為2、具有線性相位的3階FIR抽取濾波器，利用原理圖和VHDL共同完成源文件設 計。圖1是抽取濾波器的頂層原理圖。其中，clock是工作時鐘，reset是
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          • 關鍵字：
                        FPGA  FIR                          
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          FPGA四大設計要點解析及應用方案集錦
          
                                                            
                                        
            
                    	
          • 　　本文敘述概括了FPGA應用設計中的要點，包括，時鐘樹、FSM、latch、邏輯仿真四個部分。
　　FPGA的用處比我們平時想象的用處更廣泛，原因在于其中集成的模塊種類更多，而不僅僅是原來的簡單邏輯單元(LE)。早期的FPGA相對比較簡單，所有的功能單元僅僅由管腳、內部buffer、LE、RAM構建而成，LE由LUT(查找表)和D觸發(fā)器構成，RAM也往往容量非常小。現(xiàn)在的FPGA不僅包含以前的LE，RAM也更大更快更靈活，管教IOB也更加的復雜，支持的IO類型也更多，而且內部還集成了一些特殊功能單元，
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          • 關鍵字：
                        FPGA  FSM  時鐘樹  仿真                          
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          【從零開始走進FPGA】非同于MCU的獨立按鍵消抖動
          
                                                            
                                        
            
                    	
          • 　進入電子，無處不用到按鍵， FPGA中的按鍵消抖動更是非同一般，并針對不同情況有相應的對策。
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          • 關鍵字：
                        FPGA  MCU  按鍵消抖                          
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          權威調查（七）：軟件是促成更多客戶使用FPGA的原因
          
                                                            
                                        
            
                    	
          • 　　Xilinx亞太區(qū)銷售及市場副總裁楊飛在2014歲末如此總結：以前FPGA廠商的目標是填補ASIC和ASSP空白，現(xiàn)在我們說取代ASIC、ASSP，而我們現(xiàn)在要做的就是，不僅是硬件，還有軟件方面，讓系統(tǒng)級的架構工程師和軟件編程工程師也能夠直接使用FPGA?！　ilinx亞太區(qū)銷售及市場副總裁楊飛　　因為FPGA到今天為止，從來不乏風險投資公司的介入，但是三十多年以來，初創(chuàng)企業(yè)總是做不成、長不大，根本原因和最大挑戰(zhàn)不是說FPGA公司是硬件公司，因為我們根本是一家搞軟件的公司。FPGA就是把硬件變成軟件
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          • 關鍵字：
                        Xilinx  FPGA  NI                          
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          在使用CNN算法的云數據中心，Altera FPGA實現(xiàn)的加速功能具有優(yōu)異的每瓦性能
          
                                                            
                                        
            
                    	
          • 　　Altera公司今天宣布，微軟采用Altera Arria® 10 FPGA (現(xiàn)場可編程門陣列)實現(xiàn)基于CNN (卷積神經網絡)算法的數據中心加速功能，其每瓦性能非常優(yōu)異。這些算法通常用于圖像分類、圖像識別，以及自然語言處理等。
　　微軟研究人員在云技術上不斷取得進展，采用Arria 10開發(fā)套件和Arria 10 FPGA工程樣片，展示了每瓦40 GFLOPS的性能——數據中心業(yè)界最好的性能水平。而且，與GPGPU相比，在CNN平臺上，這一FPGA的性能功耗比是C
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          • 關鍵字：
                        Altera  FPGA                          
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          一種面向云架構的高性能網絡接口實現(xiàn)技術
          
                                                            
                                        
            
                    	
          • 　　0概述
　　在傳統(tǒng)的電信IT產品中，高性能網絡接口一般采用特殊的硬件模塊來實現(xiàn)，比如網絡處理器、ASIC、FPGA等等。這些特殊硬件模塊一般會采用特殊的架構和指令集對網絡數據收發(fā)過程進行優(yōu)化以達到更好的性能。然而，這也相應使得開發(fā)和維護這些模塊的成本非常的昂貴，同時還有一個無法解決的問題是基于這些特殊硬件模塊實現(xiàn)的網絡接口不能移植到云中，因為它們跟硬件的耦合度太高了。摩爾定律的出現(xiàn)，使得通用處理器的性能得到了極大的提升，這也為基于通用處理器實現(xiàn)高性能網絡接口提供了可能，同時也為移植到云中提供了前提條
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          • 關鍵字：
                        網絡接口  FPGA                          
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          Altera宣布通過與Mentor Graphics合作，推出業(yè)界領先的SoC FPGA系列產品虛擬原型
          
                                                            
            
                    	
          • 　　Altera公司今天宣布，與Mentor Graphics合作為嵌入式軟件開發(fā)人員提供同類最佳的Vista®虛擬平臺，它支持Altera全系列SoC FPGA，包括具有64位四核ARM® Cortex-A53處理器的第三代14 nm Stratix® 10 SoC。這些先進的SoC虛擬平臺加速了整個產品生命周期中嵌入式軟件的開發(fā)，顯著縮短了產品面市時間，同時降低了成本。
　　Mentor Graphics Vista SoC虛擬平臺是經過預先開發(fā)的全功能ARM處理器子系統(tǒng)仿真
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          • 關鍵字：
                        Altera  Mentor Graphics  FPGA                          
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          Altera發(fā)售20 nm SoC
          
                                                            
            
                    	
          • 　　Altera公司今天開始發(fā)售其第二代SoC系列，進一步鞏固了在SoC FPGA產品上的領先地位。Arria? 10 SoC是業(yè)界唯一在20 nm FPGA架構上結合了ARM?處理器的可編程器件。與前一代SoC FPGA相比，Arria 10 SoC進行了全面的改進，支持實現(xiàn)性能更好、功耗更低、功能更豐富的嵌入式系統(tǒng)。Altera將在德國紐倫堡舉行的嵌入式世界2015大會上展示其基于SoC的解決方案，包括業(yè)界唯一的20 nm SoC FPGA。
　　Altera的SoC產品市場資深總監(jiān)
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          • 關鍵字：
                        Altera  SoC  FPGA                          
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          工程師分享：如何正確選擇電源模塊？
          
                                                            
                                        
            
                    	
          • 　　也許你常常會發(fā)現(xiàn)自己面臨相當緊張的項目最后期限要求。舉例來說，你的經理剛給你布置了為一個新電信系統(tǒng)設計電源的任務。設計從在FPGA上實現(xiàn)的概念證明開始，現(xiàn)在到了必須創(chuàng)造電源的時候。一個隔離式電源模塊提供12V電源，為先進的ASIC、微控制器、FPGA和各種其他元件供電。一如既往，這些元件實際上充滿了電路板的空間，提供充分的電力、穩(wěn)定性、熱性能、低噪聲及可靠性需要挑戰(zhàn)物理定律。而你只有一個星期時間來創(chuàng)造這個電源。(嘆息)沒錯，就是這樣，好戲開場了!
　　由于ASIC、微控制器和FPGA的大電流要求，你
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          • 關鍵字：
                        FPGA  電源                          
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          軟硬兼顧 低功耗MCU設計考慮
          
                                                            
            
                    	
          • 　　電子產品的低功耗問題經常讓產品設計者頭痛而又不得不面對。以單片機(MCU)為核心的系統(tǒng)，其功耗主要由單片機功耗和單片機外圍電路功耗組成。要降低單片機系統(tǒng)的功耗，需要從硬件和軟件兩方面入手。
　　硬件設計考慮因素
　　要滿足單片機系統(tǒng)的低功耗要求，選用具有低功耗特性的單片機可以很容易實現(xiàn)(例如，Siliconlaboratories設計的高速C8051F($8.5125)系列單片機)。因為具有低功耗特性的單片機可以大大降低系統(tǒng)功耗，這可以從單片機的供電電壓、內部結構、系統(tǒng)時鐘和低功耗模式等幾方面來考
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          • 關鍵字：
                        MCU  低功耗                          
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          FPGA在數字信號處理中的簡單應用
          
                                                            
                                        
            
                    	
          • 　　數字信號處理技術已經成功運用于信號地濾波、語音、圖像、音頻、信息系統(tǒng)、控制和儀表設備。可編程數字信號處理器在20 世紀70 年代地引入更是使DSP 技術突飛猛進，取得巨大成功，這些PDSP 都是基于精簡指令集(RISC)計算機范例的架構。它的優(yōu)勢源于大多說信號處理算法的乘-累加運算(MAC)都是非常密集的。通過多級流水線架構，PDSP 可以獲得僅受陣列乘法器的速度限制的MAC 速度。由此可以認為FPGA 也能夠用來實現(xiàn)MAC 單元，且具有速度優(yōu)勢，但是，如果PDSP 能夠滿足所需要的MAC 速度，那么
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          • 關鍵字：
                        FPGA  信號處理                          
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          FPGA四大設計要點解析
          
                                                            
            
                    	
          • 　　本文敘述概括了FPGA應用設計中的要點，包括，時鐘樹、FSM、latch、邏輯仿真四個部分。
　　FPGA的用處比我們平時想象的用處更廣泛，原因在于其中集成的模塊種類更多，而不僅僅是原來的簡單邏輯單元(LE)。
　　早期的FPGA相對比較簡單，所有的功能單元僅僅由管腳、內部buffer、LE、RAM構建而成，LE由LUT(查找表)和D觸發(fā)器構成，RAM也往往容量非常小。
　　現(xiàn)在的FPGA不僅包含以前的LE，RAM也更大更快更靈活，管教IOB也更加的復雜，支持的IO類型也更多，而且內部還集成了一
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          • 關鍵字：
                        FPGA  Testbench                          
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          經驗總結：FPGA時序約束的6種方法
          
                                                            
            
                    	
          • 　　對自己的設計的實現(xiàn)方式越了解，對自己的設計的時序要求越了解，對目標器件的資源分布和結構越了解，對EDA工具執(zhí)行約束的效果越了解，那么對設計的時序約束目標就會越清晰，相應地，設計的時序收斂過程就會更可控。
　　下文總結了幾種進行時序約束的方法。按照從易到難的順序排列如下：
　　0. 核心頻率約束
　　這是最基本的，所以標號為0。
　　1. 核心頻率約束+時序例外約束
　　時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但這還不是最完整的時序
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          • 關鍵字：
                        FPGA  時序約束                          
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          零基礎學FPGA（十五）Testbenth 很重要，前仿真全過程筆記（上篇）
          
                                                            
                                        
            
                    	
          • 　　上一篇文章我介紹了一下一片簡易CPU的設計，今天的課程我講仿真，也即前仿真。這次課程，小墨同學將和大家從建立工程開始，一步步梳理testbench的書寫過程，幫助大家對仿真有一個深刻的概念。以后在做項目時，不要動不動就把程序下到板子里調試，看問題不對再去改程序，再下到板子里調試，如此往返，會浪費大量的時間，簡單的項目還好，但是到了大型項目的話，是不可能有這么多時間讓我們這樣調的。因此，小墨同學在這里說，testbench很重要，做好了仿真，可以為我們節(jié)約大量的開發(fā)時間。
　　下面我們開始吧~
　　
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          • 關鍵字：
                        FPGA  Testbenth                           
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          fpga+mpu+mcu介紹
          
      			
          
		      	
          
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