fpga+mpu+mcu 文章進(jìn)入fpga+mpu+mcu技術(shù)社區(qū)

如何選擇合適的微控制器

微控制器無(wú)處不在，其使用范圍也在不斷擴(kuò)大。但對(duì)其特性和潛在使用場(chǎng)景的深入理解，可以幫助我們?cè)谶x擇和部署這項(xiàng)技術(shù)時(shí)做出更明智的決策。微控制器還是微處理器：做出正確選擇首先要考慮的問(wèn)題是，你需要的是微控制器還是微處理器？這兩者雖然有些相似，但在使用場(chǎng)景上有所重疊，因此理解它們的相對(duì)優(yōu)勢(shì)是必要的第一步。微處理器通常只有一個(gè)處理核心（CPU），一般來(lái)說(shuō)，足夠強(qiáng)大，可以處理涉及大量?jī)?nèi)存的復(fù)雜應(yīng)用程序。它們是面向通用應(yīng)用的。而微控制器則包括CPU、內(nèi)存和輸入輸出（I/O），足夠支持單一或少量功能或應(yīng)用，例如醫(yī)療設(shè)備或
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Arm Cortex-M0+及其功能

Arm Cortex-M0+是一種可靠的架構(gòu)，具有低功耗需求，并在緊湊而高效的形式下提供32位功能。Cortex-M0+并不是最新的小型低功耗處理器，事實(shí)上，一些更新的產(chǎn)品可能已經(jīng)超過(guò)了它。然而，由于其廣泛的部署和成熟的環(huán)境，Cortex-M0+仍然是低功耗應(yīng)用的有力選擇。那么，Cortex-M0+有哪些重要特性呢？Cortex-M處理器系列整體上旨在滿足市場(chǎng)對(duì)低功耗和低成本設(shè)備的需求，因此適用于廣泛的應(yīng)用場(chǎng)景。Cortex-M0+處理器進(jìn)一步發(fā)展了這一系列，提供了最小的占用面積和最低的功耗。這使得Cor
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萊迪思Avant-X：捍衛(wèi)數(shù)字前沿

現(xiàn)場(chǎng)可編程門陣列（FPGA）在當(dāng)今的眾多技術(shù)中發(fā)揮著重要作用。從航空航天和國(guó)防到消費(fèi)電子產(chǎn)品，再到關(guān)鍵基礎(chǔ)設(shè)施和汽車行業(yè)，F(xiàn)PGA在我們生活中不斷普及。與此同時(shí)對(duì)FPGA器件的威脅也在不斷增長(zhǎng)。想要開(kāi)發(fā)在FPGA上運(yùn)行（固件）的IP需要花費(fèi)大量資源，受這些FPGA保護(hù)的技術(shù)也是如此。這使得FPGA成為IP盜竊或破壞的潛在目標(biāo)。防止IP盜竊、客戶數(shù)據(jù)泄露和系統(tǒng)整體完整性所需的安全功能已經(jīng)不可或缺。它們是許多FPGA應(yīng)用的基礎(chǔ)，在某些地區(qū)有相應(yīng)法律要求（例如，歐盟的GDPR、美國(guó)的HIPAA、英國(guó)的2018年
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【實(shí)戰(zhàn)】一個(gè)Buck電路設(shè)計(jì)的完整過(guò)程

設(shè)計(jì)需求：硬十開(kāi)發(fā)的一塊基于安路EG4X20BG256的FPGA板卡。該系統(tǒng)應(yīng)用于一個(gè)USB傳輸，可以進(jìn)行多通道ADC數(shù)據(jù)采集的項(xiàng)目。整體框圖如下：實(shí)物如下：1、Buck控制器選型電源框圖制作過(guò)程，可以參考前期文檔：硬件總體設(shè)計(jì)之 “專題分析”我們可以看到在電源樹(shù)中，分別需要實(shí)現(xiàn)：5V→3.3V@2A5V→1.2V@2A5V→2.5V@2A此處我們選型的Buck電源控制器（集成Mosfet）是杰華特的JW5359從Datasheet我們可以看到：1、輸入電壓范圍滿足要求4.5V~18V2、輸出電流可以達(dá)到
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將ASIC IP核移植到FPGA上——更新概念并推動(dòng)改變以完成充滿挑戰(zhàn)的任務(wù)!

本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來(lái)開(kāi)發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問(wèn)題。文章從介紹使用預(yù)先定制功能即IP核的必要性開(kāi)始，通過(guò)闡述開(kāi)發(fā)ASIC原型設(shè)計(jì)時(shí)需要考慮到的IP核相關(guān)因素，用八個(gè)重要主題詳細(xì)分享了利用ASIC所用IP來(lái)在FPGA上開(kāi)發(fā)原型驗(yàn)證系統(tǒng)設(shè)計(jì)時(shí)需要考量的因素。在上篇文章中，我們介紹了將ASIC IP移植到FPGA原型平臺(tái)上的必要性，并對(duì)原型設(shè)計(jì)中各種考量因素進(jìn)行了總體概述，分析開(kāi)發(fā)A
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基于UART/USART的串口通信協(xié)議設(shè)計(jì)與實(shí)現(xiàn)

串口通信在嵌入式系統(tǒng)中廣泛使用，而設(shè)計(jì)合適的通信協(xié)議對(duì)于確保數(shù)據(jù)的可靠傳輸至關(guān)重要。本文將探討如何基于UART/USART實(shí)現(xiàn)一種簡(jiǎn)單而有效的串口通信協(xié)議，包括數(shù)據(jù)幀結(jié)構(gòu)、校驗(yàn)方法、通信流程等，旨在幫助開(kāi)發(fā)者設(shè)計(jì)高效穩(wěn)定的串口通信系統(tǒng)。一、背景介紹串口通信是嵌入式系統(tǒng)中常用的一種通信方式，而UART（通用異步收發(fā)器）和USART（通用同步和異步收發(fā)器）是其中常見(jiàn)的串口通信接口。設(shè)計(jì)一種有效的串口通信協(xié)議可以提高系統(tǒng)的可靠性和穩(wěn)定性，確保數(shù)據(jù)的準(zhǔn)確傳輸。二、串口通信協(xié)議設(shè)計(jì)1. **數(shù)據(jù)幀結(jié)構(gòu)設(shè)計(jì)：**數(shù)據(jù)
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國(guó)產(chǎn)FPGA，走到哪一步了？

隨著人工智能（AI）技術(shù)的飛速發(fā)展，其應(yīng)用邊界不斷拓寬，從簡(jiǎn)單的圖像識(shí)別到復(fù)雜的自然語(yǔ)言處理，再到自動(dòng)駕駛、智能制造等前沿領(lǐng)域，AI 正以前所未有的速度改變著我們的世界。在這場(chǎng) AI 革命中，深度學(xué)習(xí)作為其核心驅(qū)動(dòng)力，不斷推動(dòng)著算法與模型的革新，同時(shí)也對(duì)計(jì)算資源提出了更為嚴(yán)苛的要求。誕生于 1985 年的 FPGA 雖然問(wèn)世時(shí)間不長(zhǎng)，但已經(jīng)憑借「可編程」的獨(dú)特優(yōu)勢(shì)，在百花齊放的芯片浪潮中奪得一席之地，成為 GPU 芯片的又一勁敵。FPGA 的特點(diǎn)FPGA 芯片是基于可編程器件（PAL、GAL、CPLD）發(fā)
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自主研發(fā)！國(guó)芯新一代汽車電子高性能MCU新產(chǎn)品流片、測(cè)試成功

7月29日消息，據(jù)蘇州國(guó)芯科技官網(wǎng)介紹，近日，由國(guó)芯科技研發(fā)的新一代汽車電子高性能MCU新產(chǎn)品CCFC3012PT流片和測(cè)試成功。據(jù)悉，國(guó)芯科技本次內(nèi)部測(cè)試成功的汽車電子高性能MCU新產(chǎn)品CCFC3012PT是基于公司自主PowerPC架構(gòu)C*Core CPU內(nèi)核研發(fā)的新一代多核MCU芯片。適用于智能化汽車輔助駕駛、智能座艙以及高集成度域控制器等應(yīng)用，可以更好地滿足客戶更高算力、更高信息安全等級(jí)和更高功能安全等級(jí)的應(yīng)用需求。該芯片基于40nm eFlash工藝開(kāi)發(fā)和生產(chǎn)，內(nèi)嵌10個(gè)運(yùn)算CPU核C3007，
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Ceva低功耗藍(lán)牙和802.15.4 IP為Alif Semiconductor的Balletto系列MCU帶來(lái)超低功耗無(wú)線連接能力

幫助智能邊緣設(shè)備更可靠、更高效地連接、感知和推斷數(shù)據(jù)的全球領(lǐng)先半導(dǎo)體產(chǎn)品和軟件IP授權(quán)許可廠商Ceva公司宣布世界領(lǐng)先的安全、互聯(lián)、高功效人工智能和機(jī)器學(xué)習(xí)(AI/ML)微控制器(MCU)及融合處理器供應(yīng)商Alif Semiconductor?已經(jīng)獲得授權(quán)許可，在其Balletto?系列無(wú)線微控制器中部署使用Ceva-Waves 低功耗藍(lán)牙和802.15.4 IP。Balletto系列是面向聯(lián)機(jī)物聯(lián)網(wǎng)平臺(tái)的完整邊緣 AI/ML 微控制器解決方案，集成了低功耗藍(lán)牙 5.3 和 802.15.4 無(wú)線子系統(tǒng)以
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將ASIC IP核移植到FPGA上——明了需求和詳細(xì)規(guī)劃以完成充滿挑戰(zhàn)的任務(wù)

本文從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來(lái)開(kāi)發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問(wèn)題。文章從介紹使用預(yù)先定制功能即IP核的必要性開(kāi)始，通過(guò)闡述開(kāi)發(fā)ASIC原型設(shè)計(jì)時(shí)需要考慮到的IP核相關(guān)因素，用八個(gè)重要主題詳細(xì)分享了利用ASIC所用IP來(lái)在FPGA上開(kāi)發(fā)原型驗(yàn)證系統(tǒng)設(shè)計(jì)時(shí)需要考量的因素。本篇文章是SmartDV數(shù)字芯片設(shè)計(jì)經(jīng)驗(yàn)分享系列文章的第一篇，作為全球領(lǐng)先的驗(yàn)證解決方案和設(shè)計(jì)IP提供商，SmartDV的產(chǎn)品研發(fā)及
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萊迪思全新推出邏輯優(yōu)化的通用FPGA拓展其小型FPGA產(chǎn)品組合

萊迪思半導(dǎo)體，低功耗可編程器件的領(lǐng)先供應(yīng)商，今日宣布為其領(lǐng)先的小尺寸FPGA產(chǎn)品中再添一款邏輯優(yōu)化的全新萊迪思Certus-NX? FPGA器件。新產(chǎn)品包括兩款新器件，即Certus-NX-28?和Certus-NX-09?，擁有多種封裝選項(xiàng)，可提供行業(yè)領(lǐng)先的低功耗、小尺寸和可靠性以及靈活的遷移選項(xiàng)。這些器件旨在加速?gòu)V泛的通信、計(jì)算、工業(yè)和汽車應(yīng)用。萊迪思半導(dǎo)體產(chǎn)品營(yíng)銷副總裁Dan Mansur表示：“萊迪思致力于在小型、低功耗FPGA領(lǐng)域持續(xù)創(chuàng)新，為我們的客戶提供優(yōu)化的解決方案，滿足空間受限的應(yīng)用需求，
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STM32H5：新一代高性能MCU，提供極致性價(jià)比

在飛速迭代的電子科技版圖中，微控制器作為電子設(shè)備的中樞神經(jīng)系統(tǒng)，其卓越的性能與堅(jiān)不可摧的安全性構(gòu)成了支撐整個(gè)系統(tǒng)高效運(yùn)行與數(shù)據(jù)嚴(yán)密防護(hù)的基石。近年來(lái)，物聯(lián)網(wǎng)技術(shù)的井噴式發(fā)展，對(duì)MCU的性能標(biāo)準(zhǔn)提出了更為嚴(yán)苛的要求，尤其是在工業(yè)應(yīng)用的前沿陣地，安全、效能卓越且設(shè)計(jì)靈活的MCU已成為市場(chǎng)競(jìng)相追逐的焦點(diǎn)。鑒于此，ST憑借深厚的技術(shù)積累，重磅推出了STM32H5系列新一代高性能MCU，該系列專為加速安全導(dǎo)向的工業(yè)應(yīng)用設(shè)計(jì)而生，旨在為開(kāi)發(fā)者開(kāi)辟前所未有的設(shè)計(jì)創(chuàng)新空間，并構(gòu)筑起堅(jiān)不可摧的安全防線。STM32H5系列不
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單片機(jī)獨(dú)立看門狗和窗口看門狗的區(qū)別

早期的MCU沒(méi)有看門狗，就容易引起有些產(chǎn)品死機(jī)了不能重啟工作。為了避免這個(gè)問(wèn)題，后期的MCU在內(nèi)部集成了看門狗的功能。為了滿足更多使用場(chǎng)景，現(xiàn)在很多MCU都集成了兩個(gè)看門狗：獨(dú)立看門狗與窗口看門狗。拿現(xiàn)在大家熟悉的STM32來(lái)說(shuō)，都集成了獨(dú)立看門狗和窗口看門狗，下面就展開(kāi)來(lái)講講這個(gè)兩個(gè)看門狗以及它們的區(qū)別。獨(dú)立看門狗獨(dú)立看門狗，顧名思義，就是獨(dú)立的一個(gè)看門狗，由其專用低速時(shí)鐘 (LSI) 驅(qū)動(dòng)，因此，即便在主時(shí)鐘發(fā)生故障時(shí)仍然保持工作狀態(tài)。IWDG 最適合應(yīng)用于那些需要看門狗作為一個(gè)在主程序之外，能夠完全
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好玩的項(xiàng)目|使用微控制器 PIC16F1459 構(gòu)建 DIP 開(kāi)關(guān) USB U盤

今天給大家分享我在github上看到的一個(gè)有意思的項(xiàng)目：使用微控制器 PIC16F1459 構(gòu)建 DIP 開(kāi)關(guān) USB U盤。（附帶電路原理圖，PCB布局設(shè)計(jì)，原始應(yīng)用程序。）主要是用撥片開(kāi)關(guān)來(lái)進(jìn)行配置設(shè)備，只需要撥動(dòng)紅色開(kāi)關(guān)就可以輕松配置文件。不需要編輯 XML 和 JSON 文件來(lái)存儲(chǔ)硬件或軟件的配置設(shè)置。這個(gè)項(xiàng)目分享給大家，步驟講解得很詳細(xì)，如果感興趣的可以動(dòng)手試試。先放上成品圖。DIP 開(kāi)關(guān)插電腦上圖DIP 開(kāi)關(guān) U 盤的后視圖和前視圖（顏值還挺高的）一、元件選擇作者總共設(shè)計(jì)制作了兩種不同版本的D
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利用強(qiáng)大的軟件設(shè)計(jì)工具為FPGA開(kāi)發(fā)者賦能

許多嵌入式系統(tǒng)的開(kāi)發(fā)者都對(duì)使用基于FPGA的SoC系統(tǒng)感興趣，但是基于傳統(tǒng)HDL硬件描述語(yǔ)言的FPGA開(kāi)發(fā)工具和復(fù)雜流程往往會(huì)令他們望而卻步。為了解決這一問(wèn)題，萊迪思的Propel工具套件提供了基于圖形化設(shè)計(jì)方法的設(shè)計(jì)環(huán)境，用于創(chuàng)建，分析，編譯和調(diào)試基于FPGA的嵌入式系統(tǒng)，從而完成系統(tǒng)軟硬件設(shè)計(jì)。萊迪思的Propel工具套件由兩部分組成：Propel Builder提供圖形化的SoC系統(tǒng)和硬件設(shè)計(jì)，通過(guò)拖放方式，選擇處理器和相關(guān)的外設(shè)與IP，通過(guò)圖形化的方式進(jìn)行配置和連接，從而完成系統(tǒng)層面的硬件設(shè)計(jì)；
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