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          解讀FPGA芯片SOPC發(fā)射端電路設(shè)計(jì)

          • 解讀FPGA芯片SOPC發(fā)射端電路設(shè)計(jì)-基于FPGA 芯片EP3C16Q240C8N 的片上可編程系統(tǒng),該系統(tǒng)可用于實(shí)現(xiàn)IFFT運(yùn)算和接口模塊,利用可嵌入到此FPGA 芯片的NiosII 軟核處理器來實(shí)現(xiàn)數(shù)據(jù)傳輸和控制。
          • 關(guān)鍵字: 智能硬件  MCU  FPGA  

          FPGA數(shù)字變換器控制電路設(shè)計(jì)攻略 —電路圖天天讀(102)

          • FPGA數(shù)字變換器控制電路設(shè)計(jì)攻略 —電路圖天天讀(102)-以FPGA為控制核心,開展數(shù)字量變換器測(cè)試系統(tǒng)設(shè)計(jì),系統(tǒng)通過USB 實(shí)現(xiàn)與計(jì)算機(jī)的通信,能夠產(chǎn)生計(jì)算機(jī)字信號(hào)及相應(yīng)移位脈沖信號(hào)、勤務(wù)信號(hào)和128路指令信號(hào),并能接收經(jīng)過數(shù)字量變換器變化后的計(jì)算機(jī)數(shù)碼和指令數(shù)碼信號(hào),測(cè)試系統(tǒng)能夠完成對(duì)數(shù)字量變換器各項(xiàng)性能指標(biāo)的測(cè)試。
          • 關(guān)鍵字: 數(shù)字信號(hào)處理器  FPGA  控制電路  

          解讀FPGA電容在線測(cè)試系統(tǒng)電路設(shè)計(jì)方案

          • 解讀FPGA電容在線測(cè)試系統(tǒng)電路設(shè)計(jì)方案-本文研究了一種電容在線測(cè)試方法,并以向FPGA內(nèi)植入Nios II軟核作為控制器,以控制信號(hào)源的發(fā)生與測(cè)試檔位的自動(dòng)切換。實(shí)驗(yàn)證明了該測(cè)試方法的可行性及較高的精準(zhǔn)度,達(dá)到了設(shè)計(jì)目的。
          • 關(guān)鍵字: 智能硬件  FPGA  測(cè)試測(cè)量  

          FPGA數(shù)碼相框電子電路設(shè)計(jì)大全 —電路圖天天讀(101)

          • FPGA數(shù)碼相框電子電路設(shè)計(jì)大全 —電路圖天天讀(101)-數(shù)碼相框同時(shí)還可以將靜態(tài)圖片提升為動(dòng)態(tài)的相冊(cè),攜帶方便,儲(chǔ)存時(shí)間長(zhǎng)遠(yuǎn),滿足于人們的需求,同時(shí)也會(huì)是一種節(jié)約型,環(huán)保低碳型的構(gòu)想。
          • 關(guān)鍵字: 控制電路  FPGA  數(shù)碼管  

          揭秘FPGA多重配置硬件電路設(shè)計(jì)方案

          • 揭秘FPGA多重配置硬件電路設(shè)計(jì)方案-當(dāng)FPGA 完成上電自動(dòng)加載初始化的比特流后,可以通過觸發(fā)FPGA 內(nèi)部的多重啟動(dòng)事件使得FPGA 從外部配置存儲(chǔ)器(SPI FLASH)指定的地址自動(dòng)下載一個(gè)新的比特流來重新配置。
          • 關(guān)鍵字: MCU  存儲(chǔ)器  FPGA  

          解讀FPGA設(shè)計(jì)程控濾波器系統(tǒng)電路

          • 解讀FPGA設(shè)計(jì)程控濾波器系統(tǒng)電路-設(shè)計(jì)了一個(gè)程控濾波器,實(shí)現(xiàn)了小信號(hào)程控放大、程控調(diào)整濾波器截止頻率和幅頻特性測(cè)試的功能。
          • 關(guān)鍵字: 智能硬件  濾波電路  FPGA  

          FPGA數(shù)據(jù)采集電子電路設(shè)計(jì)攻略 —電路圖天天讀(163)

          • FPGA數(shù)據(jù)采集電子電路設(shè)計(jì)攻略 —電路圖天天讀(163)-提出一種基于FPGA技術(shù)的多路數(shù)字量采集模塊,利用FPGA的I/O端口數(shù)多且可編程設(shè)置的特點(diǎn),配以VHDL編寫的 FPGA內(nèi)部邏輯,實(shí)現(xiàn)采集多路數(shù)字量信號(hào)。
          • 關(guān)鍵字: FPGA  MCU  智能硬件  

          FPGA開發(fā)外設(shè)子板模塊電路設(shè)計(jì)詳解 —電路圖天天讀(161)

          • FPGA開發(fā)外設(shè)子板模塊電路設(shè)計(jì)詳解 —電路圖天天讀(161)-FPGA以并行運(yùn)算為主,以硬件描述語言來實(shí)現(xiàn),相比于PC或單片機(jī)(無論是馮諾依曼結(jié)構(gòu)還是哈佛結(jié)構(gòu))的順序操作有很大區(qū)別,也造成了FPGA開發(fā)入門較難。
          • 關(guān)鍵字: FPGA  驅(qū)動(dòng)電路  智能硬件  

          想一次性流片成功 ASIC設(shè)計(jì)中這些問題不可忽視

          • 想一次性流片成功 ASIC設(shè)計(jì)中這些問題不可忽視-ASIC的復(fù)雜性不斷提高,同時(shí)工藝在不斷地改進(jìn),如何在較短的時(shí)間內(nèi)開發(fā)一個(gè)穩(wěn)定的可重用的ASIC芯片的設(shè)計(jì),并且一次性流片成功,這需要一個(gè)成熟的ASIC的設(shè)計(jì)方法和開發(fā)流程。
          • 關(guān)鍵字: asic  

          Xilinx擁抱軟件,擁抱云服務(wù)

          •   不久前,Xilinx在中國(guó)舉辦了首屆賽靈思開發(fā)者大會(huì)(XDF, Xilinx Developer Forum)。在北京站,電子產(chǎn)品世界編輯獲悉,Xilinx開發(fā)者正從以硬件為主,轉(zhuǎn)移到增加軟件開發(fā)者及其他開發(fā)者,預(yù)計(jì)未來五年用戶數(shù)將增加5倍,即從目前的5萬人增加到25萬人,并且在云服務(wù)方面下足了功夫,提出了FaaS(FPGA即服務(wù))理念?! ≌掌?Xilinx三位高管出席了XDF北京新聞發(fā)布會(huì)。從左至右:Xilinx戰(zhàn)略市場(chǎng)開發(fā)總監(jiān)Andy Walsh,IP及軟
          • 關(guān)鍵字: Xilinx  FPGA  

          首款定價(jià)5美金以下的SoC FPGA,安路實(shí)現(xiàn)了哪些突破?

          •   今年五月,上海安路信息科技有限公司(以下簡(jiǎn)稱“安路科技”) 完成了C輪融資,由“華大半導(dǎo)體有限公司”戰(zhàn)略領(lǐng)投,“上??萍紕?chuàng)業(yè)投資有限公司”跟投。該輪融資使安路科技搭上“國(guó)家隊(duì)”的快車,將保障安路技術(shù)團(tuán)隊(duì)能夠在充足資金的支持下,加速中高端FPGA產(chǎn)品研發(fā)、市場(chǎng)拓展以及團(tuán)隊(duì)擴(kuò)充。與此同時(shí),該輪融資也將加快國(guó)產(chǎn)FPGA對(duì)于國(guó)外進(jìn)口FPGA的替換和升級(jí)。   在“國(guó)家隊(duì)”加持下,安路科技研
          • 關(guān)鍵字: FPGA  SoC   

          用FPGA芯片實(shí)現(xiàn)高速異步FIFO的一種方法

          • 用FPGA芯片實(shí)現(xiàn)高速異步FIFO的一種方法-現(xiàn)代集成電路芯片中,隨著設(shè)計(jì)規(guī)模的不斷擴(kuò)大。一個(gè)系統(tǒng)中往往含有數(shù)個(gè)時(shí)鐘。多時(shí)鐘帶來的一個(gè)問題就是,如何設(shè)計(jì)異步時(shí)鐘之間的接口電路。異步 FIFO(First In First Out)是解決這個(gè)問題的一種簡(jiǎn)便、快捷的解決方案。
          • 關(guān)鍵字: FPGA  異步FIFO  
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