臺積電創(chuàng)建和交付本質(zhì)為基于SKILL語言的設(shè)計套件(PDKs)，為客戶提供最佳的用戶體驗和最高水準的精確度。

　　世界領(lǐng)先的晶圓代工廠部署Virtuoso平臺用于先進節(jié)點的定制設(shè)計需要， 涵蓋16納米FinFET設(shè)計。

　　主要工具包括Virtuoso Schematic Editor、Analog Design Environment、Virtuoso LayoutSuite XL和先進的GXL技術(shù)。

　　為專注于解決先進節(jié)點設(shè)計的日益復雜性，全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ:CDNS) 今天宣布，臺積電已與Cadence在Virtuoso定制和模擬設(shè)計平臺擴大合作以設(shè)計和驗證其尖端IP。此外，臺積電還將擴展其純正以本質(zhì)為基于SKILL語言的的工藝流程設(shè)計套件(PDKs)產(chǎn)品至16納米，創(chuàng)建并交付全面合格并高品質(zhì)的本質(zhì)為基于SKILL語言的的PDKs，可實現(xiàn)Virtuoso平臺所有的頂尖功能。為充分發(fā)揮最大性能和高品質(zhì)成果，新PDKs可驅(qū)動Virtuoso 12.1平臺中的尖端特性，例如自動對齊、在鄰接過程中自動處理復雜的規(guī)則、鏈接器件、支持色彩感知版圖設(shè)計和先進布線。

　　“我們將繼續(xù)加大投資升級Virtuoso平臺以解決與日俱增的設(shè)計挑戰(zhàn)。我們與臺積電和客戶緊密協(xié)作以加強和實現(xiàn)高級節(jié)點和主流設(shè)計的要求，”Cadence硅實現(xiàn)集團研發(fā)高級副總栽徐季平博士表示。“本質(zhì)為基于SKILL語言的為基礎(chǔ)的PDKs就是驅(qū)動Virtuoso方法發(fā)揮完全潛力的關(guān)鍵。”

　　“我們與Cadence在Virtuoso平臺有著長期的合作，”臺積電設(shè)計基礎(chǔ)架構(gòu)市場部高級總監(jiān)Suk Lee表示。“本質(zhì)為基于SKILL語言的PDK開發(fā)延伸至16納米使我們能夠滿足客戶在先進技術(shù)定制設(shè)計方面的需求。”