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ARM基礎(chǔ)知識連載（4）
- 在應(yīng)用程序中安裝異常中斷處理程序1.使用跳轉(zhuǎn)指令：可以在異常中斷對應(yīng)異常向量表中特定位置放置一條跳轉(zhuǎn)指令，直接跳轉(zhuǎn)到該異常中斷的處理程序。這種方法有一個缺點，即只能在32M空間范圍內(nèi)跳轉(zhuǎn)。2.使用數(shù)據(jù)讀取指令LDR：使用數(shù)據(jù)讀取指令LDR向程序計數(shù)器PC中直接賦值。這種方法分為兩步：先將異常中斷處理程序的絕對地址存放在存放在距離向量表4KB范圍內(nèi)的一個存儲單元中；再使用數(shù)據(jù)讀取指令LDR將該單元的內(nèi)容讀取到程序計數(shù)器PC中。 **在系統(tǒng)復(fù)位時安裝異常中斷處理程序**1.地址0x00處為ROM的情況&n
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ARM基礎(chǔ)知識連載（6）
- ***************************************************** ARM映像文件 ***************************************************** 1.ELF格式文件的結(jié)構(gòu) 1.1映像文件組成部分 **一個映像文件有一個或多個域組成**每個域包含一個或多個輸出段**每個輸出段包含一個或多個輸入段**各輸入段中包含了目標(biāo)文件中的代碼和數(shù)據(jù) 輸入段中包含了四類內(nèi)容：代碼、已經(jīng)初始化的數(shù)據(jù)、未經(jīng)初始化的存儲區(qū)域、內(nèi)
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ARM構(gòu)架在32位微控制器領(lǐng)域的應(yīng)用
- 摘要： 在標(biāo)準(zhǔn)微控制器的世界中，ARM體系結(jié)構(gòu)在32位嵌入式RISC領(lǐng)域有著極大的影響力。就像在8位世界中8051的廣泛應(yīng)用一樣，在32位微控制器領(lǐng)域里ARM得到了特別的青睞，并幾乎成為了事實上的標(biāo)準(zhǔn)。 關(guān)鍵字：ARM；32位微控制器 在標(biāo)準(zhǔn)微控制器的世界中，ARM體系結(jié)構(gòu)在32位嵌入式RISC領(lǐng)域有著極大的影響力。就像在8位世界中8051的廣泛應(yīng)用一樣，在32位微控制器領(lǐng)域里ARM得到了特別的青睞，并幾乎成為了事實上的標(biāo)準(zhǔn)。 對系統(tǒng)性能需求的提高和嵌入式功能的發(fā)展是促
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ARM簡介
- ARM（Advanced RISC Machines）是微處理器行業(yè)的一家知名企業(yè)，設(shè)計了大量高性能、廉價、耗能低的RISC處理器、相關(guān)技術(shù)及軟件。技術(shù)具有性能高、成本低和能耗省的特點。適用于多種領(lǐng)域，比如嵌入控制、消費/教育類多媒體、DSP和移動式應(yīng)用等。 ARM將其技術(shù)授權(quán)給世界上許多著名的半導(dǎo)體、軟件和OEM廠商，每個廠商得到的都是一套獨一無二的ARM相關(guān)技術(shù)及服務(wù)。利用這種合伙關(guān)系，ARM很快成為許多全球性RISC標(biāo)準(zhǔn)的締造者。 目
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基于FPGA的偽碼測距電路的設(shè)計與實現(xiàn)
- 1 引 言 現(xiàn)場可編程門陣列（FPGA）用硬件電路完成算法的過程，一方面解決了系統(tǒng)的開銷問題，提供了提高系統(tǒng)整體性能的條件，另一方面，由于靜態(tài)RAM型的FPGA具備可重構(gòu)特性，這使得資源利用率得到顯著提高。FPGA既具有通用計算系統(tǒng)的靈活性，又有專用處理系統(tǒng)的性能，對實現(xiàn)高性能信號處理具有很高的應(yīng)用價值，而且可重構(gòu)的特性使其可以根據(jù)算法來調(diào)整相應(yīng)的通信結(jié)構(gòu)和數(shù)據(jù)字長。FPGA以其高度的靈活性與硬件的高密度性在通信信號處理中得到了廣泛的應(yīng)用。 在對Xili
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FPGA創(chuàng)新中心落戶無錫國家集成電路設(shè)計基地
- 可編程解決方案領(lǐng)導(dǎo)廠商賽靈思公司（Xilinx）與無錫國家高新技術(shù)產(chǎn)業(yè)開發(fā)區(qū)管理委員會今天共同宣布成立無錫國家集成電路設(shè)計基地FPGA（現(xiàn)場可編程門陣列）創(chuàng)新中心，并隆重舉行賽靈思正式授權(quán)“無錫國家集成電路設(shè)計基地—賽靈思聯(lián)合實驗室”揭牌儀式。無錫新區(qū)管委會副主任朱曉紅以及賽靈思公司研究實驗室高級總監(jiān)、全球大學(xué)計劃負責(zé)人Patrick Lysaght等出席了成立大會并為聯(lián)合實驗室揭牌。 作為國家級的集成電路設(shè)計基地，新的FPGA創(chuàng)新中心的成立以及聯(lián)合實驗室的打造，意味著可編程設(shè)計在電子設(shè)計領(lǐng)域的
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FPGA：22年從配角到主角
- 任何一個從事后看來很成功的新事物從誕生到發(fā)展壯大都不可避免地經(jīng)歷過艱難的歷程并可能成為被研究的案例，F(xiàn)PGA也不例外。1985年，當(dāng)全球首款FPGA產(chǎn)品——XC2064誕生時，注定要使用大量芯片的PC機剛剛走出硅谷的實驗室進入商業(yè)市場，因特網(wǎng)只是科學(xué)家和政府機構(gòu)通信的神秘鏈路，無線電話笨重得像磚頭，日后大紅大紫的Bill Gates正在為生計而奮斗，創(chuàng)新的可編程產(chǎn)品似乎并沒有什么用武之地。 事實也的確如此。最初，F(xiàn)PGA只是用于膠合邏輯，從膠合邏輯到算法
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利用FPGA實現(xiàn)UART的設(shè)計
- 引 言 隨著計算機技術(shù)的發(fā)展和廣泛應(yīng)用，尤其是在工業(yè)控制領(lǐng)域的應(yīng)用越來越廣泛，計算機通信顯的尤為重要。串行通信雖然使設(shè)備之間的連線大為減少，但隨之帶來串／并轉(zhuǎn)換和位計數(shù)等問題，這使串行通信技術(shù)比并行通信技術(shù)更為復(fù)雜。串／并轉(zhuǎn)換可用軟件實現(xiàn)，也可用硬件實現(xiàn)。用軟件實現(xiàn)串行傳送大多采用循環(huán)移位指令將一個字節(jié)由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡單但速度慢，而且大量占用CPU的時間，影響系統(tǒng)的性能。更為方便的實現(xiàn)方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
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基于FPGA的八位RISC CPU的設(shè)計
- 1 引 言 隨著數(shù)字通信和工業(yè)控制領(lǐng)域的高速發(fā)展，要求專用集成電路（ASIC）的功能越來越強，功耗越來越低，生產(chǎn)周期越來越短，這些都對芯片設(shè)計提出了巨大的挑戰(zhàn)，傳統(tǒng)的芯片設(shè)計方法已經(jīng)不能適應(yīng)復(fù)雜的應(yīng)用需求了。SoC（System on a Chip）以其高集成度，低功耗等優(yōu)點越來越受歡迎。開發(fā)人員不必從單個邏輯門開始去設(shè)計ASIC，而是應(yīng)用己有IC芯片的功能模塊，稱為核（core），或知識產(chǎn)權(quán)（IP）宏單元進行快速設(shè)計，效率大為提高。CPU 的IP
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DCS控制器中采用ARM處理器的冗余設(shè)計
- 在自動化的許多領(lǐng)域，有效性的要求越來越高，因而對自動化系統(tǒng)的容錯水平的要求也變得越來越高，尤其在設(shè)備停機代價非常大的場合。為了滿足這些嚴(yán)格的要求，在DCS系統(tǒng)中通常采用冗余技術(shù)，這樣才能夠滿足這些領(lǐng)域所需要的安全性、可靠性和有效性的標(biāo)準(zhǔn)。 在DCS控制系統(tǒng)中，分布處理單元是系統(tǒng)關(guān)鍵的部分。當(dāng)前這些分布處理單元的控制器往往是基于86系列CPU建構(gòu)的，這種架構(gòu)目前被廣泛采用。但是由于86系列分布處理單元的特點，導(dǎo)致現(xiàn)在的控制器處理單元存在很多的缺點，如放熱量大等。
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Altera首次實現(xiàn)了對關(guān)鍵工業(yè)以太網(wǎng)協(xié)議的FPGA IP支持
- Altera公司日前宣布為工業(yè)自動化應(yīng)用中的以太網(wǎng)通信協(xié)議提供FPGA支持，這些應(yīng)用包括ProfiNet、Ethernet/IP、Modbus-IDA、EtherCAT、SERCOS III接口和Ethernet Powerlink等。這些關(guān)鍵通信協(xié)議的知識產(chǎn)權(quán)(IP)內(nèi)核現(xiàn)在可以在Altera低成本Cyclone®系列FPGA中實現(xiàn)。 設(shè)計人員利用工業(yè)以太網(wǎng)IP內(nèi)核可以在一塊電路板上實現(xiàn)任何標(biāo)準(zhǔn)，這不但減小了外形尺寸，而且節(jié)省了時間。系統(tǒng)OEM能夠以高性價比方式在其自動化產(chǎn)品中增加工業(yè)
- 關(guān)鍵字： 工業(yè)以太網(wǎng) FPGA IP 嵌入式 工業(yè)控制
基于FPGA的智能控制器設(shè)計及測試方法研究
- 摘要：通過模糊自整定PID控制器的設(shè)計，本文提出了一種基于VHDL描述、DSP Builder和Modelsim混合仿真、FPGA實現(xiàn)的智能控制器設(shè)計及測試新方法。首先，通過MATLAB仿真，得出智能控制器的結(jié)構(gòu)和參數(shù)。然后，基于VHDL進行智能控制器的數(shù)字化實現(xiàn)及其開環(huán)測試。在此基礎(chǔ)上，通過分析一般智能控制器的測試特點，采用DSP Builder構(gòu)建閉環(huán)測試系統(tǒng)，Modelsim運行DSP Builder生成文件來驗證QuartusII中所做VHDL設(shè)計的測試方法。實驗表明，該測試方法能有效模擬控制器的
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