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veriloghdl
Verilog HDL 模塊和端口以及門級(jí)建模
EDA/PCB
VerilogHDL
端口
建模
|
2018-08-03
Verilog HDL簡(jiǎn)明教程(part1)
嵌入式系統(tǒng)
VerilogHDL
FPGA
|
2017-10-11
Verilog門電平模型化
嵌入式系統(tǒng)
VerilogHDL
門級(jí)電路建模
硬件描述
門電平模型化
|
2017-06-06
Verilog HDL的歷史及設(shè)計(jì)流程
嵌入式系統(tǒng)
VerilogHDL
VHDL
設(shè)計(jì)流程
|
2017-06-06
3-DES IP核的VerilogHDL設(shè)計(jì)
嵌入式系統(tǒng)
IP核
流水線技術(shù)
VerilogHDL
DES加/解密
|
2017-06-05
32位定浮點(diǎn)數(shù)正余弦函數(shù)FPGA實(shí)現(xiàn)方法
嵌入式系統(tǒng)
Cordic算法
VerilogHDL
正余弦函數(shù)
|
2017-06-05
FPGA系統(tǒng)設(shè)計(jì)原則和技巧之：FPGA系統(tǒng)設(shè)計(jì)的3個(gè)基本原則
嵌入式系統(tǒng)
FPGA系統(tǒng)設(shè)計(jì)
高速基本單元
VerilogHDL
異步設(shè)計(jì)
同步設(shè)計(jì)
|
2017-06-05
基于Nios II的MIII總線轉(zhuǎn)換板設(shè)計(jì)
嵌入式系統(tǒng)
MIII總線
VerilogHDL
NiosII
|
2017-06-05
硬件描述語(yǔ)言Verilog HDL設(shè)計(jì)進(jìn)階之：使用函數(shù)實(shí)現(xiàn)簡(jiǎn)單的處理器
嵌入式系統(tǒng)
VerilogHDL
函數(shù)
處理器
FPGA
|
2017-06-05
硬件描述語(yǔ)言Verilog HDL設(shè)計(jì)進(jìn)階之：自動(dòng)轉(zhuǎn)換量程頻率計(jì)控制器
嵌入式系統(tǒng)
VerilogHDL
頻率計(jì)控制器
FPGA
|
2017-06-05
硬件描述語(yǔ)言Verilog HDL設(shè)計(jì)進(jìn)階之： 典型實(shí)例-狀態(tài)機(jī)應(yīng)用
嵌入式系統(tǒng)
VerilogHDL
狀態(tài)機(jī)
FPGA
|
2017-06-05
硬件描述語(yǔ)言Verilog HDL設(shè)計(jì)進(jìn)階之： 邏輯綜合的原則以及可綜合的代碼設(shè)計(jì)風(fēng)格
嵌入式系統(tǒng)
VerilogHDL
邏輯綜合
FPGA
|
2017-06-05
硬件描述語(yǔ)言Verilog HDL設(shè)計(jì)進(jìn)階之：有限狀態(tài)機(jī)的設(shè)計(jì)原理及其代碼風(fēng)格
嵌入式系統(tǒng)
VerilogHDL
有限狀態(tài)機(jī)
FSM
|
2017-06-05
硬件描述語(yǔ)言Verilog HDL設(shè)計(jì)進(jìn)階之：Verilog HDL高級(jí)語(yǔ)法結(jié)構(gòu)--函數(shù)
嵌入式系統(tǒng)
VerilogHDL
函數(shù)
function
|
2017-06-05
硬件描述語(yǔ)言Verilog HDL設(shè)計(jì)進(jìn)階之： Verilog HDL高級(jí)語(yǔ)法結(jié)構(gòu)—任務(wù)
嵌入式系統(tǒng)
VerilogHDL
任務(wù)
task
|
2017-06-05
硬件描述語(yǔ)言Verilog HDL設(shè)計(jì)進(jìn)階之：task和function說明語(yǔ)句的區(qū)別
嵌入式系統(tǒng)
VerilogHDL
task
function
|
2017-06-05
verilog HDL基礎(chǔ)之：實(shí)例3 數(shù)字跑表
嵌入式系統(tǒng)
VerilogHDL
計(jì)數(shù)器
華清遠(yuǎn)見
數(shù)字跑表
|
2017-06-05
Verilog HDL基礎(chǔ)之：時(shí)序邏輯電路
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
時(shí)序邏輯電路
D觸發(fā)器
|
2017-06-05
Verilog HDL基礎(chǔ)之：Verilog HDL語(yǔ)言簡(jiǎn)介
嵌入式系統(tǒng)
VerilogHDL
VHDL
Verilog-XL
華清遠(yuǎn)見
|
2017-06-05
Verilog HDL基礎(chǔ)之：賦值語(yǔ)句和塊語(yǔ)句
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
賦值語(yǔ)句
塊語(yǔ)句
阻塞賦值
|
2017-06-05
Verilog HDL基礎(chǔ)之：數(shù)據(jù)類型和運(yùn)算符
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
數(shù)據(jù)類型
運(yùn)算符
網(wǎng)絡(luò)類型變量
|
2017-06-05
Verilog HDL基礎(chǔ)之：實(shí)例5 交通燈控制器
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
FPGA
交通燈控制器
|
2017-06-05
Verilog HDL基礎(chǔ)之：程序基本結(jié)構(gòu)
嵌入式系統(tǒng)
VerilogHDL
數(shù)字邏輯電路
華清遠(yuǎn)見
|
2017-06-05
Verilog HDL基礎(chǔ)之：實(shí)例4 PS/2接口控制
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
|
2017-06-05
Verilog HDL基礎(chǔ)之：程序設(shè)計(jì)經(jīng)驗(yàn)（獨(dú)家）
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
|
2017-06-05
Verilog HDL基礎(chǔ)之：與C語(yǔ)言的區(qū)別與聯(lián)系（獨(dú)家）
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
C語(yǔ)言
|
2017-06-05
Verilog HDL基礎(chǔ)之：組合邏輯電路的實(shí)現(xiàn)(原創(chuàng))
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
數(shù)字邏輯電路
|
2017-06-05
Verilog HDL基礎(chǔ)之：條件語(yǔ)句
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
|
2017-06-05
Verilog HDL基礎(chǔ)之：其他常用語(yǔ)句
嵌入式系統(tǒng)
VerilogHDL
華清遠(yuǎn)見
|
2017-06-05
基于Verilog狀態(tài)機(jī)的PLC背板總線協(xié)議接口芯片設(shè)計(jì)
嵌入式系統(tǒng)
VerilogHDL
PLC背板
CPLD
|
2017-06-05
基于FPGA的多軸控制器設(shè)計(jì)
EDA/PCB
VerilogHDL
FPGA
多軸控制器
編碼器
四細(xì)分
|
2016-10-18
基于VerilogHDL的FIR數(shù)字濾波器設(shè)計(jì)與仿真
嵌入式系統(tǒng)
VerilogHDL
FIR數(shù)字濾波器
|
2014-01-04
基于VerilogHDL的SDX總線與Wishbone總線接口轉(zhuǎn)化的設(shè)計(jì)與實(shí)現(xiàn)
嵌入式系統(tǒng)
SDX總線
VerilogHDL
Wishbone總線
|
2012-09-08
基于VerilogHDL語(yǔ)言的FIR數(shù)字濾波器設(shè)計(jì)與實(shí)現(xiàn)
手機(jī)與無線通信
濾波器
設(shè)計(jì)
實(shí)現(xiàn)
數(shù)字
FIR
VerilogHDL
語(yǔ)言
基于
|
2012-08-21
VerilogHDL綜合性設(shè)計(jì)
嵌入式系統(tǒng)
設(shè)計(jì)
綜合性
VerilogHDL
|
2012-07-24
基于VerilogHDL濾波器的設(shè)計(jì)
嵌入式系統(tǒng)
濾波器
VerilogHDL
|
2011-08-30
基于FPGA的空間存儲(chǔ)器的糾錯(cuò)系統(tǒng)的設(shè)計(jì)
嵌入式系統(tǒng)
BCH碼
FPGA
VerilogHDL
AMS
|
2010-12-26
基于VerilogHDL的CMOS圖像敏感器驅(qū)動(dòng)電路設(shè)計(jì)
工控自動(dòng)化
驅(qū)動(dòng)
電路設(shè)計(jì)
敏感
圖像
VerilogHDL
CMOS
基于
|
2010-12-08
基于VerilogHDL的小波濾波器的設(shè)計(jì)與實(shí)現(xiàn)
EDA/PCB
VerilogHDL
小波濾波器
|
2009-05-06
基于VerilogHDL的背景噪聲扣除電路設(shè)計(jì)
EDA/PCB
VerilogHDL
背景
電路設(shè)計(jì)
|
2008-04-18
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英偉達(dá)或于3月推出CPO交換機(jī)新品
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電路設(shè)計(jì)
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